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公开(公告)号：CN116482935A
公开(公告)日：2023-07-25
申请号：CN202211535262.9
申请日：2022-12-02
Abstract: 本发明涉及一种形成图案的方法。该方法包括：在基板上涂覆含金属的抗蚀剂组合物，沿着基板的边缘顺序地涂覆两种类型的用于去除边缘珠粒的组合物，执行包括干燥和加热的热处理以在基板上形成含金属的抗蚀剂膜，以及对该含金属的抗蚀剂膜进行曝光和显影以形成抗蚀剂图案；或在基板上涂覆含金属的抗蚀剂组合物，沿着基板的边缘涂覆用于去除边缘珠粒的组合物，执行包括干燥和加热的热处理以在基板上形成含金属的抗蚀剂膜，曝光含金属的抗蚀剂膜，以及用显影液组合物显影以形成抗蚀剂图案，其中，两种类型的用于去除边缘珠粒的组合物和显影液组合物的细节如说明书中所述。
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公开(公告)号：CN115881731A
公开(公告)日：2023-03-31
申请号：CN202211129273.7
申请日：2022-09-16
Applicant: 三星电子株式会社
IPC: H01L27/092 , H01L23/528 , H01L23/48
Abstract: 一种半导体器件包括：有源区，在衬底上沿第一方向延伸；栅电极，与有源区相交并沿垂直于第一方向的第二方向延伸；接触结构，在栅电极的一侧设置在有源区上并沿第二方向延伸；以及第一过孔，设置在接触结构上以连接到接触结构，并且第一过孔具有在第二方向上的长度大于在第一方向上的长度的形状。多个第一金属互连被设置，多个第一金属互连在第一过孔上沿第一方向延伸并连接到第一过孔。第二过孔被设置，第二过孔设置在多个第一金属互连上以连接到多个第一金属互连，并且第二过孔具有在第二方向上的长度大于在第一方向上的长度的形状。
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公开(公告)号：CN106469724B
公开(公告)日：2021-10-19
申请号：CN201610685667.9
申请日：2016-08-18
Applicant: 三星电子株式会社
IPC: H01L27/092
Abstract: 本发明提供了一种半导体装置，该半导体装置包括：衬底，其具有第一逻辑单元、第二逻辑单元和第三逻辑单元；有源图案，其设置在第一逻辑单元至第三逻辑单元中的每一个中，以从衬底突出；以及栅极结构，其与有源图案交叉。第二逻辑单元和第三逻辑单元在第一方向上彼此间隔开，并且第一逻辑单元介于它们之间。有源图案在第一方向上排列，并且在与第一方向交叉的第二方向上延伸。当在第一方向上测量时，分别在第一逻辑单元和第二逻辑单元中的最邻近的一对有源图案之间的距离与分别在第一逻辑单元和第三逻辑单元中的最邻近的一对有源图案之间的距离不同。
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公开(公告)号：CN106876365B
公开(公告)日：2021-05-04
申请号：CN201610939502.X
申请日：2016-10-24
Applicant: 三星电子株式会社
IPC: H01L23/522 , H01L23/528
Abstract: 一种逻辑半导体器件，包括：多个有源图案，在水平方向上延伸并且在垂直方向上彼此间隔开；隔离层，限定所述有源图案；在有源图案和隔离层上在垂直方向上延伸的多个栅极图案，所述栅极图案在水平方向上彼此间隔开；多个下配线，在栅极图案上方在水平方向上延伸；多个上配线，在下配线上方在垂直方向上延伸；贯穿接触，连接上配线中的至少一个上配线以及栅极图案中的至少一个栅极图案，贯穿接触从上配线的底表面延伸到相对于有源图案的下配线之一的底表面之下的位置。
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公开(公告)号：CN109216346A
公开(公告)日：2019-01-15
申请号：CN201810251133.4
申请日：2018-03-26
Applicant: 三星电子株式会社
IPC: H01L27/02 , H01L23/535 , H01L21/768
Abstract: 一种集成电路器件可以包括：鳍型有源区域，在基板上在第一方向上延伸；绝缘分隔结构，在鳍型有源区域上在与第一方向交叉的第二方向上延伸；一对分开的栅线，彼此间隔开而使绝缘分隔结构在其间，并在第二方向上延伸以与绝缘分隔结构对准；一对源极/漏极区域，位于鳍型有源区域上并彼此间隔开而使绝缘分隔结构位于其间；以及跨接接触，位于绝缘分隔结构之上并且连接在所述一对源极/漏极区域之间。
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Patent Agency Ranking
公开(公告)号：CN109037215A
公开(公告)日：2018-12-18
申请号：CN201810475600.1
申请日：2018-05-17
Applicant: 三星电子株式会社
IPC: H01L27/092 , H01L21/8238
Abstract: 本发明公开一种半导体器件以及制造半导体器件的方法。所述半导体器件包括：第一逻辑单元及第二逻辑单元，在衬底上在第一方向上彼此相邻；栅极电极，在第一逻辑单元及第二逻辑单元的每一者中在第一方向上延伸；电源线，在第一逻辑单元与第二逻辑单元之间的边界处在第二方向上延伸；以及连接结构，将电源线电连接到第一逻辑单元的有源图案及第二逻辑单元的有源图案。连接结构位于电源线下方且从第一逻辑单元延伸到第二逻辑单元。连接结构的顶表面处于比栅极电极的顶表面的水平高度高的水平高度。在本发明的半导体器件中，单个连接结构可将电源线电连接到不同逻辑单元的源极/漏极区。由此，半导体器件的集成度可因此得到提高且制造可因此得到简化。
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公开(公告)号：CN107919358A
公开(公告)日：2018-04-17
申请号：CN201710880103.5
申请日：2017-09-26
Applicant: 三星电子株式会社
IPC: H01L27/088 , H01L21/8234
CPC classification number: H01L23/535 , H01L21/76826 , H01L21/76829 , H01L21/76831 , H01L21/76889 , H01L21/76895 , H01L21/76897 , H01L21/823431 , H01L21/823475 , H01L21/823481 , H01L21/845 , H01L27/088 , H01L27/0886 , H01L27/1211 , H01L29/0649 , H01L29/0847 , H01L29/41791 , H01L29/66545 , H01L29/785
Abstract: 一种半导体器件和制造半导体器件的方法，该器件包括：在衬底上的栅极结构；分别在衬底的邻近栅极结构的部分上的源极/漏极层；分别接触源极/漏极层的上表面的第一接触插塞；接触栅极结构中的一个的第二接触插塞，第二接触插塞的侧壁由绝缘间隔物覆盖；以及共同地接触栅极结构中的至少一个的上表面和第一接触插塞中的至少一个的第三接触插塞，第三接触插塞的侧壁的至少一部分不被绝缘间隔物覆盖。
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公开(公告)号：CN117116930A
公开(公告)日：2023-11-24
申请号：CN202310449538.X
申请日：2023-04-24
Applicant: 三星电子株式会社
IPC: H01L27/02
Abstract: 半导体器件包括：第一标准单元，在衬底上布置在第一行中，并且分别包括第一基底有源区；第二标准单元，布置在与第一行相邻的第二行中，并且分别包括第二基底有源区；电力线；以及器件隔离层，其中，在平面图中，第一标准单元和第二标准单元具有相同的单元高度，每个第一标准单元的第一基底有源区包括具有第一导电类型的第一有源线以及具有第二导电类型的第二有源线，每个第二标准单元的第二基底有源区包括具有第一导电类型的第三有源线以及具有第二导电类型的第四有源线，布置在第一行中的第一标准单元的第一有源线具有相同的第一宽度，布置在第二行中的第二标准单元的第三有源线具有相同的第二宽度，并且第一宽度窄于第二宽度。
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公开(公告)号：CN108962913B
公开(公告)日：2023-07-18
申请号：CN201810499974.7
申请日：2018-05-23
Applicant: 三星电子株式会社
IPC: H01L27/118
Abstract: 本公开提供了集成电路器件。一种集成电路器件包括：在第一型式逻辑单元中在第一方向上平行地布置的一对参考导电线以及在第二型式逻辑单元中平行地布置的一对交换导电线，其中所述一对参考导电线和所述一对交换导电线中的在不同布线轨迹中的一个参考导电线和一个交换导电线具有相同的平面形状和相同的长度，并延伸以交叉第一型式逻辑单元和第二型式逻辑单元之间的单元边界。
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