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公开(公告)号：CN116775264A
公开(公告)日：2023-09-19
申请号：CN202210242874.2
申请日：2022-03-11
Applicant: 华为技术有限公司 , 中国科学院上海微系统与信息技术研究所
IPC: G06F9/50
Abstract: 一种进程管理方法和电子设备。在该方法中，能在系统运行过程中实时将易失性内存中的进程数据迁移到非易失性内存。实施本申请提供的技术方案，在系统休眠时不需要打包备份内存中的数据，在系统唤醒或重启时也不需要解析重构数据，能快速休眠和唤醒系统。且即使面对意外掉电等情况而重启，也可以避免内存中的关键数据丢失，同样能提升系统唤醒或重启的速度。
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公开(公告)号：CN113539327A
公开(公告)日：2021-10-22
申请号：CN202110779019.0
申请日：2021-07-09
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G11C13/00 , G06F16/903
Abstract: 本发明涉及一种相变存储单元实现快速逻辑计算装置及数据检索方法，装置包括相变存储阵列和外围控制电路，相变存储阵列包括两个相变存储逻辑算子；相变存储逻辑算子包括两个相变存储单元，两个相变存储单元的一端均与同一位线相连，另一端与各自的选通管的漏端相连，选通管的源端接地，相变存储逻辑算子中的一个相变存储单元的选通管的栅极与第一字线相连，另一个相变存储单元的选通管的栅极与第二字线相连；外围控制电路将初始数据信息写入相变存储阵列中，选通管根据第一字线和第二字线上的信号选通相变存储单元，使得相变存储单元中存储的信息与位线上的脉冲信号进行逻辑运算。本发明能够减少数据匹配计算量，实现高效的数据检索。
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公开(公告)号：CN105632551B
公开(公告)日：2018-09-25
申请号：CN201510960374.2
申请日：2015-12-18
Applicant: 中国科学院上海微系统与信息技术研究所
Abstract: 本发明提供一种存储阵列、存储对象逻辑关系的存储芯片及方法，存储阵列包括：第一引出线和第二引出线，不同编号的第一引出线和第二引出线之间分别连接一存储单元，相同编号的第一引出线和第二引出线之间分别连接一可控开关。存储芯片包括：接口模块；产生控制信号的控制模块；产生写电流、擦电流或读电流的驱动模块；选通第一、第二引出线的第一、第二译码器；以及存储逻辑关系值的存储阵列。存储方法包括：写入和读出操作。本发明通过全新的存储阵列实现对象间的逻辑关系的存储；同时在读出时，通过可控开关在相同编号的引出线间传递，将结果转换为条件，以此综合间接关系因素，可用于仿脑智能应用场景，提高存储阵列中的信息量。
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公开(公告)号：CN108052541A
公开(公告)日：2018-05-18
申请号：CN201711174508.3
申请日：2017-11-22
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G06F17/30
Abstract: 本发明提供一种基于多级页表目录结构的文件系统的实现、访问方法、终端，包括：以页为单位管理文件系统中所有文件数据；在文件系统中设置iNode区和数据区；所述数据区包括目录页和数据页，所述iNode区所存储的iNode节点包括iNode节点信息字段、页表级数字段N和根目录地址字段；以文件所对应的第N级目录页页号为根目录，以第（N‑1）级目录页页号为第1级子目录，以此类推，第1级目录页页号为第（N‑1）级子目录，形成一个N级页表目录结构来对文件数据进行存储管理，第1级目录页为数据页；将数据页的逻辑顺序作为多级页表目录结构的遍历顺序。本发明的基于多级页表目录结构的文件系统的实现、访问方法、终端实现了文件数据在物理存储空间内的随机存储。
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公开(公告)号：CN107591179A
公开(公告)日：2018-01-16
申请号：CN201710813137.2
申请日：2017-09-11
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G11C13/00
Abstract: 本发明提供一种扩展存储器操作次数的电路结构及方法，所述电路结构包括N位循环计数器电路，与所述N位循环计数器电路连接的N个地址产生电路，及与N个所述地址产生电路连接存储器阵列，通过把对一个存储器字的N次操作分散到N个不同的存储器字中，避免了对一个存储器字的过度操作，在每次掉电时，把触发器电路的状态存储在非挥发相变存储器中，在每次上电时，读出非挥发相变存储器中的数据，使触发器电路及N位循环计数器电路恢复到掉电前状态，实现了存储器字在任何情况下的均衡操作。通过本发明所述一种扩展存储器操作次数的电路结构及方法，解决了现有技术中相变存储器无法实现每个存储单元的读写擦均衡的问题。
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Patent Agency Ranking
公开(公告)号：CN102890963B
公开(公告)日：2016-08-17
申请号：CN201110202834.7
申请日：2011-07-20
Applicant: 中国科学院上海微系统与信息技术研究所
Abstract: 本发明提供一种非易失性随机存储器件（100），其包括由若干存储单元块（111）构成的存储单元阵列（110）以及和所述存储单元阵列（110）相连接的外围电路；所述外围电路包括用于根据地址输入信息选中相应存储单元块的地址译码电路（120）、存储所有存储单元块的操作模式信息并在控制信号（160）作用下重新写入的块操作模式信息寄存器（130）、根据块操作模式信息寄存器（130）中存储的操作模式信息输出某一写操作模式到存储单元阵列的写驱动电路（140）以及根据块操作模式信息寄存器（130）中存储的操作模式信息输出某一读操作模式到存储单元阵列的读出电路（150）。本发明兼容两种不同操作模式的相变存储器简化接口设计，节约设计面积，减少功耗，提高速度。
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公开(公告)号：CN103246610B
公开(公告)日：2016-06-15
申请号：CN201210032785.1
申请日：2012-02-14
Applicant: 中国科学院上海微系统与信息技术研究所
Abstract: 本发明提供一种基于单类型存储器的嵌入式系统的动态存储管理方法，该嵌入式系统包括预存有内核及文件系统启动加载信息和引导程序的启动程序存储区及建置有内核及文件系统的系统RAM区，该方法是在引导程序启动后，基于启动信息加载内核与文件系统；然后在系统RAM区标记出已用内存区及可用内存区；最后系统接收到更新或搬移指令时，申请系统RAM区中是否有连续可用的内存块，若是，则写入内核或文件系统的更新或搬移数据，若否，则整理该可用内存区中的碎片并将各该碎片合并成连续可用的内存块，以将内核或文件系统的更新或搬移数据写入该内存块，本发明模糊了内存与外存的界限，统一了存储架构，把外存管理纳入了内存管理之中，解决了不便管理等问题。
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公开(公告)号：CN104715792A
公开(公告)日：2015-06-17
申请号：CN201310674694.2
申请日：2013-12-11
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G11C11/56
CPC classification number: G11C13/0004 , G11C13/0069 , G11C13/0097
Abstract: 本发明提供一种具有初始化功能的相变存储器写擦电路，所述相变存储器写擦电路至少包括：初始化控制电路，与电源连接，用于接入内部电路上电复位信号及外部信号并发出初始化复位信号；初始化电路，包括原始电流源；所述初始化电路与所述电源及所述初始化控制电路连接，并在所述初始化复位信号的控制下发出复位电流脉冲使相变存储单元初始化；写擦控制电路，包括写擦控制信号产生电路及与所述写擦控制信号产生电路相连的写擦操作电路；所述写擦操作电路连接于所述电源及所述相变存储单元之间。本发明可以提高相变存储器的位合格率，同时还具有快速写擦功能。
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公开(公告)号：CN102324840B
公开(公告)日：2015-05-13
申请号：CN201110123472.2
申请日：2011-05-13
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H02M3/07
Abstract: 本发明揭示了一种电荷泵及其工作方法，所述电荷泵包括参考电压发生电路、电压比较器、时钟发生器、电荷转移电容、稳压电容、第一开关、第二开关、第三开关、及第四开关；通过对电荷转移电容充电，并将充电完毕的电荷转移电容上的电荷转移到电荷泵输出端上，输出高于输入电压的电平，每次对电荷转移电容充电时，并未将电荷转移电容充满，只是将电荷转移电容充到设定的电压后停止充电。本发明可增加电荷泵的转换效率，降低电荷泵电路输出电压纹波。
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公开(公告)号：CN104571946A
公开(公告)日：2015-04-29
申请号：CN201410708797.0
申请日：2014-11-28
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G06F3/06
CPC classification number: G06F3/0611
Abstract: 本发明提供一种支持逻辑电路快速查询的存储器装置及其访问方法，所述存储器装置至少包括：存储器、由逻辑电路和控制器组成的存储器控制器、连接于逻辑电路和服务器之间的接口。本发明通过逻辑电路对存储器内部数据进行搜索，并不需要服务器CPU来参与数据的查询工作，节约了CPU的时间，减少了数据的迁移、数据的查询等，从而减少了服务器的任务，提高了系统的性能。使用逻辑电路进行查询，且利用逻辑电路系统并行执行的能力，使查询数据的速度更快。
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