半导体装置及半导体装置的工作方法

    公开(公告)号:CN113302778A

    公开(公告)日:2021-08-24

    申请号:CN202080009103.8

    申请日:2020-01-14

    Abstract: 提供一种新颖结构的电池控制电路、新颖结构的电池保护电路以及包括该电池电路的蓄电装置。本发明提供一种半导体装置,在分别对应于一个二次电池的n组的单元平衡电路中,包括晶体管、比较电路、电容器,在n组的单元平衡电路的每一个中,电连接晶体管的源极和漏极中的一个与比较电路的反相输入端子及电容器的一个电极,对电容器的另一个电极供应接地电位,晶体管成为开启状态,对电容器的一个电极供应第一电位,晶体管成为关闭状态,电连接电容器的另一个电极与对应于单元平衡电路的每一个的二次电池的负极,对电容器的一个电极供应第一电位与对应于单元平衡电路的每一个的二次电池的负极的电位之和,以控制对应于单元平衡电路的每一个的二次电池的充电。

    半导体装置及电子设备
    5.
    发明公开

    公开(公告)号:CN105703760A

    公开(公告)日:2016-06-22

    申请号:CN201510941255.2

    申请日:2015-12-16

    CPC classification number: H03K19/018521 H03K3/356104 H03K19/0016 H03K19/003

    Abstract: 本发明提供能够抑制电源电压上升之后高电平信号非意图地输出的半导体装置及电子设备。半导体装置包括:第一缓冲电路、电平转移电路及第二缓冲电路。通过对第一缓冲电路供给第一电位,并对电平转移电路及第二缓冲电路供给第二电位,来恢复到原来的状态。在供给第二电位之前供给第一电位。通过先对第一缓冲电路供给第一电位,来成为能控制电平转移电路及第二缓冲电路的工作的状态,由此抑制高电平信号非意图地输出到连接到第二缓冲电路的布线。

    运算装置及电子设备
    6.
    发明公开

    公开(公告)号:CN117519454A

    公开(公告)日:2024-02-06

    申请号:CN202311475196.5

    申请日:2018-08-28

    Abstract: 提供一种功耗小的运算装置及电子设备。提供一种能够进行高速工作的运算装置及电子设备。提供一种能够抑制发热的运算装置及电子设备。上述运算装置包括第一运算部及第二运算部。第一运算部包括第一CPU核心及第二CPU核心。第二运算部包括第一GPU核心及第二GPU核心。CPU核心具有进行电源门控的功能且包括连接于触发器的第一数据保持电路。第一GPU核心保持模拟值且包括能够作为2位以上的数字数据读出的第二数据保持电路。第二GPU核心保持数字值且包括能够作为1位数字数据读出的第三数据保持电路。第一至第三数据保持电路分别具有包括氧化物半导体的晶体管及电容器。

    单极性电平转移电路及半导体装置

    公开(公告)号:CN112889138A

    公开(公告)日:2021-06-01

    申请号:CN201980068258.6

    申请日:2019-10-16

    Abstract: 提供一种能够使用n沟道型晶体管向负电位方向进行电平转换的半导体装置。半导体装置包括第一源极跟随器、第二源极跟随器及比较器。第一源极跟随器被供应第二高电源电位及低电源电位,第二源极跟随器被供应第一高电源电位及低电源电位,第一源极跟随器被输入使用第二高电源电位及第一高电源电位表示高电平或低电平的数字信号。在此,第二高电源电位比第一高电源电位高,第一高电源电位比低电源电位高。比较器对第一源极跟随器与第二源极跟随器的输出电位进行比较并输出使用第一高电源电位及低电源电位表示高电平或低电平的数字信号。

    半导体装置
    10.
    发明公开
    半导体装置 审中-公开

    公开(公告)号:CN111989865A

    公开(公告)日:2020-11-24

    申请号:CN201980026896.1

    申请日:2019-04-08

    Abstract: 提供一种低功耗且能够稳定工作的半导体装置。包括具有沟道形成区中含有氧化物半导体的晶体管的电路结构的逻辑电路。逻辑电路是2输入2输出的二线式逻辑电路。构成逻辑电路的晶体管分别具有栅极及背栅极。输入端子与电连接到提供高电源电位的布线的晶体管的栅极和背栅极中的一方电连接。输出端子与电连接到提供高电源电位的布线的晶体管的栅极和背栅极中的另一方电连接。输出端子与电连接到提供低电源电位的布线的晶体管的源极和漏极中的一方电连接。电连接到提供低电源电位的布线电连接的晶体管的栅极或背栅极与输入端子电连接。

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