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公开(公告)号:CN112583382A
公开(公告)日:2021-03-30
申请号:CN202011064307.X
申请日:2020-09-30
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K3/356
Abstract: 本揭露提供一种正反器。本文所述的电路、系统以及方法用于增加主从式正反器的保持时间。一种正反器包含用以接收扫描输入信号并产生延迟扫描输入信号的电路;用以接收数据信号以及延迟扫描输入信号的主闩锁器;耦接主闩锁器的从闩锁器。主闩锁器基于主闩锁器接收的扫描致能信号选择性提供数据信号或延迟扫描输入信号的一者至从闩锁器。
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公开(公告)号:CN113141177B
公开(公告)日:2024-09-06
申请号:CN202110057326.8
申请日:2021-01-15
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K19/20
Abstract: 一种时钟门控电路,包括NOR逻辑门、传输门、交叉耦合对的晶体管以及第一晶体管。NOR逻辑门耦合到第一节点,并接收第一使能信号和第二使能信号,并输出第一控制信号。传输门耦合在第一节点与第二节点之间,并接收第一控制信号、反相时钟输入信号和时钟输出信号。交叉耦合对的晶体管耦合在第二节点与输出节点之间,并接收至少第二控制信号。第一晶体管包括:被配置为接收反相时钟输入信号的第一栅极端子;耦合到输出节点的第一漏极端子;以及耦合到参考电源的第一源极端子。第一晶体管响应于反相时钟输入信号来调节时钟输出信号。本发明的实施例还涉及操作时钟门控电路的方法。
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公开(公告)号:CN113141177A
公开(公告)日:2021-07-20
申请号:CN202110057326.8
申请日:2021-01-15
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K19/20
Abstract: 一种时钟门控电路,包括NOR逻辑门、传输门、交叉耦合对的晶体管以及第一晶体管。NOR逻辑门耦合到第一节点,并接收第一使能信号和第二使能信号,并输出第一控制信号。传输门耦合在第一节点与第二节点之间,并接收第一控制信号、反相时钟输入信号和时钟输出信号。交叉耦合对的晶体管耦合在第二节点与输出节点之间,并接收至少第二控制信号。第一晶体管包括:被配置为接收反相时钟输入信号的第一栅极端子;耦合到输出节点的第一漏极端子;以及耦合到参考电源的第一源极端子。第一晶体管响应于反相时钟输入信号来调节时钟输出信号。本发明的实施例还涉及操作时钟门控电路的方法。
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