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公开(公告)号：CN114123997A
公开(公告)日：2022-03-01
申请号：CN202110945757.8
申请日：2021-08-17
Applicant: 株式会社村田制作所
Abstract: 本发明提供一种抑制功率效率的下降的功率放大电路。功率放大电路包含：高通滤波器，在一端输入高频输入信号；第1放大器，将从高通滤波器的另一端输出的高频输入信号放大，并输出放大后的高频信号；第2放大器，将高频信号放大，并输出放大后的高频输出信号；自耦变压器，进行第1放大器与第2放大器之间的阻抗匹配；和阻抗电路，一端与高通滤波器的另一端电连接，另一端与向第1放大器输出偏置电压或偏置电流的偏置电路的输出端子电连接，并将从高通滤波器的另一端输出的高频输入信号输出到偏置电路。
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公开(公告)号：CN112491370A
公开(公告)日：2021-03-12
申请号：CN202010925740.1
申请日：2020-09-04
Applicant: 株式会社村田制作所
Abstract: 本发明的课题在于，在确保功率放大电路的2个功率放大路径的隔离度的同时，减少功率损耗。功率放大电路包括：第1路径以及第2路径，设置在输入端子与输出端子之间；第1放大器，设置于第1路径，在第1模式的情况下成为工作状态；第2放大器，设置于第2路径，在第2模式的情况下成为工作状态；第1匹配电路，在第1路径中，设置在第1放大器与输出端子之间；第1电容器，一端与第1匹配电路的输出端子侧连接；第1电感器，一端与第1电容器的另一端连接，另一端接地；和短路开关，与第1电感器并联地设置，短路开关在第1模式的情况下将第1电感器的两端短路，在第2模式的情况下成为开路状态。
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公开(公告)号：CN112087203A
公开(公告)日：2020-12-15
申请号：CN202010539871.6
申请日：2020-06-12
Applicant: 株式会社村田制作所
Abstract: 提供一种功率放大电路，是在通过差分放大器结构将功率放大的功率放大电路中高效率的功率放大电路。功率放大电路(10)具备功率分配器(101)、从输出端子(2011)输出放大信号(RF3)的放大器(201)、以及从输出端子(2021)输出放大信号(RF4)的放大器(202)。此外，功率放大电路(10)具备连接在输出端子(2011)与输出端子(2012)之间的终止电路(301)、传输线路(401)、传输线路(402)、连接在传输线路(401)的另一端与传输线路(402)的另一端之间的终止电路(501)、以及功率合成器(601)。
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公开(公告)号：CN110829982A
公开(公告)日：2020-02-21
申请号：CN201910728083.9
申请日：2019-08-07
Applicant: 株式会社村田制作所
Abstract: 本发明提供一种在使放大器与前级的电路的阻抗匹配的同时使线性提高的功率放大电路，具备：放大晶体管；偏置电路，对放大晶体管供给偏置电流或电压；以及第一电阻元件，连接在放大晶体管的基极与偏置电路之间，偏置电路具备：电压生成电路；第一晶体管，在基极被供给第一直流电压并从发射极供给偏置电流或电压；第二晶体管，在基极被供给第二直流电压且发射极与第一晶体管的发射极连接；信号供给电路，对第二晶体管的基极供给输入信号；以及阻抗电路，设置在第一晶体管的基极与第二晶体管的基极之间，在以第一模式动作的情况下，电压生成电路被控制为接通状态，在以功率电平比第一模式小的第二模式动作的情况下，电压生成电路被控制为断开状态。
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公开(公告)号：CN108512515A
公开(公告)日：2018-09-07
申请号：CN201810160395.X
申请日：2018-02-26
Applicant: 株式会社村田制作所
Abstract: 本发明提供一种功率放大电路，在对放大器和前级的电路的阻抗进行匹配的同时提高功率增益的线性。功率放大电路具备：放大晶体管，在基极被供给输入信号，并从集电极输出放大信号；偏置电路，对放大晶体管的基极供给偏置电流或电压；以及第一电阻元件，连接在放大晶体管的基极与偏置电路之间，偏置电路具备：电压生成电路；第一晶体管，在基极被供给第一直流电压，并从发射极供给偏置电流或电压；第二晶体管，在基极被供给第二直流电压，发射极与第一晶体管的发射极连接；信号供给电路，设置在放大晶体管的基极与第二晶体管的基极之间，对第二晶体管的基极供给输入信号；以及阻抗电路，设置在第一晶体管的基极与第二晶体管的基极之间。
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Patent Agency Ranking
公开(公告)号：CN108111135A
公开(公告)日：2018-06-01
申请号：CN201710872537.0
申请日：2017-09-25
Applicant: 株式会社村田制作所
CPC classification number: H03F1/0205 , H03F1/0261 , H03F1/22 , H03F1/56 , H03F1/565 , H03F3/195 , H03F3/213 , H03F2200/222 , H03F2200/387 , H03F2200/411 , H03F2200/451 , H03F2200/516 , H03F3/21 , H03F1/0222 , H03F3/19 , H03F3/245 , H03F2200/504
Abstract: 本发明提供一种能够抑制电路规模的增大，并且实现最大输出功率的增大的功率放大电路。本发明的功率放大电路包括：第一晶体管；第二晶体管；第一偏置电路，其提供第一偏置电流或电压；第二偏置电路，其提供第二偏置电流或电压；第一电感器；以及第一电容器，对第一晶体管的集电极提供电源电压，第一晶体管的发射极接地，对第一晶体管的基极提供无线频率信号以及第一偏置电流或电压，对第二晶体管的集电极提供电源电压，第二晶体管的发射极通过第一电容器与第一晶体管的集电极连接，并且通过第一电感器接地，对第二晶体管的基极提供第二偏置电流或电压，从第二晶体管的集电极输出将无线频率信号放大后的放大信号。
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公开(公告)号：CN107863942A
公开(公告)日：2018-03-30
申请号：CN201710541979.7
申请日：2017-07-05
Applicant: 株式会社村田制作所
CPC classification number: H03F3/21 , H03F1/0261 , H03F1/22 , H03F1/34 , H03F3/191 , H03F3/245 , H03F2200/144 , H03F2200/18 , H03F2200/318 , H03F2200/408 , H03F2200/451 , H03F3/193 , H03F2200/504
Abstract: 本发明提供一种对发送信号进行斜率控制的功率放大模块，其能抑制电路增大。功率放大模块包括：输出第一电流的第一电流源，该第一电流与用于控制放大信号的信号电平的电平控制电压相应；输出与电平控制电压相应的第二电流的第二电流源；第一晶体管，其基极被提供输入信号和第一偏置电流，其发射极接地；第二晶体管，其发射极连接至第一晶体管的集电极，其基极被提供第二电流，并从集电极输出将输入信号放大后的第一放大信号；以及第三晶体管，其集电极被提供第一电流，其基极被提供偏置控制电流或电压，并从发射极向第一晶体管的基极提供第一偏置电流。
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公开(公告)号：CN119652271A
公开(公告)日：2025-03-18
申请号：CN202411234028.1
申请日：2024-09-04
Applicant: 株式会社村田制作所
Inventor： 本多悠里
Abstract: 本发明提供一种即使在高频信号的振幅大的情况下也能够抑制晶体管的击穿的功率放大器。一种功率放大器，具有多级放大部，放大部包含进行了发射极接地的晶体管，其中，具备：第1放大部，具有将输入的高频信号放大的第1晶体管；第2放大部，具有将第1放大部的输出放大的第2晶体管；电压检测电路，至少具备阻抗元件，设置在第1晶体管与第2晶体管之间；以及保护电路，基于包含所述阻抗元件的电压检测电路的输出，使向第1晶体管以及第2晶体管中的至少一者提供的基极偏置电流减少。
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公开(公告)号：CN112087203B
公开(公告)日：2024-07-30
申请号：CN202010539871.6
申请日：2020-06-12
Applicant: 株式会社村田制作所
Abstract: 提供一种功率放大电路，是在通过差分放大器结构将功率放大的功率放大电路中高效率的功率放大电路。功率放大电路(10)具备功率分配器(101)、从输出端子(2011)输出放大信号(RF3)的放大器(201)、以及从输出端子(2021)输出放大信号(RF4)的放大器(202)。此外，功率放大电路(10)具备连接在输出端子(2011)与输出端子(2012)之间的终止电路(301)、传输线路(401)、传输线路(402)、连接在传输线路(401)的另一端与传输线路(402)的另一端之间的终止电路(501)、以及功率合成器(601)。
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公开(公告)号：CN110391788B
公开(公告)日：2023-06-27
申请号：CN201910297010.9
申请日：2019-04-12
Applicant: 株式会社村田制作所
Abstract: 本发明提供一种功率放大器的控制电路，能够使输出特性变得适当。控制电路具备：第1输出部，将对偏置电路的电偏置状态进行设定的恒定的偏置电流输出到偏置电路；第2输出部，将对偏置电路的电偏置状态进行控制的偏置控制电流或恒定电压输出到偏置电路；电阻，一端与基准电位连接；和开关，设置在电阻的另一端与第2输出部的输出端子之间。
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