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公开(公告)号:CN101741372B
公开(公告)日:2013-01-02
申请号:CN200910208332.8
申请日:2009-11-10
Applicant: 瑞萨电子株式会社
CPC classification number: H03L7/0814 , G06F1/10 , G06F1/3203 , G06F1/324 , G06F1/3296 , H03L7/0818 , H03L7/089 , Y02D10/126 , Y02D10/172
Abstract: 本发明提供一种半导体集成电路和时钟同步化控制方法,能够以低成本且高精度地对DVFS控制对象电路区域抑制该区域在电源电压变更工作中的工作性能劣化。如下这样的时钟同步化控制中,进行工作,使得在变更第一电路的电源电压的过程中也能使比较的两个时钟的相位落入设计值内,该时钟同步化控制为:在对将时钟传输到使用第一电源电压(VDDA)进行工作的第一电路(FVA)的路径与将时钟传输到使用第二电源电压(VDDB)进行工作的第二电路(NFVA)的路径之间的时钟进行时钟延迟调整时,在VDDA和VDDB为相同电压时,用不含有相位调整用的延迟元件的路径分配向FVA分配的时钟,在降低FVA区域的电源电压时,暂时以错开1周期~2周期的相位将向FVA区域分配的时钟分配于FVA区域,并使双方的时钟(CKAF、CKBF)同步化。
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公开(公告)号:CN103105882A
公开(公告)日:2013-05-15
申请号:CN201210451048.5
申请日:2012-11-12
Applicant: 瑞萨电子株式会社
IPC: G05F1/56
CPC classification number: G05F1/59 , G06F1/26 , H01L23/5286 , H01L2924/0002 , H02M2001/0045 , H03K17/102 , H01L2924/00
Abstract: 本发明提供了一种半导体集成电路,该半导体集成电路包括:多个输出晶体管,每个输出晶体管根据施加到控制端的阻抗控制信号所指示的控制值,相对于负载电流的量值控制输出电压的量值;电压监控电路,其输出输出电压监控值,该输出电压监控值指示输出电压的电压值;以及控制电路,其根据指示输出电压的目标值的基准电压和输出电压监控值之间的误差值的量值来控制控制值的量值,并且基于控制值来控制是否使这些晶体管的任一个成为导通状态。根据预先通知负载电流变化的预告信号,在预定时段内,控制电路相对于误差值增大控制值的变化步长。
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公开(公告)号:CN103105882B
公开(公告)日:2016-12-21
申请号:CN201210451048.5
申请日:2012-11-12
Applicant: 瑞萨电子株式会社
IPC: G05F1/56
CPC classification number: G05F1/59 , G06F1/26 , H01L23/5286 , H01L2924/0002 , H02M2001/0045 , H03K17/102 , H01L2924/00
Abstract: 本发明提供了一种半导体集成电路,该半导体集成电路包括:多个输出晶体管,每个输出晶体管根据施加到控制端的阻抗控制信号所指示的控制值,相对于负载电流的量值控制输出电压的量值;电压监控电路,其输出输出电压监控值,该输出电压监控值指示输出电压的电压值;以及控制电路,其根据指示输出电压的目标值的基准电压和输出电压监控值之间的误差值的量值来控制控制值的量值,并且基于控制值来控制是否使这些晶体管的任一个成为导通状态。根据预先通知负载电流变化的预告信号,在预定时段内,控制电路相对于误差值增大控制值的变化步长。
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