存储器系统
    1.
    发明公开

    公开(公告)号:CN101681313A

    公开(公告)日:2010-03-24

    申请号:CN200980000132.1

    申请日:2009-02-10

    Abstract: 一种存储器系统包括易失性第一存储单元、非易失性第二存储单元、和控制器。该控制器执行数据传输,将包括存储在第二存储单元的数据的存储位置的管理信息存储在第一存储单元,并且在更新管理信息的同时,执行数据管理。第二存储单元具有管理信息存储区,用于存储管理信息存储信息,其包括最新状态的管理信息以及管理信息的位置信息。存储位置信息在存储器系统的启动操作期间通过控制器来读取,并包括表示在管理信息存储区中最新状态的管理信息的存储位置的第二指针以及表示第二指针的存储位置的第一指针。第一指针存储在第二存储单元的固定区中,第二指针存储在第二存储单元中不包括固定区的区域中。

    存储器系统
    2.
    发明公开

    公开(公告)号:CN101641680A

    公开(公告)日:2010-02-03

    申请号:CN200880006501.3

    申请日:2008-09-22

    Abstract: 一种存储器系统,包括:WC 21,通过主机设备以扇区单位从该WC 21读出数据和将数据写入该WC 21中;FS 12,以页单位从该FS 12读出数据和将数据写入该FS 12中;MS 11,以轨道单位从该MS 11读出数据和将数据写入该MS 11中;FSIB 12a,其用作为用于FS 12的输入缓冲器;以及MSIB 11a,其用作为用于MS 11的输入缓冲器。在FSIB 12a中设置FSBB 12ac,该FSBB 12ac具有等于或大于WC 21的存储容量的存储容量,且存储在WC 21中写入的数据。数据管理单元120管理各个存储单元,当判断在这些存储单元当中执行的一种处理超过预定时间时,数据管理单元120挂起被判断为超过预定时间的那个处理,并且控制在WC 21中写入的数据,以将所述数据保存在FSBB 12ac中。

    半导体存储装置
    5.
    发明公开

    公开(公告)号:CN101627444A

    公开(公告)日:2010-01-13

    申请号:CN200880004858.8

    申请日:2008-09-30

    CPC classification number: G11C16/349 G06F11/1068 G11C11/005 G11C16/3431

    Abstract: 本发明涉及存储器,该存储器包括:第一存储区,所述存储区包括多个存储组,所述存储组包括多个存储单元,为存储组分别分配地址,存储组分别为数据擦除操作的单位;第二存储区,暂时地在其中存储从第一存储区读取的数据,或暂时地在其中存储要写入第一存储区的数据;读取计数器,在其中存储每一个存储组的数据读取计数;纠错电路,计算读取的数据的错误位计数;以及控制器,执行刷新操作,其中当错误位计数超过第一阈值时,或当数据读取计数超过第二阈值时,存储在存储组之一中的读取的数据被暂时地存储在第二存储区中,并且将读取的数据写回同一个存储组。

    存储器系统
    6.
    发明公开

    公开(公告)号:CN101535967A

    公开(公告)日:2009-09-16

    申请号:CN200780042552.7

    申请日:2007-11-28

    CPC classification number: G11C16/349 G06F11/008 G06F11/1068

    Abstract: 本发明提供一种能够判别消耗度等存储器状态并且允许存储器被高效地使用的存储器系统。该存储器系统包括:NAND型快闪存储器1,在其中数据能够被电写入/擦除;非易失性存储器2,其对NAND型快闪存储器1的擦除操作次数进行计数,并且保存该擦除操作次数及最大擦除操作次数;以及控制器3,其具有从计算机4被提供自诊断命令的连接接口31,并根据该自诊断命令从非易失性存储器2获取上述擦除操作次数及最大擦除操作次数,并经由连接接口31将上述擦除操作次数及最大擦除操作次数输出到计算机4。

    存储器系统
    9.
    发明公开

    公开(公告)号:CN101681300A

    公开(公告)日:2010-03-24

    申请号:CN200980000142.5

    申请日:2009-03-03

    Abstract: 公开了一种存储器系统(10),其包含:具有多个存储器基元的闪速EEPROM非易失性存储器(11),所述存储器基元具有浮栅极且数据项可在其中电擦除以及写入;缓冲存储器(13),其临时存储闪速EERPOM非易失性存储器(11)的数据;控制电路(12,14),其控制闪速EEPROM非易失性存储器(11)和缓冲存储器(13);接口电路(16),其与主机通信,其中,控制电路用于从闪速EEPROM非易失性存储器的将被确定的希望目标区域读取数据,并通过将所读取数据的数据“0”的计数值是否达到预设条件计数值用作确定条件来检测被擦除区域,从而确定写入区域/未写入区域。

    存储器系统
    10.
    发明公开

    公开(公告)号:CN101647007A

    公开(公告)日:2010-02-10

    申请号:CN200880006648.2

    申请日:2008-09-22

    Abstract: 控制器执行:第一处理,其用于以扇区单位将多个数据写入第一存储区中;第二处理,其用于以第一管理单位将存储在第一存储区中的数据清理至第一输入缓冲器,第一管理单位的大小为扇区单位的两倍或更大的自然数倍;第三处理,其用于以第二管理单位将存储在第一存储区中的数据清理至第二输入缓冲器,第二管理单位的大小为第一管理单位的两倍或更大的自然数倍;第四处理,其用于将第一输入缓冲器中所有页都被写入的逻辑块重新定位至第二存储区;第五处理,其用于将第二输入缓冲器中所有页都被写入的逻辑块重新定位至第三存储区;以及第六处理,其用于以第二管理单位将存储在第二存储区中的多个数据清理至第二输入缓冲器。

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