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公开(公告)号:CN102403338A
公开(公告)日:2012-04-04
申请号:CN201110281178.4
申请日:2011-09-14
IPC: H01L29/36 , H01L29/78 , H01L21/265 , H01L21/336
CPC classification number: H01L29/7813 , H01L29/086 , H01L29/1608 , H01L29/41766 , H01L29/45 , H01L29/66068
Abstract: 一种SiC半导体器件,包括:按下述顺序堆叠的衬底(1)、漂移层(2)和基极区(3);第一和第二源极区(4a,4b)和基极区中的接触层(5);穿透所述源极和基极区的沟槽(6);沟槽中的栅电极(8);覆盖栅电极,具有接触孔的层间绝缘膜(10);经由所述接触孔与所述源极区和所述接触层耦合的源电极(9);衬底上的漏电极(11);以及金属硅化物膜(30)。高浓度的第二源极区比低浓度的第一源极区更浅,且高浓度的第二源极区具有被层间绝缘膜覆盖的部分,该部分包括表面附近的低浓度的第一部以及比第一部深的高浓度的第二部。第二部上的金属硅化物膜的厚度大于第一部上的金属硅化物膜的厚度。
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公开(公告)号:CN1950948A
公开(公告)日:2007-04-18
申请号:CN200580015045.5
申请日:2005-05-11
IPC: H01L29/78 , H01L29/423 , H01L29/06
CPC classification number: H01L29/7813 , H01L29/0623 , H01L29/0653 , H01L29/42368 , H01L29/4238 , H01L29/7811
Abstract: 本发明提供了一种绝缘栅半导体器件,其在沟槽底部周围具有浮置区,且能够可靠地实现高耐压。绝缘栅半导体器件100包括电流流过的元件区域和围绕元件区域的终端区域。半导体器件100还包括在元件区域中的多个栅极沟槽21和在终端区域中的多个终端沟槽62。栅极沟槽21形成为条形,以及终端沟槽62形成为同心环形。在半导体器件100中,栅极沟槽21和终端沟槽62以使栅极沟槽21的端部和终端沟槽62的侧面之间的间隔均匀的方式设置。也就是说,根据终端沟槽62的拐角的曲率来调整栅极沟槽21的长度。
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公开(公告)号:CN116918072A
公开(公告)日:2023-10-20
申请号:CN202180094906.2
申请日:2021-11-05
Applicant: 株式会社电装
Inventor: 高谷秀史
IPC: H01L29/78
Abstract: 场效应晶体管(10)具有:p型沟槽下层(35),其配置于沟槽(14)的下侧,在从上侧观察半导体基板(12)时沿着沟槽的长边方向延伸;多个p型深层(36);以及多个n型深层(37)。各p型深层从体层(34)向下侧突出,在从上侧观察半导体基板时沿着与沟槽交叉的第一方向延伸,在与第一方向正交的第二方向上隔开间隔部配置,且与配置于沟槽的下侧的p型沟槽下层相接。各n型深层配置于对应的间隔部内,在位于体层的下侧的沟槽的侧面与栅极绝缘膜相接。
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公开(公告)号:CN107996003B
公开(公告)日:2020-02-04
申请号:CN201680033066.8
申请日:2016-06-03
Abstract: 提供了一种制造绝缘栅开关器件的方法。所述方法包括:在第一SiC半导体层的表面中形成第一沟槽;将p型杂质注入到所述第一沟槽的底表面中;在所述第一沟槽的内表面上沉积第二SiC半导体层以形成第二沟槽;以及形成栅极绝缘层、栅电极、第一区域和体区域,使得栅极绝缘层覆盖第二沟槽的内表面,栅电极位于第二沟槽中,第一区域为n型并与栅极绝缘层接触,体区域为p型,与注入区域分离,并且在第一区域下方与栅极绝缘层接触。
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公开(公告)号:CN104380471B
公开(公告)日:2017-10-27
申请号:CN201380031045.9
申请日:2013-06-06
IPC: H01L29/78 , H01L21/28 , H01L21/336 , H01L27/04 , H01L29/06 , H01L29/12 , H01L29/47 , H01L29/861 , H01L29/868 , H01L29/872
CPC classification number: H01L29/7811 , H01L21/046 , H01L21/0475 , H01L21/30604 , H01L21/308 , H01L21/761 , H01L21/8213 , H01L29/0615 , H01L29/063 , H01L29/0634 , H01L29/0661 , H01L29/0696 , H01L29/0878 , H01L29/1095 , H01L29/157 , H01L29/158 , H01L29/1608 , H01L29/41766 , H01L29/4236 , H01L29/66068 , H01L29/66727 , H01L29/66734 , H01L29/7806 , H01L29/7813 , H01L29/861 , H01L29/872
Abstract: SiC半导体装置具备以埋入沟槽(5a)内的方式具有低浓度区域(5b)和高浓度区域(5c)的p型区域(5),该沟槽(5a)形成在单元区域中,由低浓度区域(5b)构成p型柱,并且由高浓度区域(5c)构成p+型深层。由此,能够由基于低浓度区域(5b)的p型柱和基于n型漂移层(2)的n型柱构成SJ构造,所以实现了导通电阻的降低。此外,通过基于高浓度区域(5c)的p+型深层在截止时阻断漏极电位,所以能够缓和对栅极绝缘膜(8)施加的电场,能够防止栅极绝缘膜(8)被破坏。因此,SiC半导体装置能够实现降低导通电阻和防止栅极绝缘膜(8)破坏这双方。
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公开(公告)号:CN106165103A
公开(公告)日:2016-11-23
申请号:CN201580018706.3
申请日:2015-02-10
IPC: H01L29/78 , H01L21/336 , H01L29/06 , H01L29/12
CPC classification number: H01L29/7811 , H01L21/761 , H01L29/06 , H01L29/0619 , H01L29/0623 , H01L29/0649 , H01L29/0661 , H01L29/0696 , H01L29/1095 , H01L29/12 , H01L29/408 , H01L29/4236 , H01L29/66734 , H01L29/7397 , H01L29/7813
Abstract: 提供一种能实现更高耐压的半导体器件及其制造方法。所提供的半导体器件具有:p型的第四区,其与栅极沟槽的下端相接;终端沟槽,其在第二区的外侧形成于半导体基板的表面;p型的下端p型区,其与终端沟槽的下端相接;p型的侧面p型区,其与终端沟槽的外周侧的侧面相接,且与下端p型区相连,并在半导体基板的表面露出;p型的多个保护环区,其形成于比侧面p型区靠外周侧处,且在表面露出。
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公开(公告)号:CN102947937B
公开(公告)日:2015-11-25
申请号:CN201180028874.2
申请日:2011-06-02
CPC classification number: H01L29/1608 , H01L21/046 , H01L29/0619 , H01L29/0623 , H01L29/0653 , H01L29/0661 , H01L29/0696 , H01L29/407 , H01L29/41741 , H01L29/4236 , H01L29/42368 , H01L29/49 , H01L29/66068 , H01L29/7397 , H01L29/7811 , H01L29/7813
Abstract: 本发明的课题在于提高半导体装置的耐压特性。半导体装置具备包围元件区的终端区。在元件区内形成有主沟槽。在终端区内形成有包围元件区的终端沟槽。终端沟槽位于终端沟槽的最内周侧。在漂移区的表面上层叠有体区。主沟槽到达漂移区,并且在其内部形成有栅电极。终端沟槽到达漂移区。终端沟槽的侧壁和底面被氧化膜所覆盖。覆盖终端沟槽的底面的氧化膜的表面被埋入电极所覆盖。栅电压被施加于埋入电极。
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公开(公告)号:CN103890954A
公开(公告)日:2014-06-25
申请号:CN201280051533.1
申请日:2012-10-17
CPC classification number: H01L29/4236 , H01L21/047 , H01L21/28008 , H01L21/823487 , H01L29/0619 , H01L29/0623 , H01L29/1608 , H01L29/41741 , H01L29/42368 , H01L29/66068 , H01L29/66666 , H01L29/7806 , H01L29/7813 , H01L29/7827
Abstract: 一种半导体装置,其具有半导体衬底,所述半导体衬底包括:体区域;漂移区;沟槽,其从所述半导体衬底的表面延伸穿过所述体区域进入所述漂移区;以及源极区域,所述源极区域被定位为在暴露于所述半导体衬底的所述表面的范围内与所述沟槽邻接,所述源极区域通过所述体区域而与所述漂移区隔离。特定层配置在所述沟槽的底部上,并且它具有在所述特定层与所述漂移区之间的接合部分处形成耗尽层的特性。绝缘层覆盖所述特定层的上表面和所述沟槽的侧壁。导电部形成在所述沟槽的所述侧壁的一部分上。所述导电部被接合至所述特定层,且到达所述半导体衬底的所述表面。
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公开(公告)号:CN102299180B
公开(公告)日:2014-03-05
申请号:CN201110175094.2
申请日:2011-06-22
CPC classification number: H01L29/7813 , H01L29/0619 , H01L29/0661 , H01L29/0878 , H01L29/1095 , H01L29/1608 , H01L29/407 , H01L29/66068 , H01L29/7397 , H01L29/7811 , H01L29/8613
Abstract: 本发明涉及一种半导体器件,包括:半导体衬底(4)和电场末端部(13)。半导体衬底(4)包括衬底(1)、设置在所述衬底(1)的表面上的漂移层(2)以及设置在所述漂移层(2)的表面上的基极层(3)。所述半导体衬底(4)被划分为其中设置有半导体元件的单元区和包围所述单元区的外围区。基极部分(3)具有位于贯穿所述单元区和所述外围区的同一平面上的底面,并且提供位于所述外围区中的电场缓和层(3a)。所述电场末端部(13)包围所述电场缓和层(3a)的一部分和所述单元区,并且从所述电场缓和层(3a)的表面穿透所述电场缓和层(3a)到达所述漂移层(2)。
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公开(公告)号:CN102760768A
公开(公告)日:2012-10-31
申请号:CN201210128717.5
申请日:2012-04-27
IPC: H01L29/78 , H01L29/423 , H01L29/06 , H01L21/04
CPC classification number: H01L29/7813 , H01L29/045 , H01L29/0634 , H01L29/1095 , H01L29/1608 , H01L29/66068 , H01L29/7397
Abstract: 一种SiC半导体器件包括:SiC衬底(1,2),其包括第一或第二导电类型层(1)和第一导电类型漂移层(2),并且包括具有偏移方向的主表面;沟槽(6),其设置在所述漂移层上并且具有纵向方向;以及栅极电极(9),其经由栅极绝缘膜(8)设置在所述沟槽中。所述沟槽的侧壁提供沟道形成表面。所述垂直半导体器件根据施加至所述栅极电极的栅极电压而使电流沿所述沟槽的所述沟道形成表面流动。所述SiC衬底的所述偏移方向垂直于所述沟槽的所述纵向方向。
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