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公开(公告)号：CN110263499A
公开(公告)日：2019-09-20
申请号：CN201910670946.1
申请日：2019-07-24
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网上海市电力公司
IPC: G06F17/50 , G06K19/077
Abstract: 本发明公开了一种高灵敏度大容量射频标签芯片的版图结构，该版图结构包括：第1版图区、第2版图区、第3版图区、第4版图区、第5版图区、第6版图区、第7版图区和第8版图区，其中，第1版图区分别与第2-8版图区电连接；第2版图区分别与第1和6版图区电连接；第3版图区分别与第1和6版图区电连接；第4版图区分别与第1和6版图区电连接；第5版图区分别与第1和6版图区电连接；第6版图区分别与第1-5版图区以及第7-8版图区电连接；第7版图区分别与第1和6版图区电连接；以及第8版图区分别与第1和6版图区电连接，并覆盖在第3和4版图区上。本发明的版图结构能够显著提升射频标签芯片的存储容量、灵敏度和可靠性。
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公开(公告)号：CN108984945A
公开(公告)日：2018-12-11
申请号：CN201810877425.9
申请日：2018-08-03
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司
IPC: G06F17/50
Abstract: 本发明公开了一种基于多核心联合仿真被验证设计的仿真验证平台，包括具有以下结构中的至少一种结构：数字逻辑仿真工具和算法仿真工具分时联合仿真验证平台结构、数字逻辑仿真工具和算法仿真工具同时联合仿真验证平台结构、数字逻辑仿真工具和硬件原型平台联合仿真验证平台结构以及硬件原型平台作和算法仿真工具借助DSP联合仿真验证平台结构。本发明的基于多核心联合仿真被验证设计的仿真验证平台能够联合使用三类仿真验证工具，能够更好的提升定位问题的精准度、功能/算法的覆盖率、执行仿真的速度，大大提升了仿真效率。
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公开(公告)号：CN110263499B
公开(公告)日：2024-03-05
申请号：CN201910670946.1
申请日：2019-07-24
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网上海市电力公司
IPC: G06F30/392 , G06K19/077
Abstract: 本发明公开了一种射频标签芯片的版图结构，该版图结构包括：第1版图区、第2版图区、第3版图区、第4版图区、第5版图区、第6版图区、第7版图区和第8版图区，其中，第1版图区分别与第2‑8版图区电连接；第2版图区分别与第1和6版图区电连接；第3版图区分别与第1和6版图区电连接；第4版图区分别与第1和6版图区电连接；第5版图区分别与第1和6版图区电连接；第6版图区分别与第1‑5版图区以及第7‑8版图区电连接；第7版图区分别与第1和6版图区电连接；以及第8版图区分别与第1和6版图区电连接，并覆盖在第3和4版图区上。本发明的版图结构能够显著提升射频标签芯片的存储容量、灵敏度和可靠性。
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公开(公告)号：CN108563590B
公开(公告)日：2024-02-23
申请号：CN201810684179.5
申请日：2018-06-28
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网江苏省电力有限公司南京供电分公司
Abstract: 本发明提供了一种基于片上FLASH存储器的OTP控制器和控制方法。该OTP控制器包括：通信总线模块，处理器通过该通信总线模块用于对片上FLASH存储器和OTP控制器进行数据读写；总线协议转换模块，其与所述通信总线模块进行通信，将该通信总线模块的总线协议转换为片上FLASH存储器的读写总线协议；读写状态控制模块，其与所述总线协议转换模块进行通信，用于控制所述片上FLASH存储器的读写状态；以及OTP接口，其与所述总线协议转换模块以及所述片上FLASH存储器进行通信，用于OTP数据在OTP控制器与片上FLASH存储器的存储单元之间的传输。本发明的OTP控制器能够对FLASH存储器进行一次性编程的数据读写，并能够保护OTP数据不被改写。
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公开(公告)号：CN114328316A
公开(公告)日：2022-04-12
申请号：CN202111389257.7
申请日：2021-11-22
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江苏省电力有限公司 , 国家电网有限公司
Abstract: 本发明实施例提供一种DMA控制器及SOC系统，属于数据处理及传输领域。所述DMA控制器包括：总线主机接口，用于提供从源端至目的端的数据搬运的接口；以及传输控制模块，用于控制DMA控制器执行基于传输链表的数据搬运。执行基于传输链表的数据搬运包括：配置链表指针寄存器的指针指向传输链表中的首地址；配置链表寄存器自动访问链表指针寄存器所指向的首地址，并将该首地址对应的待搬运数据自动加载到所述DMA控制器；以及配置链表寄存器按照传输链表中的地址顺序，依次自动访问自首地址的下一地址起的各地址，并自动加载相应地址对应的待搬运数据，直到加载完所有待搬运数据。本发明提高了DMA控制器的数据传输效率并且减小了CPU的工作负荷。
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Patent Agency Ranking
公开(公告)号：CN114327810A
公开(公告)日：2022-04-12
申请号：CN202111401082.7
申请日：2021-11-19
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江苏省电力有限公司 , 国家电网有限公司
IPC: G06F9/48 , G06F11/30 , G06F15/163
Abstract: 本发明实施例提供一种用于多核芯片的线程调度方法及装置，属于芯片技术领域。所述方法包括：针对线程调度队列中的待调度线程，在所述多核芯片中，查找能够处理所述待调度线程且当前温度低于对应的第一阈值温度的硬件部件；以及在未查找到所述硬件部件的情况下，延迟调度所述待调度线程，对所述线程调度队列中的下一待调度线程执行调度处理。在调度线程时，查找能够处理该线程且当前温度低于阈值温度的硬件部件。若查找不到所述硬件部件，则延迟调度所述线程。如此，能够避免多核芯片的各硬件部件超高负荷运行，提高多核芯片的使用寿命。
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公开(公告)号：CN114280449A
公开(公告)日：2022-04-05
申请号：CN202111386939.2
申请日：2021-11-22
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江苏省电力有限公司 , 国家电网有限公司
IPC: G01R31/28
Abstract: 本发明实施例提供一种数字芯片的测试访问架构与测试访问方法，属于集成电路测试技术领域。所述架构包括：由数字芯片内的所有模块划分的N个测试组；其中，所述N个测试组的每一个测试组中包括多个测试模块，所述每一个测试组中的所述多个测试模块之间被配置为采用分布式测试访问机制进行测试；所述N个测试组之间被配置为采用多路选择测试访问机制进行测试。本发明实施例适用于对大规模数字芯片的测试过程中的架构划分。
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公开(公告)号：CN110554855B
公开(公告)日：2021-10-12
申请号：CN201910859035.3
申请日：2019-09-11
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司
IPC: G06F7/58
Abstract: 本发明公开了一种真随机数发生器，该真随机数发生器包括低频时钟单元，所述低频时钟单元具有慢振荡器，该慢振荡器包括：跨阻放大器、迟滞比较器、电荷泵、跨导放大器、第一电容以及电压缓冲器。跨阻放大器包括：运算放大器、第一电阻、第二电阻、第三电阻以及第四电阻。该真随机数发生器的jitter值在低频时钟输出频率确定的情况下只与跨阻放大器的噪声电阻、噪声带宽、噪声电压增益这三个参数相关，在噪声电阻和噪声带宽在比较小的情况下，通过增大噪声电压增益得到比较大的噪声电压标准差，即可以设计出比较大的低频时钟jitter，增大随机数的性能，并且可以减少电路的功耗和面积。
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公开(公告)号：CN112101057B
公开(公告)日：2021-03-19
申请号：CN202011305922.5
申请日：2020-11-20
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司
IPC: G06K7/10
Abstract: 本发明实施例提供一种标签数量估算方法、装置、电子设备及存储介质。所述方法包括：设定帧长度系数Q，基于最小不可检测的碰撞标签数量值Limit，获取相应帧长度内每个帧时隙内的碰撞标签数量值；统计相应帧长度内不同的碰撞标签数量值所分别对应的帧时隙数量之和；根据最小不可检测的碰撞标签数量值Limit和所述帧长度系数Q，查询对应的标签碰撞系数K；根据统计的帧时隙数量之和以及标签碰撞系数K，对标签数量进行第一轮估算，得到第一估算结果。通过上述方法，根据不同的帧长度系数Q和最小不可检测的碰撞标签数量值Limit，得到对应的碰撞系数K，使得对标签数量的估算更为准确，更加适用于标签数量较多的情况。
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公开(公告)号：CN108628791B
公开(公告)日：2020-05-19
申请号：CN201810427403.2
申请日：2018-05-07
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网新疆电力有限公司检修公司
Abstract: 本发明公开了一种基于PCIE接口的高速安全芯片架构和高速的数据处理方法。所述高速安全芯片架构将总线、CPU、安全存储单元、DMA、密码运算单元以及高速PCIE接口单元均集成在一个芯片上。只需要使用一颗芯片就可以完成安全芯片的全部功能。所述基于PCIE接口的高速安全芯片架构具有集成度高、面积小、成本低、功耗低的优点。
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