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公开(公告)号:CN1950948A
公开(公告)日:2007-04-18
申请号:CN200580015045.5
申请日:2005-05-11
IPC: H01L29/78 , H01L29/423 , H01L29/06
CPC classification number: H01L29/7813 , H01L29/0623 , H01L29/0653 , H01L29/42368 , H01L29/4238 , H01L29/7811
Abstract: 本发明提供了一种绝缘栅半导体器件,其在沟槽底部周围具有浮置区,且能够可靠地实现高耐压。绝缘栅半导体器件100包括电流流过的元件区域和围绕元件区域的终端区域。半导体器件100还包括在元件区域中的多个栅极沟槽21和在终端区域中的多个终端沟槽62。栅极沟槽21形成为条形,以及终端沟槽62形成为同心环形。在半导体器件100中,栅极沟槽21和终端沟槽62以使栅极沟槽21的端部和终端沟槽62的侧面之间的间隔均匀的方式设置。也就是说,根据终端沟槽62的拐角的曲率来调整栅极沟槽21的长度。
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公开(公告)号:CN106165103B
公开(公告)日:2019-07-16
申请号:CN201580018706.3
申请日:2015-02-10
IPC: H01L29/78 , H01L21/336 , H01L29/06 , H01L29/12
CPC classification number: H01L29/7811 , H01L21/761 , H01L29/06 , H01L29/0619 , H01L29/0623 , H01L29/0649 , H01L29/0661 , H01L29/0696 , H01L29/1095 , H01L29/12 , H01L29/408 , H01L29/4236 , H01L29/66734 , H01L29/7397 , H01L29/7813
Abstract: 提供一种能实现更高耐压的半导体器件及其制造方法。所提供的半导体器件具有:p型的第四区,其与栅极沟槽的下端相接;终端沟槽,其在第二区的外侧形成于半导体基板的表面;p型的下端p型区,其与终端沟槽的下端相接;p型的侧面p型区,其与终端沟槽的外周侧的侧面相接,且与下端p型区相连,并在半导体基板的表面露出;p型的多个保护环区,其形成于比侧面p型区靠外周侧处,且在表面露出。
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公开(公告)号:CN107615492A
公开(公告)日:2018-01-19
申请号:CN201680030119.0
申请日:2016-04-05
IPC: H01L29/78 , H01L21/20 , H01L21/265 , H01L21/336 , H01L29/06 , H01L29/12
Abstract: 半导体装置具有:基板(1),其包括外周区域和具有半导体元件的单元区域;以及所述基板上的漂移层(2)。半导体元件具备基极区域(3)、源极区域(4)、沟槽栅构造、比栅极沟槽深的深层(5)、源极电极(11)、以及漏极电极(12)。外周区域具有使所述漂移层露出的凹部(20)、以及保护环层(21),保护环层具有在露出了的所述漂移层的表面包围所述单元区域的多个框形状的保护环沟槽(21c)、以及配置于保护环沟槽内的第1保护环(21a)。所述深沟槽的宽度和所述保护环沟槽的宽度。
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公开(公告)号:CN103890954B
公开(公告)日:2016-10-26
申请号:CN201280051533.1
申请日:2012-10-17
CPC classification number: H01L29/4236 , H01L21/047 , H01L21/28008 , H01L21/823487 , H01L29/0619 , H01L29/0623 , H01L29/1608 , H01L29/41741 , H01L29/42368 , H01L29/66068 , H01L29/66666 , H01L29/7806 , H01L29/7813 , H01L29/7827
Abstract: 一种半导体装置,其具有半导体衬底,所述半导体衬底包括:体区域;漂移区;沟槽,其从所述半导体衬底的表面延伸穿过所述体区域进入所述漂移区;以及源极区域,所述源极区域被定位为在暴露于所述半导体衬底的所述表面的范围内与所述沟槽邻接,所述源极区域通过所述体区域而与所述漂移区隔离。特定层配置在所述沟槽的底部上,并且它具有在所述特定层与所述漂移区之间的接合部分处形成耗尽层的特性。绝缘层覆盖所述特定层的上表面和所述沟槽的侧壁。导电部形成在所述沟槽的所述侧壁的一部分上。所述导电部被接合至所述特定层,且到达所述半导体衬底的所述表面。
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公开(公告)号:CN102844867B
公开(公告)日:2015-08-05
申请号:CN201280001099.6
申请日:2012-02-06
IPC: H01L29/10 , H01L29/78 , H01L29/739 , H01L29/16 , H01L21/336 , H01L29/66
CPC classification number: H01L29/7813 , H01L29/0634 , H01L29/0878 , H01L29/1095 , H01L29/1608 , H01L29/66068 , H01L29/66348 , H01L29/7397
Abstract: 一种SiC器件包括反型MOSFET,其具有:按照顺序叠置的衬底(1)、漂移层(2)以及基底区域(3);基底区域(3)的上部中的源极和接触区域(4、5);穿透源极和基底区域(4、3)的沟槽(6);沟槽(6)中的栅极绝缘膜(8)上的栅电极(9);与源极和基底区域(4、3)耦合的源电极(11);衬底(1)的背面上的漏电极(13);以及多个深层(10),所述深层位于漂移层(2)的上部中、比沟槽(6)更深、并且在与沟槽的纵向方向交叉的方向上延伸。每个深层(10)在深度方向上具有杂质浓度分布,并且在施加栅电压时,在沟槽侧上的深层(10)的一部分中提供反型层。
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公开(公告)号:CN102403338B
公开(公告)日:2014-08-20
申请号:CN201110281178.4
申请日:2011-09-14
IPC: H01L29/36 , H01L29/78 , H01L21/265 , H01L21/336
CPC classification number: H01L29/7813 , H01L29/086 , H01L29/1608 , H01L29/41766 , H01L29/45 , H01L29/66068
Abstract: 一种SiC半导体器件,包括:按下述顺序堆叠的衬底(1)、漂移层(2)和基极区(3);第一和第二源极区(4a,4b)和基极区中的接触层(5);穿透所述源极和基极区的沟槽(6);沟槽中的栅电极(8);覆盖栅电极,具有接触孔的层间绝缘膜(10);经由所述接触孔与所述源极区和所述接触层耦合的源电极(9);衬底上的漏电极(11);以及金属硅化物膜(30)。高浓度的第二源极区比低浓度的第一源极区更浅,且高浓度的第二源极区具有被层间绝缘膜覆盖的部分,该部分包括表面附近的低浓度的第一部以及比第一部深的高浓度的第二部。第二部上的金属硅化物膜的厚度大于第一部上的金属硅化物膜的厚度。
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公开(公告)号:CN102856382A
公开(公告)日:2013-01-02
申请号:CN201210226273.9
申请日:2012-06-29
CPC classification number: H01L29/7813 , H01L29/045 , H01L29/0865 , H01L29/1095 , H01L29/1608 , H01L29/4236 , H01L29/66068 , H01L29/7825 , H01L29/7827
Abstract: 本发明涉及一种碳化硅半导体器件。在碳化硅半导体器件中,多个沟槽(7)具有一个方向上的纵向方向并且以条纹图案布置。每个所述沟槽(7)均具有在所述纵向方向上延伸的第一侧壁和第二侧壁。所述第一侧壁与(11-20)平面和(1-100)平面中的一个平面成第一锐角,所述第二侧壁与(11-20)平面和(1-100)平面的所述一个平面成第二锐角,并且所述第一锐角小于所述第二锐角。第一导电类型区(5)仅与每个所述沟槽(7)的所述第一侧壁和所述第二侧壁中的所述第一侧壁接触,并且电流通路仅形成在所述第一侧壁和所述第二侧壁中的所述第一侧壁上。
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公开(公告)号:CN100557819C
公开(公告)日:2009-11-04
申请号:CN200480029528.6
申请日:2004-10-06
IPC: H01L29/78 , H01L29/06 , H01L21/336 , H01L29/423 , H01L29/739 , H01L21/331
Abstract: 本发明旨在提供一种可容易地制造的绝缘栅型半导体器件及其制造方法,同时实现较高的耐压设计和较低的接通电阻设计。所述半导体器件包括N+源极区31、N+漏极区11、P-体区41以及N-漂移区12。通过挖出所述半导体器件上部的部分区域,形成栅极沟槽21。所述栅极沟槽21包括栅电极22。P浮置区51设置在所述栅极沟槽21的下方。可形成与栅极沟槽21具有不同深度的另一沟槽25,P浮置区54设置在所述沟槽25的下方。
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公开(公告)号:CN100487916C
公开(公告)日:2009-05-13
申请号:CN200580015045.5
申请日:2005-05-11
IPC: H01L29/78 , H01L29/423 , H01L29/06
CPC classification number: H01L29/7813 , H01L29/0623 , H01L29/0653 , H01L29/42368 , H01L29/4238 , H01L29/7811
Abstract: 本发明提供了一种绝缘栅半导体器件,其在沟槽底部周围具有浮置区,且能够可靠地实现高耐压。绝缘栅半导体器件100包括电流流过的元件区域和围绕元件区域的终端区域。半导体器件100还包括在元件区域中的多个栅极沟槽21和在终端区域中的多个终端沟槽62。栅极沟槽21形成为条形,以及终端沟槽62形成为同心环形。在半导体器件100中,栅极沟槽21和终端沟槽62以使栅极沟槽21的端部和终端沟槽62的侧面之间的间隔均匀的方式设置。也就是说,根据终端沟槽62的拐角的曲率来调整栅极沟槽21的长度。
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公开(公告)号:CN107996003B
公开(公告)日:2020-02-04
申请号:CN201680033066.8
申请日:2016-06-03
Abstract: 提供了一种制造绝缘栅开关器件的方法。所述方法包括:在第一SiC半导体层的表面中形成第一沟槽;将p型杂质注入到所述第一沟槽的底表面中;在所述第一沟槽的内表面上沉积第二SiC半导体层以形成第二沟槽;以及形成栅极绝缘层、栅电极、第一区域和体区域,使得栅极绝缘层覆盖第二沟槽的内表面,栅电极位于第二沟槽中,第一区域为n型并与栅极绝缘层接触,体区域为p型,与注入区域分离,并且在第一区域下方与栅极绝缘层接触。
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