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公开(公告)号：CN117492994B
公开(公告)日：2025-01-14
申请号：CN202311452131.9
申请日：2023-11-02
Applicant: 北京智芯微电子科技有限公司
Abstract: 本公开实施例公开了核间运行中断程序的方法、装置、芯片、设备及介质，该方法包括：响应于第一处理核的当前运行状态为中断嵌套状态，确定第一处理核上中断程序的运行状态；响应于第一处理核上高优先级的第一中断程序正在运行、低优先级的第二中断程序暂停运行，且第一中断程序的已运行时长大于或等于预设时长阈值，在多个处理核中确定出当前运行状态为空闲状态的第二处理核；控制第二处理核和第一处理核以预设时长轮询运行第二中断程序直至结束。本公开技术方案通过在核间轮询运行低优先级中断程序的方式来提高中断程序的处理效率，从而提高了CPU的程序处理效率。
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公开(公告)号：CN117609114B
公开(公告)日：2024-09-03
申请号：CN202311499211.X
申请日：2023-11-10
Applicant: 北京智芯微电子科技有限公司
Abstract: 本发明公开了一种多核处理器数据共享控制方法、装置、存储模块及芯片，控制方法应用于第一单元和第二单元之间的信息交互。第一单元的存储空间被划分为多个子存储空间，第二单元包括多个处理器单元，每一个子存储空间与一个处理器单元相匹配。控制方法包括：在发出请求的处理器单元与请求访问的子存储空间相匹配的情况下，发出请求的处理器单元能够直接访问请求访问的子存储空间。主处理器单元用于设置每一个处理器单元的访问权限。每一个处理器单元可以通过主处理器单元更改访问权限，使得每一个处理器单元可以访问任意一个子存储空间，提高了处理器单元对子存储空间的访问效率，也就提高了第二单元对第一单元的访问效率。
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公开(公告)号：CN117708603A
公开(公告)日：2024-03-15
申请号：CN202311459092.5
申请日：2023-11-03
Applicant: 北京智芯微电子科技有限公司 , 国网山东省电力公司信息通信公司 , 国家电网有限公司
IPC: G06F18/22 , G06F11/30 , G06F123/02
Abstract: 本发明涉及集成电路领域，公开一种故障关联度的预测方法与系统、多核处理器以及芯片。所述方法包括：确定变电站内的参照设备在发生故障的预设时间段内的标准参数序列与待预测设备在预设时间段内的第一特定参数序列之间的关联系数；根据待预测设备在预设时间段内的第一特定参数序列与待预测设备在待预测时间段内的第一特定参数序列，确定待预测设备的特定参数在不同时间段内的相似度，其中待预测时间段与预设时间段的时长相同；以及根据关联系数与相似度，确定待预测设备与参照设备同时发生故障的关联度。本发明在参照设备出现故障时预测其他设备发生故障的关联度，从而在关联度较大时可通知其他设备，实现高协同性，最大程度减小故障带来的危害。
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公开(公告)号：CN110674069B
公开(公告)日：2021-02-19
申请号：CN201910916915.X
申请日：2019-09-26
Applicant: 北京智芯微电子科技有限公司 , 国家电网有限公司 , 国网上海市电力公司
IPC: G06F13/40
Abstract: 本发明公开了一种芯片的数字引脚转换电路及方法、芯片，该数字引脚转换电路包括：通信接口、编码器、存储器、查找表控制器、查找表模块。通信接口用于接收外部输入的引脚配置数据，编码器用于根据外围电路的引脚配置需求对引脚配置数据进行编码从而产生编码后的芯片功能端口与芯片引脚之间一一对应的二维关系数据表；存储器用于存储该二维关系数据表，查找表控制器用于读取存储器中的地址信息和数据信息从而控制查找表模块选择芯片功能端口与芯片引脚之间的连接关系。该芯片上基于数字引脚转换电路，能够在芯片已有引脚资源上通过软件任意配置从而实现芯片已有引脚的任意排列，减少成本。
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公开(公告)号：CN114327255B
公开(公告)日：2025-02-14
申请号：CN202111370701.0
申请日：2021-11-18
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网山西省电力公司 , 国家电网有限公司
Abstract: 本发明实施例提供一种存储器接口控制器及存储器，属于数据存储领域。所述存储器接口控制器包括：第一通信模块，用于接收外部设备传送的明文数据，并将所接收的明文数据传送给寄存器模块进行存储；加密模块，用于对存储的明文数据进行加密以得到对应的密文数据，并将密文数据传送给缓存模块进行缓存；数据处理模块，用于将寄存器模块所存储的明文数据搬运给加密模块，以及将缓存模块所缓存的密文数据搬运给第二通信模块；所第二通信模块，用于将所接收的密文数据传送给所述存储器。本发明的存储器接口控制器通过增加加密模块，实现了在数据存储源头的加密保证，可保证了数据安全。
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Patent Agency Ranking
公开(公告)号：CN117609107A
公开(公告)日：2024-02-27
申请号：CN202311501889.7
申请日：2023-11-10
Applicant: 北京智芯微电子科技有限公司 , 国网山东省电力公司信息通信公司 , 国家电网有限公司
Abstract: 本发明公开了一种多核处理器高速访问控制方法、装置、存储模块及芯片，控制方法应用于第一单元和第二单元之间的信息交互。第一单元的存储空间被划分为多个子存储空间，第二单元包括多个处理器单元，每一个子存储空间与一个处理器单元相匹配。控制方法包括：在子存储空间存储的数据未进行更新的情况下，若发出请求的处理器单元访问过请求访问的子存储空间，发出请求的处理器单元不对请求访问的子存储空间进行访问。在子存储空间的数据没有更新的情况下，处理器单元可以通过读取自身的缓存来使用这些数据，而不需要再次对子存储空间的数据进行访问，这样可以节省处理器单元进行数据访问的次数和时间，有利于提高效率。
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公开(公告)号：CN116126397A
公开(公告)日：2023-05-16
申请号：CN202310403706.1
申请日：2023-04-17
Applicant: 北京智芯微电子科技有限公司 , 国网江苏省电力有限公司 , 国家电网有限公司
Abstract: 本公开涉及微控制器技术领域，具体涉及一种基于微控制器的控制方法、装置、设备及介质，所述微控制器包括中央处理器、闪存Flash和静态随机存取存储器SRAM，所述方法包括：控制中央处理器通过微控制器的目标引脚读取输入值；响应于输入值与预设引脚值匹配，将储存在Flash中的目标指令程序搬移至SRAM，并通过所述中央处理器将微控制器的启动模式设置为SRAM启动；控制中央处理器至少从SRAM中读取所述目标指令程序并执行。该方案可以将微控制器中FLASH的指令程序搬移到微控制器的SRAM中，从而在微控制器的启动模式为SRAM启动的情况下，CPU可以从SRAM中高速读取指令程序。
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公开(公告)号：CN113986600B
公开(公告)日：2023-02-03
申请号：CN202111298088.6
申请日：2021-11-04
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江苏省电力有限公司信息通信分公司 , 国家电网有限公司
Abstract: 本发明实施例提供一种用于芯片串行接口的测试方法、装置和芯片，该方法包括设置错误时序，通过该错误时序发送数据至待测芯片上；根据该待测芯片的回复数据确定该待测芯片串行接口的稳定性。本发明通过模拟各种错误的时序场景，增加芯片的容错测试，能够更广范围地验证芯片串行接口的稳定性。
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公开(公告)号：CN113986600A
公开(公告)日：2022-01-28
申请号：CN202111298088.6
申请日：2021-11-04
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江苏省电力有限公司信息通信分公司 , 国家电网有限公司
Abstract: 本发明实施例提供一种用于芯片串行接口的测试方法、装置和芯片，该方法包括设置错误时序，通过该错误时序发送数据至待测芯片上；根据该待测芯片的回复数据确定该待测芯片串行接口的稳定性。本发明通过模拟各种错误的时序场景，增加芯片的容错测试，能够更广范围地验证芯片串行接口的稳定性。
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公开(公告)号：CN109541443A
公开(公告)日：2019-03-29
申请号：CN201910023385.6
申请日：2019-01-10
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司
IPC: G01R31/28
Abstract: 本发明公开了一种实时时钟故障检测装置及方法，该装置包括：温度补偿晶体振荡器电路、检测分析模块、通信接口模块、主控模块、显示模块。温度补偿晶体振荡器电路用于提供精准的时钟源。检测分析模块用于检测及分析智能电表或RTC芯片的实时时钟故障。通信接口模块包括控件输入接口以及显示驱动接口，控件输入接口能够输入测试请求。主控模块用于将所述检测分析模块的实时时钟故障的检测数据转换成便于显示的数据；显示模块用于显示所述主控模块转换后的实时时钟故障检测数据。所述检测分析模块、所述通信接口模块以及所述主控模块均集成在FPGA芯片上。该实时时钟检测装置及方法能够很方便地进行RTC芯片或电表中RTC芯片的实时时钟故障检测和分析。
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