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公开(公告)号：CN103718157A
公开(公告)日：2014-04-09
申请号：CN201180069925.6
申请日：2011-12-12
申请人： 英特尔公司
发明人： J·C·三额詹 , B·托尔 , R·C·凡伦天 , M·B·吉尔卡尔 , A·T·福塞斯 , G·Z·克里斯沃斯 , E·T·格罗科斯基 , D·布拉德福德 , L·K·吴 , E·乌尔德-阿迈德-瓦尔
CPC分类号： G06F9/324 , G06F9/30018 , G06F9/30058 , G06F9/30094
摘要： 描述了在计算机处理器中执行跳转指令的系统、装置和方法的实施例。在一些实施例中，混合指令的执行使得当写掩码的所有位为零时条件性地跳转至目标指令的地址，其中目标指令的地址是使用所述指令的指令指针和相对偏移来计算的。
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公开(公告)号：CN103299273A
公开(公告)日：2013-09-11
申请号：CN201180064992.9
申请日：2011-11-17
申请人： ARM有限公司
发明人： 保罗·安东尼·吉尔克森 , 约翰·迈克尔·霍尔利 , 迈克尔·约翰·吉布斯
CPC分类号： G06F11/3495 , G06F9/30072 , G06F9/30094 , G06F9/30101 , G06F9/30123 , G06F9/30145 , G06F11/348
摘要： 本发明提供一种用于追踪条件指令的追踪单元、诊断装置及数据处理装置。数据处理装置产生指令观察指示符及结果输出指示符，指令观察指示符指示条件指令的执行，结果输出指示符指示数据处理装置对执行各条件指令的结果的输出。指令观察指示符及结果输出指示符由追踪单元接收，所述追踪单元被配置为输出条件指令追踪数据项并独立地输出条件结果追踪数据项，从而使得能够通过诊断装置对条件指令以及相应条件结果进行分离追踪分析。指令观察指示符在追踪单元处在数据处理装置的第一处理周期中被接收，而结果输出指示符在第二不同处理周期中被接收。
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公开(公告)号：CN101515229B
公开(公告)日：2013-06-19
申请号：CN200910005794.X
申请日：2009-02-12
申请人： 瑞萨电子株式会社
发明人： 荒川文男
IPC分类号： G06F9/30
CPC分类号： G06F9/30185 , G06F9/3001 , G06F9/30029 , G06F9/30058 , G06F9/30094 , G06F9/3016 , G06F9/30181 , G06F9/3865
摘要： 本发明提供一种数据处理器。在标志生成指令数量较多的情况下，通过增加1条指令生成的标志数量，而使标志生成指令数量的减少超过标志使用指令数量的增加，由此实现指令数量的削减，根据以上观点，定义生成与操作数的数据尺寸对应的多个标志的指令。例如，在缩小指令集计算机型的数据处理器中，在指令集中添加可对多个数据尺寸的操作数进行运算处理的、不拘泥于如下操作数的数据尺寸而生成与各个数据尺寸对应的标志(newU、newT)的指令，其中，该如下操作数为对较大数据尺寸的操作数的低位一侧进行与对较小数据尺寸的操作数的运算处理相等的处理而被进行运算处理的操作数。
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公开(公告)号：CN103150141A
公开(公告)日：2013-06-12
申请号：CN201210505766.6
申请日：2012-11-30
申请人： 瑞萨电子株式会社
发明人： 小林悠记
CPC分类号： G06F9/30029 , G06F9/30021 , G06F9/30094 , G06F9/3853 , G06F9/3885
摘要： 本发明涉及VLIW处理器、指令结构和指令执行方法。第一运算单元130根据第一控制信号ctr1将第一比较运算单元122的输出或者该输出与已经保存于寄存器50内的值的与值或者或值作为第一运算结果CR1输出。第二运算单元140根据第二控制信号ctr2将第二比较运算单元124的输出或者该输出与已经保存于寄存器50内的值的与值或者或值作为第二运算结果CR2输出。第三运算单元150根据第三控制信号ctr3将第一运算结果CR1或者第一运算结果CR1与第二运算结果CR2的与值或者或值作为执行结果输出到寄存器50。寄存器50重新保存并输出来自第三运算单元150的执行结果。
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公开(公告)号：CN101501634B
公开(公告)日：2013-05-29
申请号：CN200780030183.X
申请日：2007-08-15
申请人： 高通股份有限公司
CPC分类号： G06F9/30101 , G06F9/30021 , G06F9/30094 , G06F9/3885
摘要： 本发明揭示一种处理器装置，其包含具有用于标量和向量操作的经组合条件码寄存器的寄存器堆。所述处理器装置利用所述经组合条件码寄存器来进行标量和向量操作。此外，比较操作可将所得位存储在所述经组合条件码寄存器中，且条件操作可利用所述经组合条件码寄存器位来评估条件。
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公开(公告)号：CN101231583B
公开(公告)日：2011-07-13
申请号：CN200710144187.2
申请日：2007-09-21
申请人： 英特尔公司
CPC分类号： G06F9/30021 , G06F7/026 , G06F9/3001 , G06F9/30029 , G06F9/30036 , G06F9/30058 , G06F9/30094 , G06F9/30098 , G06F9/30145 , G06F9/30149 , G06F9/3016 , G06F9/3887 , G06F12/0875 , G06F2212/452
摘要： 一种用于包含在对打包或非打包数据执行逻辑比较和分支支持操作的处理器指令中的方法和装置。在一个实施例中，处理器耦合到存储器。存储器中已经存储了第一数据和第二数据。该处理器对该第一和第二数据执行逻辑比较。该逻辑比较可以对该第一和第二数据的每个位执行，或者可以只对某些位执行。对于至少一个实施例，至少第一数据包括打包数据元素，并且该逻辑比较对该打包数据元素的最高有效位执行。该逻辑比较可以包括对第一和第二数据的相同的各个位的比较，并且还包括对第一数据的位与第二数据的相应位的反码的逻辑比较。基于这些比较，可以进行分支支持动作。这样的分支支持动作可以包括设置一个或多个标志，其进而可以被所述分支单元使用。可选择地，分支支持动作可以包括分支到所指示的目标代码位置。
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公开(公告)号：CN102109977A
公开(公告)日：2011-06-29
申请号：CN201010620155.7
申请日：2010-12-21
申请人： 英特尔公司
IPC分类号： G06F9/308
CPC分类号： G06F9/30145 , G06F9/30018 , G06F9/30029 , G06F9/30094 , G06F9/3802
摘要： 接收指示源操作数和目标操作数的指令。响应于该指令将结果储存在目标操作数中。该结果操作数可具有：(1)第一位范围，具有由该指令显式指定的第一端，其中各个位的值与源操作数在相应位置中的位的值相同；以及(2)第二位范围，不管源操作数在相应位置中的位的值如何，其所有位都具有相同值。在不在源操作数的相应位置中相对于这些有相同值的位来移动结果的第一范围的情况下，可完成该指令的执行，而不管第一位范围在结果中的位置如何。还揭示了用于执行这种指令的执行单元、具有用于执行这种指令的处理器的计算机系统、以及储存这种指令的机器可读介质。
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公开(公告)号：CN101937329A
公开(公告)日：2011-01-05
申请号：CN201010283414.1
申请日：2007-09-21
申请人： 英特尔公司
CPC分类号： G06F9/30021 , G06F7/026 , G06F9/3001 , G06F9/30029 , G06F9/30036 , G06F9/30058 , G06F9/30094 , G06F9/30098 , G06F9/30145 , G06F9/30149 , G06F9/3016 , G06F9/3887 , G06F12/0875 , G06F2212/452
摘要： 一种用于包含在对打包或非打包数据执行逻辑比较和分支支持操作的处理器指令中的方法和装置。在一个实施例中，处理器耦合到存储器。存储器中已经存储了第一数据和第二数据。该处理器对该第一和第二数据执行逻辑比较。该逻辑比较可以对该第一和第二数据的每个位执行，或者可以只对某些位执行。对于至少一个实施例，至少第一数据包括打包数据元素，并且该逻辑比较对该打包数据元素的最高有效位执行。该逻辑比较可以包括对第一和第二数据的相同的各个位的比较，并且还包括对第一数据的位与第二数据的相应位的反码的逻辑比较。基于这些比较，可以进行分支支持动作。这样的分支支持动作可以包括设置一个或多个标志，其进而可以被所述分支单元使用。可选择地，分支支持动作可以包括分支到所指示的目标代码位置。
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公开(公告)号：CN1415087B
公开(公告)日：2010-05-26
申请号：CN00818092.X
申请日：2000-09-14
申请人： 英特尔公司
发明人： S·斯托里
IPC分类号： G06F9/32
CPC分类号： G06F9/30094
摘要： 公开了一种机制，用来检测以推测方式执行的浮点运算的下溢情况。浮点状态寄存器包括一个状态标志，当浮点指令产生的结果“细小”的时候将它置位。清除这个状态标志，屏蔽所有异常，以推测方式执行指令。读出“细小”异常标志，以确定以推测方式执行的指令是否会导致未屏蔽下溢异常。如果处理器到达跟这个指令有关的一个注册点就会发生这一异常。如果没到达这一点就可以忽略这一异常。
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公开(公告)号：CN101046741B
公开(公告)日：2010-05-26
申请号：CN200710091956.7
申请日：2007-03-30
申请人： 恩益禧电子股份有限公司
发明人： 寺岛卓
IPC分类号： G06F9/38
CPC分类号： G06F9/30061 , G06F9/30094
摘要： 本发明提供一种抑制周期数的增加和指令长度的增大，使条件分支处理快速化的处理装置。作为指令组包含：复合条件分支指令，进行和一个或多个条件分别对应的比较运算，根据比较运算结果和指定分支条件值间的比较运算，向指定的分支对象进行分支；和设定一个条件的条件设定指令，处理器装置具有多个条件设定比较部，通过条件设定指令的运行而被选择，设定由条件设定指令指定的条件，在运行复合条件分支指令时，分别运行和由条件设定指令设定的条件对应的比较运算；和复合条件分支判定部，在运行复合条件分支指令时，利用对在多个条件设定比较部的比较运算结果和由复合条件分支指令指定的分支条件值进行了比较的结果，判定是否向分支对象进行分支。
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