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公开(公告)号：CN104145247A
公开(公告)日：2014-11-12
申请号：CN201280071070.5
申请日：2012-03-02
申请人： 瑞萨电子株式会社
IPC分类号： G06F11/00
CPC分类号： G06F12/0246 , G06F9/30065 , G06F9/324 , G06F2212/7208
摘要： 程序计数器(12)通过加上第1值或第2值来更新地址。代码选择电路(14)根据程序计数器(12)的地址，选择插入代码寄存器组块(17)内的由程序计数器(12)指定的地址所对应的插入代码或闪存控制代码用ROM(13)内的由程序计数器(12)指定的地址的源代码中的某一个。命令执行部(15)执行所选择的代码。多个源代码及插入代码中的至少1个是多循环命令。程序计数器(14)在执行多循环命令时，停止地址的更新。
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公开(公告)号：CN101251793A
公开(公告)日：2008-08-27
申请号：CN200810007989.3
申请日：2008-02-22
申请人： 富士通株式会社
发明人： 山崎恭启
IPC分类号： G06F9/38
CPC分类号： G06F9/30058 , G06F9/3017 , G06F9/324 , G06F9/3806 , G06F9/382 , G06F9/3844
摘要： 本发明提供了一种信息处理设备，所述信息处理设备具有预解码器，对输入指令中的操作码进行解码，生成条件转移指令信息和指令类型信息，并将条件转移指令信息、指令类型信息和删除了操作码的输入指令写入指令缓存存储器，所述条件转移指令信息指示输入指令是条件转移指令，所述指令类型信息在输入指令是条件转移指令时指示条件转移指令的类型；以及历史信息写单元，作为指令缓存存储器中存储的条件转移指令的运行结果，将指示条件转移指令是否被转移的历史信息写入指令缓存存储器中的如下区域，其中条件转移指令的操作码被删除。
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公开(公告)号：CN102109979A
公开(公告)日：2011-06-29
申请号：CN201010598247.X
申请日：2010-12-21
申请人： 索尼公司
发明人： 坂口浩章
IPC分类号： G06F9/38
CPC分类号： G06F9/30134 , G06F9/30145 , G06F9/30163 , G06F9/30167 , G06F9/322 , G06F9/324 , G06F9/3853 , G06F9/3877 , G06F9/3881
摘要： 一种处理器包括：缓冲器，用于将不具有操作数的指令序列分离为多个段，并存储这些段；数据保存器，用于保存将被处理的数据；译码器，用于参考所述数据，并从序列的顶部顺序地译码这些指令中的至少一个；指令执行单元，用于执行指令；以及指令序列控制单元，用于根据译码结果来控制指令序列的更新。当所译码的顶部指令是分支指令时，如果发生分支，则指令序列控制单元更新序列，使得段之一的顶部指令位于序列的顶部处。如果不发生分支，则指令序列控制单元更新序列，使得紧跟在分支指令之后的下一个指令位于序列的顶部处。
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公开(公告)号：CN101911016A
公开(公告)日：2010-12-08
申请号：CN200980101766.6
申请日：2009-01-07
申请人： 国际商业机器公司
CPC分类号： G06F9/30054 , G06F9/30167 , G06F9/324 , G06F9/342 , G06F9/355
摘要： 本发明涉及一种用于执行相对指令的方法、系统和程序产品，当执行所述执行相对指令时提取和执行相对地址处的目标指令，于是将处理返回至在所述执行相对指令之后的下一指令。通过将所述程序计数器的值与符号扩展即时字段相加来形成相对地址。可选地，在执行之前，通过对比特与目标指令的预定比特进行或操作的执行来修改所提取的目标指令。
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公开(公告)号：CN104395876B
公开(公告)日：2018-05-08
申请号：CN201380036045.8
申请日：2013-07-06
申请人： 皇家飞利浦有限公司
发明人： M.邓 , P.M.H.M.A.戈里斯森 , L.M.G.M.托休伊泽恩 , A.J.尼伊斯森
CPC分类号： G06F9/30145 , G06F1/03 , G06F9/30 , G06F9/30007 , G06F9/3001 , G06F9/30029 , G06F9/30061 , G06F9/324 , G06F9/3867
摘要： 一种计算机系统包括处理器和存储器，处理器包括被配置成重复地获得计算机程序的下一个指令的指令循环电路、被配置成对指令循环电路获得的指令解码并且执行该指令的指令解码器，该计算机系统支持在一个或多个所述指令的控制下的多个算术和/或逻辑操作，其中存储器存储多个表格，所述多个算术和/或逻辑操作中的每一个特定操作受存储器中存储的特定表格支持，每个特定表格包括针对一系列输入的所述特定算术操作的结果。
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公开(公告)号：CN100375012C
公开(公告)日：2008-03-12
申请号：CN200380110341.4
申请日：2003-12-30
申请人： ARM有限公司
发明人： D·J·西尔
CPC分类号： G06F9/342 , G06F9/30149 , G06F9/30167 , G06F9/3017 , G06F9/322 , G06F9/324
摘要： 提供了一种支持地址偏移量产生指令的数据处理系统(2)，所述指令利用传统指令编码中的先前冗余位编码地址偏移量值的位，同时保持与所述传统编码的向后兼容。
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公开(公告)号：CN1269052C
公开(公告)日：2006-08-09
申请号：CN98117276.8
申请日：1998-06-16
申请人： 松下电器产业株式会社
IPC分类号： G06F15/00
CPC分类号： G06F9/324 , G06F9/30101 , G06F9/30167 , G06F9/322 , G06F9/3885 , G06F9/461
摘要： 一种处理器，包括用于存储常量的常量寄存器36，用于对指令寄存器10中保存的指令的P0.0字段中所设置的格式码进行译码的格式译码器21，以及用于在格式译码器21译出应存在常量寄存器36中的常量被置于该指令中时，一边对常量寄存器中已存入的常量移位，一边将上述新的常量存入常量寄存器中的常量寄存器控制部件32。
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公开(公告)号：CN106406814B
公开(公告)日：2019-06-14
申请号：CN201610875658.6
申请日：2016-09-30
申请人： 上海兆芯集成电路有限公司
IPC分类号： G06F9/22
CPC分类号： G06F9/3016 , G06F9/28 , G06F9/30058 , G06F9/30145 , G06F9/3017 , G06F9/322 , G06F9/324 , G06F9/3802 , G06F9/3804 , G06F9/3814 , G06F9/3822 , G06F9/3842 , G06F9/3867
摘要： 本发明涉及处理器和将架构指令转译成微指令的方法。处理器具有执行微指令的执行流水线和将架构指令转译成为微指令的指令转译器。指令转译器具有：存储器，保持微代码指令并且每时钟周期提供多个微代码指令；队列，保持存储器所提供的微代码指令；分支解码器，其对微代码指令进行解码以检测本地分支指令，使得要将读取的多条微代码指令中直到程序顺序首位本地分支指令为止但不包括程序顺序首位本地分支指令的微代码指令写入队列，并防止将程序顺序首位本地分支指令及其后续微代码指令写入队列。本地分支指令由指令转译器而非由执行流水线进行解析。微代码转译器将每时钟周期从队列接收到的多个微代码指令转译成微指令以提供至执行流水线。
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公开(公告)号：CN104395876A
公开(公告)日：2015-03-04
申请号：CN201380036045.8
申请日：2013-07-06
申请人： 皇家飞利浦有限公司
发明人： M.邓 , P.M.H.M.A.戈里斯森 , L.M.G.M.托休伊泽恩 , A.J.尼伊斯森
CPC分类号： G06F9/30145 , G06F1/03 , G06F9/30 , G06F9/30007 , G06F9/3001 , G06F9/30029 , G06F9/30061 , G06F9/324 , G06F9/3867
摘要： 一种计算机系统包括处理器和存储器，处理器包括被配置成重复地获得计算机程序的下一个指令的指令循环电路、被配置成对指令循环电路获得的指令解码并且执行该指令的指令解码器，该计算机系统支持在一个或多个所述指令的控制下的多个算术和/或逻辑操作，其中存储器存储多个表格，所述多个算术和/或逻辑操作中的每一个特定操作受存储器中存储的特定表格支持，每个特定表格包括针对一系列输入的所述特定算术操作的结果。
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公开(公告)号：CN101911016B
公开(公告)日：2014-05-14
申请号：CN200980101766.6
申请日：2009-01-07
申请人： 国际商业机器公司
CPC分类号： G06F9/30054 , G06F9/30167 , G06F9/324 , G06F9/342 , G06F9/355
摘要： 本发明涉及一种用于执行相对指令的方法、系统和程序产品，当执行所述执行相对指令时提取和执行相对地址处的目标指令，于是将处理返回至在所述执行相对指令之后的下一指令。通过将所述程序计数器的值与符号扩展即时字段相加来形成相对地址。可选地，在执行之前，通过对比特与目标指令的预定比特进行或操作的执行来修改所提取的目标指令。
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