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公开(公告)号：CN111884630A
公开(公告)日：2020-11-03
申请号：CN202010077873.8
申请日：2020-02-01
Applicant: 瑞昱半导体股份有限公司
Inventor： 林嘉亮
IPC: H03K5/151
Abstract: 本发明公开了一种用来产生正交时钟的装置，用来接收一二相位输入时钟与输出一四相位输出时钟，该装置包含一电路按一环形拓扑而配置，其包含：一第一开关由该输入时钟的一第一相位控制；一第一反相放大器；一第二开关由该输入时钟的一第二相位控制；一第二反相放大器；一第三开关由该输入时钟的第一相位控制；一第三反相放大器；一第四开关由该输入时钟的第二相位控制；以及一第四反相放大器。该第一反相放大器与该第三反相放大器共用一第一再生负载，该负载根据该输入时钟的第一相位而重置；该第二反相放大器与该第四反相放大器共用一第二再生负载，该负载根据该输入时钟的第二相位而重置。
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公开(公告)号：CN110719091A
公开(公告)日：2020-01-21
申请号：CN201911053269.5
申请日：2019-10-31
Applicant: 宁波飞芯电子科技有限公司
Inventor： 雷述宇
IPC: H03K5/151
Abstract: 本申请提供一种互补信号生成电路，涉及电路技术领域。该互补信号生成电路包括：第一容性电路、第二容性电路和感性电路；第一容性电路和第二容性电路分别包括至少一个容性元件，感性电路包括至少一个感性元件；第一容性电路的第一端分别与电源和感性电路的第一端电连接；第一容性电路的第二端接地；第二容性电路的第一端与感性电路的第二端电连接，第二容性电路的第二端接地。通过电源为第一容性电路输入一次能量后，能量可以在第一容性电路和第二容性电路反复振荡，使第一容性电路和第二容性电路产生互补信号，相对于现有的生成互补信号的电路而言，可以有效减少能量浪费，降低互补信号生成电路的能耗。
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公开(公告)号：CN110277989A
公开(公告)日：2019-09-24
申请号：CN201910193020.8
申请日：2019-03-14
Applicant: 三星显示有限公司
Inventor： 瓦朗坦·艾布拉姆宗
Abstract: 本发明涉及一种正交时钟生成电路以及方法。该正交时钟生成电路包括近似正交时钟生成器和I/Q校正电路。近似正交时钟生成器具有被配置为接收输入信号的输入端，并且使用输入信号来生成近似正交时钟和近似同相时钟。I/Q校正电路被配置为在第一正交输入端处接收近似正交时钟并在第一同相输入端处接收近似同相时钟，并且在第一正交输出端处输出改善后的正交时钟并在第一同相输出端处输出改善后的同相时钟。
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公开(公告)号：CN105991114B
公开(公告)日：2019-03-08
申请号：CN201610146047.8
申请日：2016-03-15
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K5/151
Abstract: 本发明的实施例提供一种时钟生成电路，包括两相不重叠时钟生成电路、反相器和延时电路。两相不重叠时钟生成电路被配置为：基于非反相时钟信号和反相时钟信号来生成第一相位时钟信号和第二相位时钟信号。在时钟周期内的第一时间段和第二时间段期间，第一相位时钟信号和第二相位时钟信号对应于相同的逻辑值。反相器被配置为基于输入时钟信号来生成反相时钟信号。延时电路被配置为基于输入时钟信号来生成非反相时钟信号。延时电路具有足以使第一时间段和第二时间段之间的差值小于预定容差的预定延时。
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公开(公告)号：CN109074119A
公开(公告)日：2018-12-21
申请号：CN201680082386.2
申请日：2016-12-30
Applicant: 比特富集团有限公司 , 瓦莱里斯·瓦维洛夫斯
Inventor： 瓦列里·内贝斯尼伊
Abstract: 描述了用于差分信号转发的技术和设备。差分信号转发方法可以包括接收输入差分信号对，该输入差分信号对包括分别在第一输入端子和第二输入端子处接收的第一输入信号和第二输入信号，以及在相应的第一输出端子和第二输出端子处生成第一输出信号和第二输出信号。生成输出信号可以包括：在第一时间，基于确定第一输入信号和第二输入信号表示互补的值，将第一输出信号的电平设置为表示由第一输入信号表示的值的逆，并将第二输出信号的电平设置为表示由第二输入信号表示的值的逆，并且在第二时间，基于确定第一输入信号和第二输入信号不表示互补的值而将输出端子置于高阻抗状态。
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Patent Agency Ranking
公开(公告)号：CN107431480A
公开(公告)日：2017-12-01
申请号：CN201680018803.7
申请日：2016-02-04
Abstract: 本发明涉及一种用于控制H半桥的电子电路，所述H半桥包括相应不同类型的第一（7）和第二（8）MOSFET晶体管，其源极分别连到供电线（2）和连到电气接地（4），并且相应的漏极连到负载（1）。此外，所述控制电路包括：相应的不同类型的第一（9）和第二（10）双极晶体管，其集电极分别连到供电线（2）和电气接地（4），并且相应的基极连到所述MOSFET晶体管（7、8）的控制模块（16）；以及在所述MOSFET晶体管（7、8）的栅极之间相对于彼此并联装配的第一（18）和第二（19）分支，其连到第一双极晶体管（9）和第二双极晶体管（10）的相应的发射极，所述第一（18）分支包括第一二极管（181）和第一电阻（182），所述第二（19）分支包括第二二极管（191）和第二电阻（192）。
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公开(公告)号：CN105991114A
公开(公告)日：2016-10-05
申请号：CN201610146047.8
申请日：2016-03-15
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K5/151
CPC classification number: H03K5/1515
Abstract: 本发明的实施例提供一种时钟生成电路，包括两相不重叠时钟生成电路、反相器和延时电路。两相不重叠时钟生成电路被配置为：基于非反相时钟信号和反相时钟信号来生成第一相位时钟信号和第二相位时钟信号。在时钟周期内的第一时间段和第二时间段期间，第一相位时钟信号和第二相位时钟信号对应于相同的逻辑值。反相器被配置为基于输入时钟信号来生成反相时钟信号。延时电路被配置为基于输入时钟信号来生成非反相时钟信号。延时电路具有足以使第一时间段和第二时间段之间的差值小于预定容差的预定延时。
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公开(公告)号：CN104919704A
公开(公告)日：2015-09-16
申请号：CN201380070303.4
申请日：2013-11-15
Applicant: 密克罗奇普技术公司
Inventor： S·S·斯蒂德曼 , Z·伦德斯特鲁姆 , C·N·格洛扎 , S·D·库帕查恩 , H·达尔马瓦斯克伊塔
CPC classification number: G06F1/06 , G06F12/00 , G06F13/1694 , H03K5/05 , H03K5/1515 , H03K7/08 , H03L7/089 , H03L7/10 , Y02D10/14
Abstract: 本发明涉及一种互补输出产生器COG模块，其产生由上升及下降事件源所确定的至少两个互补输出。在所述COG模块的简单配置中，所述上升及下降事件源为相同信号，所述相同信号为具有所要周期及工作循环的信号。所述COG模块将此单信号输入转换成双互补输出。所述双输出的频率及工作循环实质上匹配所述单输入信号的频率及工作循环。可在所述互补输出之间引入消隐及静带时间，且还可对所述双互补输出进行相位延迟。另外，所述COG模块可提供高达四个输出以用于控制半波及全波桥式功率应用。
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公开(公告)号：CN102356369B
公开(公告)日：2015-06-10
申请号：CN201080012451.7
申请日：2010-03-18
Applicant: 高通股份有限公司
CPC classification number: G06F1/06 , H03K23/667 , H03K23/68
Abstract: 本发明描述一种同步化分频器，其可在频率上对时钟信号进行划分且提供具有良好信号特性的差分输出信号。在一个示范性设计中，所述同步化分频器包括单端分频器及同步电路。所述单端分频器在频率上对所述时钟信号进行划分且提供第一及第二单端信号，所述第一及第二单端信号可为具有时序偏斜的互补信号。所述同步电路基于所述时钟信号对所述第一及第二单端信号进行重新取样且提供具有减小的时序偏斜的差分输出信号。在一个示范性设计中，所述同步电路包括第一及第二开关以及第一及第二反相器。所述第一开关及所述第一反相器形成对所述第一单端信号进行重新取样的第一取样与保持电路或第一锁存器。所述第二开关及所述第二反相器形成对所述第二单端信号进行重新取样的第二取样与保持电路或第二锁存器。
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公开(公告)号：CN101390288B
公开(公告)日：2011-04-27
申请号：CN200780006500.4
申请日：2007-03-02
Applicant: 国际商业机器公司
CPC classification number: H03L7/0812 , H03K3/0322 , H03K5/133 , H03K2005/00032 , H03K2005/00052 , H03K2005/00208
Abstract: 调节电路(100)包括电流限制式压控电路，所述电流限制式压控电路配置以调节第一类型的信号差异。相位内插压控电路(M1-M8)配置以调节第二类型的信号差异。通过电流限制式方法执行粗略调谐控制，以在工艺和温度变化的情况下提供广泛的调谐范围，同时使用相位内插方法来实现线性调谐曲线和低抖动。调节电路(100)适用于在DLL或者PLL中使用。
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