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公开(公告)号：CN1111118C
公开(公告)日：2003-06-11
申请号：CN99803897.0
申请日：1999-02-10
Applicant: 莱克斯马克国际公司
IPC: B41J29/393 , H01L27/108
CPC classification number: B41J2/17546 , B41J2/04541 , B41J2/04563 , B41J2/0458 , B41J2/17526 , B41J25/34 , B41J2202/17 , G11C7/1036 , G11C8/10
Abstract: 一种用于向喷墨打印机的电子设备提供打印头识别信息的喷墨打印头识别系统，包括一个或多个集成在打印头芯片上的并行负载、串行输出、动态的移位寄存器，该芯片具有多条将打印机电子设备与打印头电子设备互连的地址线。每个移位寄存器的存储器输入端与存储器矩阵电连接，存储器矩阵根据从打印机电子设备接收解码信号功能，向移位寄存器提供信息的数字比特。在一种优选实施方式中，两条地址线为每个寄存器提供顺序的序列时钟信号，以便将从移位寄存器的相应的存储器矩阵接收到的信息比特串行地移位到输出线，打印机电子设备由此读取打印头识别信息。本发明的实施方式可以采用任意多个移位寄存器和存储器矩阵，而与可用地址线数无关。
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公开(公告)号：CN1098162C
公开(公告)日：2003-01-08
申请号：CN96122802.4
申请日：1996-09-26
Applicant: 莱克斯马克国际公司
Inventor： 乔治·K·帕里什 , 劳伦斯·R·斯图尔德
CPC classification number: B41J2/04541 , B41J2/04563 , B41J2/0458 , B41J2/17526 , B41J2/17546 , B41J25/34 , B41J2202/17 , G11C7/1036 , G11C8/10
Abstract: 一种喷墨打印头识别系统，用于向喷墨打印机的电路部分提供打印头识别信息，包括集成到打印头芯片的一个或多个并行输入串行输出的动态移位寄存器，该芯片具有多个连接打印机电路部分和打印头电路部分的地址线。用单个数字位给每个移位寄存器编程和编码。在一个实施例中，在单个芯片地址线上由多个移位寄存器接收的电压脉冲(负载信号)给每个编码的寄存器的输入端加上寄存器自己的编码位。两个地址线为每个寄存器提供相继的顺序的时钟信号，以便把编码的信息串行移动到一个输出器件，打印机电路部分在这里读出打印头识别信息。
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公开(公告)号：CN104281554B
公开(公告)日：2019-07-09
申请号：CN201410324322.1
申请日：2014-07-09
Applicant: 罗伯特·博世有限公司
IPC: G06F13/38
CPC classification number: G11C7/1036 , G06F21/79 , G06F2221/2141
Abstract: 电路装置和用于该电路装置的运行方法。本发明涉及一种电路装置（100），其具有用于输入第一数字输入数据（d_i1）的第一输入端（110a）、用于输出数字输出数据（d_o）的输出端（120）和用于接收控制信号（s）的控制输入端（130），其特征在于，设置至少两个寄存器单元（140a、140b），并且所述电路装置（100）被构造为根据控制信号（s）a）选择性地将第一输入数据（d_i1）或第二数字输入数据（d_i2）的至少一部分写入到第一寄存器单元（104a）中，并且b）选择性地将第一输入数据（d_i1）或第二输入数据（d_i2）的至少一部分写入到第二寄存器单元（104b）中。
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公开(公告)号：CN108885600A
公开(公告)日：2018-11-23
申请号：CN201780017504.6
申请日：2017-03-10
Applicant: 美光科技公司
CPC classification number: G06F3/0638 , G06F3/0604 , G06F3/0647 , G06F3/0656 , G06F3/0673 , G06T1/0007 , G06T1/60 , G11C7/1006 , G11C7/1036 , G11C11/4091 , G11C11/4096 , G11C2207/005 , G11C2207/102 , G11C2207/104 , H04N19/186
Abstract: 本发明包含使用经压缩与经解压缩数据进行操作的设备与方法。一种实例方法包含：将经压缩数据接收到存储器中处理PIM装置；及在所述PIM装置上解压缩所述经压缩数据。
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公开(公告)号：CN103890857B
公开(公告)日：2017-02-15
申请号：CN201180074427.0
申请日：2011-10-27
Applicant: 慧与发展有限责任合伙企业
Inventor： 马修·D·皮克特 , R·斯坦利·威廉姆斯 , 吉尔贝托·M·里贝罗
CPC classification number: G06F5/08 , G11C7/1012 , G11C7/1036 , G11C19/00 , G11C19/28 , G11C21/00
Abstract: 可移位的存储器采用环形寄存器来移位在该可移位的存储器内的环形寄存器中存储的数据字的连续子集。可移位的存储器包括具有内置字级移位能力的存储器。该存储器包括存储数据字的多个环形寄存器。数据字的连续子集是可在该存储器内在多个环形寄存器中的多组环形寄存器之间从第一位置向第二位置移位的。该数据字的连续子集具有小于该存储器的总大小的大小。当移位该连续子集时，该存储器仅移位在该连续子集内存储的数据字。
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Patent Agency Ranking
公开(公告)号：CN105893159A
公开(公告)日：2016-08-24
申请号：CN201610454483.1
申请日：2016-06-21
Applicant: 北京百度网讯科技有限公司
IPC: G06F9/50
CPC classification number: G11C7/1072 , G06F9/30025 , G06N3/0481 , G11C7/1006 , G11C7/1036 , G11C11/41 , G11C29/50004 , G11C2029/5004 , G06F9/5044
Abstract: 本申请公开了数据处理方法和装置。所述方法的一具体实施方式包括：对接收到的待处理输入数据进行预处理；根据预处理的结果以及通过线性拟合激活函数得到的结果获得所述待处理输入数据的配置参数的存储地址，其中，配置参数是根据激活函数的曲线特性预先设置的；根据所述存储地址获取所述待处理输入数据的配置参数；根据所述待处理输入数据的配置参数以及预先设定的电路结构对所述待处理输入数据的预处理结果进行处理，得到处理结果。该实施方式实现了使用配置参数和预先设定的电路结构实现对待处理输入数据的处理，不需要使用用于实现激活函数的专用电路，从而简化了电路结构，且同时可以支持多种激活函数，提高了灵活性。
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公开(公告)号：CN105684087A
公开(公告)日：2016-06-15
申请号：CN201480059305.8
申请日：2014-08-28
Applicant: 美光科技公司
CPC classification number: G11C7/065 , G11C5/06 , G11C7/06 , G11C7/08 , G11C7/1006 , G11C7/1036 , G11C7/22 , G11C8/10 , G11C11/4091 , G11C19/00 , G11C2207/002 , G11C2207/005
Abstract: 本发明包含与数据移位相关的设备及方法。实例设备包括：第一存储器单元，其耦合到阵列的第一感测线；第一隔离装置，其位于所述第一存储器单元与对应于所述第一存储器单元的第一感测电路之间；及第二隔离装置，其位于所述第一存储器单元与对应于第二感测线的第二感测电路之间。所述第一隔离装置及所述第二隔离装置经操作以在所述阵列中使数据移位而未经由所述阵列的输入/输出线转移所述数据。
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公开(公告)号：CN104281554A
公开(公告)日：2015-01-14
申请号：CN201410324322.1
申请日：2014-07-09
Applicant: 罗伯特·博世有限公司
IPC: G06F13/38
CPC classification number: G11C7/1036 , G06F21/79 , G06F2221/2141 , G06F21/72 , G06F2221/2153
Abstract: 电路装置和用于该电路装置的运行方法。本发明涉及一种电路装置（100），其具有用于输入第一数字输入数据（d_i1）的第一输入端（110a）、用于输出数字输出数据（d_o）的输出端（120）和用于接收控制信号（s）的控制输入端（130），其特征在于，设置至少两个寄存器单元（140a、140b），并且所述电路装置（100）被构造为根据控制信号（s）a）选择性地将第一输入数据（d_i1）或第二数字输入数据（d_i2）的至少一部分写入到第一寄存器单元（104a）中，并且b）选择性地将第一输入数据（d_i1）或第二输入数据（d_i2）的至少一部分写入到第二寄存器单元（104b）中。
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公开(公告)号：CN103703515A
公开(公告)日：2014-04-02
申请号：CN201280036797.X
申请日：2012-07-05
Applicant: 美光科技公司
Inventor： 尼古拉斯·亨德里克森
IPC: G11C16/34
CPC classification number: G11C16/26 , G11C7/1033 , G11C7/1036 , G11C7/1039 , G11C7/106 , G11C11/5642 , G11C16/0458 , G11C16/0483 , G11C2207/2272 , G11C2211/5642
Abstract: 本发明揭示操作存储器装置的设备及方法。在一种这样的方法中，从存储器装置确定及转移存储器单元的数据状态的第一部分，同时继续确定所述相同存储器单元的数据状态的剩余部分。在至少一种方法中，在第一感测阶段期间确定存储器单元的数据状态且转移所述存储器单元的所述数据状态，同时所述存储器单元经历额外感测阶段以确定所述存储器单元的所述数据状态的额外部分。
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公开(公告)号：CN102194508A
公开(公告)日：2011-09-21
申请号：CN201110045395.3
申请日：2011-02-22
Applicant: 安森美半导体贸易公司
IPC: G11C7/06
CPC classification number: G11C7/1036 , G11C7/08
Abstract: 本发明提供一种在串行接口方式的存储器装置中抑制电路规模的增加的同时使数据的读出高速化的存储器装置。EEPROM(100)包括：存储数据的存储器单元阵列(10)；根据与时钟同步地串行输入的地址信号选择存储器单元阵列(10)的地址的行地址译码器(11)和列地址译码器(12)；与数据的各位对应地一个一个设置的读出放大器(SA0～SA5、SA_M0、SA_M1)；和与时钟同步地从顶端位起依次串行输出从这些读出放大器读出的数据的移位寄存器(15)。列地址译码器(12)通过在确定列地址信号的全部位之前，将顶端位的两个候补数据分别输入到两个读出放大器(SA_M0、SA_M1)，从而开始两个候补数据的读出。
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