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公开(公告)号：CN103839280B
公开(公告)日：2016-08-17
申请号：CN201410110081.0
申请日：2014-03-21
Applicant: 武汉科技大学
Abstract: 本发明涉及一种基于视觉信息的人体姿态跟踪方法。其技术方案是：在训练阶段，根据训练数据中的真实三维人体姿态时序数据，采用高斯潜变量模型算法对人体姿态进行学习，得到人体姿态运动先验模型。在跟踪测试阶段，输入待测试的视频数据和视频数据中首帧三维人体姿态，利用在训练阶段学习到的人体姿态运动先验模型构建潜变量运动模型，使用潜变量运动模型来实现免疫粒子滤波算法中粒子更新步骤。本发明具有实用性强、准确性高和效率较高的特点。
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公开(公告)号：CN102611408B
公开(公告)日：2014-12-03
申请号：CN201210100159.1
申请日：2012-04-09
Applicant: 武汉科技大学
IPC: H03H7/12
Abstract: 本发明涉及一种基于忆阻器的带通滤波器。其技术方案是：该滤波器由控制模块(1)、低通滤波模块(3)和高通滤波模块(6)组成。低通滤波模块(3)由第一忆阻器电路(2)的输出端VLP1与第一忆容等效电路(4)的输入端VIN2连接组成；高通滤波模块(6)由第二忆容等效电路(5)的输出端VHP1与第二忆阻器电路(7)的输入端VIN4连接组成。第一忆阻器电路(2)的输入端、第一忆容等效电路(4)的输入端、第二忆容等效电路(5)的输入端和第二忆阻器电路(7)的输入端与控制模块(1)的输出端对应连接。第一忆阻器电路(2)的输入端VIN1外接滤波器的输入信号，第二忆阻器电路(7)的输出端外接滤波器的输出信号。本发明具有结构简单、精度高且更易于控制等特点。
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公开(公告)号：CN109408910B
公开(公告)日：2022-12-02
申请号：CN201811167785.6
申请日：2018-10-08
Applicant: 武汉科技大学
IPC: G06F30/30
Abstract: 本发明涉及一种浮地型分数阶忆阻器的等效电路及其使用方法。其技术方案是：浮地型分数阶忆阻器的等效电路施加激励电压v(t)后通过放大模块(8)、压控移相器(6)、频率/电压转换器(23)等23个模块的作用，能精确模拟分数阶忆阻器的电气特性且精度高，同时能保证通过浮地型分数阶忆阻器的等效电路的端子A和端子D的电流相等；引入的分数阶忆阻器阶次的控制信号α＇能改变分数阶忆阻器的阶次，引入的分数阶忆阻器状态变量初始值的控制信号x0＇能改变分数阶忆阻器状态变量的初始值。浮地型分数阶忆阻器的等效电路的分数阶阶次和分数阶忆阻器状态变量初始值调整方便和易于控制，使用时等效电路的端子A和端子D都能与其他电路中的元件进行任意连接。
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公开(公告)号：CN108319797B
公开(公告)日：2019-08-20
申请号：CN201810193950.9
申请日：2018-03-09
Applicant: 武汉科技大学
IPC: G06F17/50
Abstract: 本发明具体涉及一种分数阶忆阻器的等效电路。其技术方案是：分数阶忆阻器的等效电路的输入电流i(t)通过第二电阻(1)、电流传输器(2)、第一电阻(3)的作用后得到电流传输器(2)的输出电压Vo1，再经过压控移相器(6)移相和经过频率/电压转换器(21)检测输入信号的频率。第三加法器(11)的输出电压VD2经过模拟反相器(12)的作用后得到电流传输器(2)的输入电压VI2；引入的分数阶忆阻器阶次的控制信号α＇用来改变分数阶忆阻器的阶次，引入的分数阶忆阻器状态变量初始值的控制信号x0＇用来改变分数阶忆阻器状态变量的初始值。本发明不仅能够精确模拟分数阶忆阻器的电气特性且精度高，此外分数阶阶次和分数阶忆阻器状态变量初始值调整方便并易于控制。
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公开(公告)号：CN107832085A
公开(公告)日：2018-03-23
申请号：CN201710888566.6
申请日：2017-09-27
Applicant: 武汉科技大学
IPC: G06F9/38
CPC classification number: G06F9/3867
Abstract: 本发明公开了一种可重构任务的流水优化方法，包括如下步骤：第一步，切分应用程序；第二步，建立FPGA配置文件：第三步，流水配置和执行应用程序。本发明将应用程序按照数据流的方向进行切分，构建出FPGA配置文件，根据每个程序块的运行执行和配置时间动态流水化进行配置。本方法实现了应用程序在FPGA平台上进行重构和配置时的流水化，从而提供了应用程序执行的效率和重构的灵活性。
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Patent Agency Ranking
公开(公告)号：CN107807901A
公开(公告)日：2018-03-16
申请号：CN201710826828.6
申请日：2017-09-14
Applicant: 武汉科技大学
IPC: G06F15/78
CPC classification number: G06F15/7871
Abstract: 本发明公开了一种可扩展的可重构多核处理器连接方法，包括步骤如下：S1、建立可重构片上资源阵列；S2、建立可重构多核的片上网络；S3、在片上网络的连线交叉处配置片上路由器；S4、将可编程逻辑块连接到片上路由器上。本发明的技术方案具有高效性和灵活性，将片上网络与可重构技术结合在一起，通过片上路由器来连接所有的可编程逻辑块，从而使得芯片上不是通过总线，而是通过片上网络来进行连接，减少布线的宽度，提高芯片的利用面积，提供可扩展的片上连接方法。
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公开(公告)号：CN102611408A
公开(公告)日：2012-07-25
申请号：CN201210100159.1
申请日：2012-04-09
Applicant: 武汉科技大学
IPC: H03H7/12
Abstract: 本发明涉及一种基于忆阻器的带通滤波器。其技术方案是：该滤波器由控制模块(1)、低通滤波模块(3)和高通滤波模块(6)组成。低通滤波模块(3)由第一忆阻器电路(2)的输出端VLP1与第一忆容等效电路(4)的输入端VIN2连接组成；高通滤波模块(6)由第二忆容等效电路(5)的输出端VHP1与第二忆阻器电路(7)的输入端VIN4连接组成。第一忆阻器电路(2)的输入端、第一忆容等效电路(4)的输入端、第二忆容等效电路(5)的输入端和第二忆阻器电路(7)的输入端与控制模块(1)的输出端对应连接。第一忆阻器电路(2)的输入端VIN1外接滤波器的输入信号，第二忆阻器电路(7)的输出端外接滤波器的输出信号。本发明具有结构简单、精度高且更易于控制等特点。
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公开(公告)号：CN101299222B
公开(公告)日：2011-09-07
申请号：CN200810047985.8
申请日：2008-06-12
Applicant: 武汉科技大学
Abstract: 本发明涉及一种基于“图”编码的模拟电路的自动合成方法。自动合成步骤是：用“无向双连通多重图”表示模拟电路，设定模拟电路功能参数，随机产生N个个体以形成种群P，评估种群P中所有个体的性能，选亲和力高的n个个体形成临时种群PS，对临时种群PS克隆以形成克隆种群PC，对克隆种群PC修改以形成变异种群PM，评估变异种群PM，选出m个亲和力高的个体形成重选种群PR，替换种群P中亲和力低的个体以形成次新种群PN，随机产生d个新个体替换次新种群PN中亲和力低的个体以形成新种群PT；对新种群PT按种群P的评估方法进行评估，依此循环，直到生成满足要求的模拟电路。本发明具有可生成任意结构形式、映射简单、编码效率高的特点。
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公开(公告)号：CN107832255B
公开(公告)日：2021-07-23
申请号：CN201710827202.7
申请日：2017-09-14
Applicant: 武汉科技大学
Abstract: 本发明公开了一种运行时动态请求可重构核的优化方法，包括步骤：S1、配置通用可重构核：将通用可重构核配置到FPGA上；S2、切分可重构任务：将可重构任务切分为可重构子系统和软件子系统两部分：可重构子系统为可构建为可重构核、由硬件执行的部分，记为R，设可重构子系统R由m个硬件模块构成，m≥1；软件子系统为必须由软件执行的部分，记为S，设软件子系统S由n个软件模块构成，n≥2；S3、在通用处理器上执行可重构任务：将可重构任务调度到通用处理器上执行，执行可重构任务的第一个软件模块；S4、运行时动态请求可重构核：可重构任务的软件模块执行时，动态请求可重构核。本发明能实现可重构核的优化使用，提高可重构任务执行的效率。
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公开(公告)号：CN108319797A
公开(公告)日：2018-07-24
申请号：CN201810193950.9
申请日：2018-03-09
Applicant: 武汉科技大学
IPC: G06F17/50
Abstract: 本发明具体涉及一种分数阶忆阻器的等效电路。其技术方案是：分数阶忆阻器的等效电路的输入电流i(t)通过第二电阻(1)、电流传输器(2)、第一电阻(3)的作用后得到电流传输器(2)的输出电压Vo1，再经过压控移相器(6)移相和经过频率/电压转换器(21)检测输入信号的频率。第三加法器(11)的输出电压VD2经过模拟反相器(12)的作用后得到电流传输器(2)的输入电压VI2；引入的分数阶忆阻器阶次的控制信号α＇用来改变分数阶忆阻器的阶次，引入的分数阶忆阻器状态变量初始值的控制信号x0＇用来改变分数阶忆阻器状态变量的初始值。本发明不仅能够精确模拟分数阶忆阻器的电气特性且精度高，此外分数阶阶次和分数阶忆阻器状态变量初始值调整方便并易于控制。
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