一种基于FPGA的NVMe设备存储速度提升方法

    公开(公告)号:CN110209358A

    公开(公告)日:2019-09-06

    申请号:CN201910487224.2

    申请日:2019-06-05

    Abstract: 一种基于FPGA的NVMe设备存储速度提升方法,涉及数据存储技术领域,为解决现有技术中由于数据包发送时耗时较长,导致NVMe存储设备存储速度慢的问题,包括步骤一:NVMe SSD向FPGA发送读内存请求;步骤二:NVMe SSD获取FPGA回复的完成报文:步骤二一:流程控制模块向数据发送模块发送传输信号;步骤二二:数据发送模块根据接收到的数据包类型进行数据包封装和发送;步骤二三:数据包通过AXI-Stream总线传输给PCIe硬核,最终数据传输给NVMe SSD;步骤三:NVMe SSD从完成报文中提取待存储数据。本发明采用的半背靠背发送策略与普通发送策略相比可以提升22%的数据传输速度。

    一种基于时域稀疏性的FRI信号重构方法

    公开(公告)号:CN105761725B

    公开(公告)日:2019-07-05

    申请号:CN201610076167.5

    申请日:2016-02-03

    Abstract: 本发明涉及信号处理技术领域,具体涉及一种基于时域稀疏性的FRI信号重构方法。该重构方法包括如下步骤:(1)对模拟时间轴进行量化和网格化处理,网格的数目要远大于FRI信号的未知参数数目;(2)选取适当的系数对FRI采样样本进行加权求和,从而获取测量向量,并将此测量向量表示为时域上的稀疏线性组合;(3),将FRI参数估计问题转换为求解一个最小L0范数下的优化问题,其稀疏解中非零元素的位置即为时延参数的估计值,非零元素的值即为幅值参数的估计值。本发明提供的基于时域稀疏性的FRI信号重构方法,重构精度高,且抗噪声干扰能力强,适用噪声环境下的FRI信号重构问题。

    基于比较器的多路并行信号采集系统及其采集方法和信号重构方法

    公开(公告)号:CN103401556A

    公开(公告)日:2013-11-20

    申请号:CN201310351198.3

    申请日:2013-08-13

    Inventor: 张京超 付宁 杨柳

    Abstract: 基于比较器的多路并行信号采集系统及其采集方法和信号重构方法,涉及多频带信号采集领域。解决了现有的多频带信息采集系统的采样频率受ADC量化器限制使信息传输和存储压力大,导致系统运行速度缓慢,同时由于采集方法的制约导致采集系统抗噪性低的问题。该采集系统包括模拟乘法器、低通滤波器、比较器和采样器,多频带信号经低通滤波器和比较器处理后得到离散数字信号,对该信号进行傅立叶变换后完成该采集系统的采集工作;通过对观测值进行计算,并判断估计观测值的数值符号与实际观测值的数值符号不一致的个数或迭代次数是否达到最大迭代次数,进而计算出多频带稀疏信号的支撑基实现原信号的重构。本发明适用于对多频带信号进行采集及重构。

    一种基于稀疏正则化约束的盲解卷积无线通信信号重构方法

    公开(公告)号:CN115249028B

    公开(公告)日:2023-06-23

    申请号:CN202210520026.3

    申请日:2022-05-13

    Abstract: 一种基于稀疏正则化约束的盲解卷积无线通信信号重构方法,本发明涉及基于稀疏正则化约束的盲解卷积信号重构方法。本发明的目的是为了解决现有稀疏盲解卷积信号重构方法对观测点需求多、信号重构准确率低、误差大的问题。过程为:1、设置的初始值;2、定义损失函数,迭代的值;3、令为2中得到的中绝对值从大到小排列前sp个元素组成的向量,并记录这些元素的位置,C'为矩阵C中与这些位置对应的列组成的矩阵;4、设置新的盲解卷积问题的初值;5、定义损失函数,根据梯度下降算法迭代的值;6、令对应位置的值等于其余位置的值为0;此时的即为最终求解结果。本发明用于稀疏信号恢复技术领域。

    基于MiniVPX架构的高精度触发板卡和触发方法

    公开(公告)号:CN115509987B

    公开(公告)日:2023-06-02

    申请号:CN202211130709.4

    申请日:2022-09-16

    Abstract: 接口模块及触发单元、基于MiniVPX架构高精度触发板卡和触发方法,涉及飞机机载测试系统领域。针对现有技术中存在的,现有的测试系统难以保证机载测试数据的实时性与同步性的问题,本发明提供的技术方案为:接口模块的触发总线单元,单元包括:触发总线、CPU板卡、触发板卡和至少两个功能板卡;至少两个功能板卡串联连接,功能板卡依次发送触发信号至下一个功能板卡,最后一个功能板卡向CPU板卡发送触发信号,第一个功能板卡用于响应触发板卡发送的触发信号;CPU板卡用于向触发板卡发送控制信号;触发板卡用于向第一个功能板卡发送触发信号,并且还通过星型连接的方式分别向所有功能板卡发送触发信号。适合应用于飞机机载测试系统领域中的机载测试系统。

    接口模块及触发单元、基于MiniVPX架构的高精度触发板卡和触发方法

    公开(公告)号:CN115509987A

    公开(公告)日:2022-12-23

    申请号:CN202211130709.4

    申请日:2022-09-16

    Abstract: 接口模块及触发单元、基于MiniVPX架构高精度触发板卡和触发方法,涉及飞机机载测试系统领域。针对现有技术中存在的,现有的测试系统难以保证机载测试数据的实时性与同步性的问题,本发明提供的技术方案为:接口模块的触发总线单元,单元包括:触发总线、CPU板卡、触发板卡和至少两个功能板卡;至少两个功能板卡串联连接,功能板卡依次发送触发信号至下一个功能板卡,最后一个功能板卡向CPU板卡发送触发信号,第一个功能板卡用于响应触发板卡发送的触发信号;CPU板卡用于向触发板卡发送控制信号;触发板卡用于向第一个功能板卡发送触发信号,并且还通过星型连接的方式分别向所有功能板卡发送触发信号。适合应用于飞机机载测试系统领域中的机载测试系统。

    一种适配3D TLC型NAND闪存数据存储的双目标状态消除编解码方法

    公开(公告)号:CN113342570A

    公开(公告)日:2021-09-03

    申请号:CN202110672534.9

    申请日:2021-06-17

    Abstract: 本发明提出了一种适配3D TLC型NAND闪存数据存储的双目标状态消除编解码方法,通过编码器对胞元数据预处理,每个胞元内部均能够存储3比特信息,所述胞元共有8个状态N,将所述8个状态两两配对等分为4组,记为Gi;设其中一组GX为目标消除的双状态,将原始数据流按字线长度进行划分后,取4个胞元作为一个编码的码段,记录该4胞元码段中8种状态各自出现的个数num(N),根据码段中的状态组合得到重映射编码方法;将重映射编码后的信息存储到闪存的不同块中;解码器根据标志位将4胞元码段重新映射为原始数据;本发明的方法可以作为一种通用方法,提升了3D TLC型NAND闪存的可靠性。

    一种用于闪存胞元不可靠状态消除的等长编解码方法

    公开(公告)号:CN113342569A

    公开(公告)日:2021-09-03

    申请号:CN202110672532.X

    申请日:2021-06-17

    Abstract: 本发明提出了一种用于闪存胞元不可靠状态消除的等长编解码方法,通过编码器对胞元数据预处理,再将多级胞元所有状态等分为4组,然后根据码段中的状态组合得到重映射编码方法;将重映射编码后的信息存储到闪存的不同块中:解码器根据标志位将经过步骤三的3胞元码段反映射为原始数据;本发明基于等长编码的特性保证了所有码字的码长都相等,即原始数据流不会因为存储的调制数据中的比特翻转而发生窜动,实现一种以消除目标状态的数据形式对多级胞元闪存进行数据存储的编解码方法。对于MLC型闪存可消除一种状态,对于TLC型闪存可消除两种状态。

    一种面向压缩感知的稀疏多带信号盲重构方法

    公开(公告)号:CN111478706A

    公开(公告)日:2020-07-31

    申请号:CN202010259663.0

    申请日:2020-04-03

    Abstract: 本发明公开了一种面向压缩感知的稀疏多带信号盲重构方法。步骤1、将多带信号重构问题转化为线性规划问题;步骤2、步骤1的线性公式设定输入值;步骤3、输入采样得到的稀疏多带信号,对稀疏多带信号进行l次迭代操作;步骤4、计算SPG投影的估计值;步骤5、更新对应的残差的估计值:步骤6、更新迭代;步骤7、完成稀疏多带信号的重构。本发明解决现有方法在实际应用中由于无法获得当前有效频带数而导致无法进行稀疏多带信号重构的问题。

    一种基于FPGA的NVMe SSD PCIe数据包解析方法

    公开(公告)号:CN110134629A

    公开(公告)日:2019-08-16

    申请号:CN201910420009.0

    申请日:2019-05-20

    Abstract: 一种基于FPGA的NVMe SSD PCIe数据包解析方法,它属于存储技术领域。本发明解决了传统的PCIe数据包解析过程复杂,且需要占用的逻辑资源过多的问题。本发明借助接收的NVMe数据包的TLP参数的特征以及地址的变化规律,简化了数据包解析过程,在不解析TLP地址的情况下能够准确判断出TLP包的类型及作用;而且由FPGA内部的BlockRam构成的FIFO缓存模块只需记录TLP参数及编号字段,不用记录TLP的地址,与传统的数据解析方法相比,本发明提出的简化方法在保证数据解析模块功能完整的同时,可以节省57%的逻辑资源。本发明可以应用于存储技术领域。

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