低噪声模数转换器
    1.
    发明授权

    公开(公告)号:CN112511167B

    公开(公告)日:2024-08-16

    申请号:CN202010951169.0

    申请日:2020-09-11

    IPC分类号: H03M1/54

    摘要: 本公开涉及低噪声模数转换器。ADC电路中的噪声源可以包括采样电容器的kT/C噪声、数字电路耦合到采样电容器的噪声以及放大器噪声。此外,采样开关失配引起的电荷注入可引起偏移。使用所描述的技术可以大大消除或减少这些各种噪声源。结果,可以大大减小采样电容器的尺寸,同时仍然可以为整个转换器显着改善噪声性能和功率效率。

    采样保持刷新电路、方法及电子装置

    公开(公告)号:CN114614826B

    公开(公告)日:2024-07-09

    申请号:CN202210306639.7

    申请日:2022-03-25

    发明人: 李伊珂

    IPC分类号: H03M1/54 H03M1/12

    摘要: 本公开的实施例涉及采样保持刷新电路、方法及电子装置。该采样保持刷新电路包括第一采样单元、第二采样单元和比较器。第一采样单元和第二采样单元中,除了保持电容的电容值不同,其他元器件以及元器件连接方式均相同。比较器将第一采样单元产生的第一采样保持信号和第二采样单元产生的第二采样保持信号比较并输出刷新控制信号,该刷新控制信号用于刷新第一采样保持信号。本公开通过选择具有不同失调电压的比较器和不同电容值的保持电容,可自适应调整第一采样保持信号的刷新阈值。

    一种基于时钟锁定的低功耗单斜坡ADC电路

    公开(公告)号:CN116015305A

    公开(公告)日:2023-04-25

    申请号:CN202211610490.8

    申请日:2022-12-12

    IPC分类号: H03M1/56 H03M1/54

    摘要: 本发明提供一种基于时钟锁定的低功耗单斜坡ADC电路,属于模拟集成电路领域。包括:斜坡产生电路,采样保持电路,比较器,三个寄存器,反相器以及开关。输入信号VPIXEL作为比较器的同相输入端,VRAMP作为比较器的反相输入端。根据比较器的基本性质可知,若输入信号VPIXEL大于VRAMP,则比较器的输出VCOMP_out为高电平;若输入信号VPIXEL小于比较信号,则比较器的输出VCOMP_out为低电平。本发明采用二分法的方式,确定输入电压所对应的范围,缩短并锁定计数器的工作区间,降低计数器的开关功耗,进而降低单斜坡ADC的功耗。

    接口电路及其使用方法、模数采样电路及控制方法和雷达

    公开(公告)号:CN115225093A

    公开(公告)日:2022-10-21

    申请号:CN202110422756.5

    申请日:2021-04-16

    IPC分类号: H03M1/54

    摘要: 接口电路及其使用方法、模数采样电路及控制方法和雷达,其中,所述接口电路包括:边沿探测单元,用于当探测到目标脉冲的上升沿跳变与下降沿跳变时,输出采样置位信号;采样控制单元,用于在接收到所述采样置位信号时,直接输出与该探测到的目标脉冲对应的采样触发信号,以指示所述模数转换单元进行采样。采用上述方案,能够兼顾提升接口电路的响应速度和稳定性,以提高模数转换单元的采样效率和采样结果的完整性。

    开关电路和采样保持电路
    5.
    发明公开

    公开(公告)号:CN114553224A

    公开(公告)日:2022-05-27

    申请号:CN202210183504.6

    申请日:2022-02-25

    发明人: 官宇 刘伟

    IPC分类号: H03M1/08 H03M1/54

    摘要: 本公开提供了一种开关电路和采样保持电路,开关电路包括:控制电路和采样开关管;其中,控制电路,用于在保持阶段,根据第一时钟信号控制采样开关管关断;在采样阶段,根据第一时钟信号控制采样开关管导通,使得将输入信号输出;其中,控制电路包括:电荷泵电路、电压控制电路和第一电荷泄放电路;其中,电荷泵电路用于控制采样开关管的栅极和源极之间的电压的变化量小于或等于预设阈值;电压控制电路用于在保持阶段,不将电荷泵电路的电压加到采样开关管的栅极和源极;在采样阶段,将电荷泵电路的电压加到采样开关管的栅极和源极;第一电荷泄放电路用于在保持阶段,进行采样开关管和电压控制电路的电荷的对地泄放。

    一种用于快照式读出电路中的采样保持电路

    公开(公告)号:CN112636758B

    公开(公告)日:2022-05-06

    申请号:CN202011525814.9

    申请日:2020-12-22

    IPC分类号: H03M1/54

    摘要: 本发明公开用于快照式读出电路中的采样保持电路,包括:低误差采样开关电路、补偿电路、钳位电路和采样电容Cint;低误差采样开关电路包括结构一致的第一低误差采样开关gate1和第二低误差采样开关gate2,待采样电压从第一低误差采样开关gate1注入,第一低误差采样开关gate1与第二低误差采样开关gate2连接,第二低误差采样开关gate2另一端与采样电容Cint连接后接地;gate1和gate2同步开关,钳位电路并联在gate2两端,使得gate2两端电压相等;补偿电路并联在gate2两端向采样电容Cint补偿采样保持过程中的漏电流。采用漏电流补偿结构之后,采样电压对比未采用此结构时的电压降低幅度减少;结合采样开关的钳位结构限制开关在关闭状态下的漏电流,进一步减少采样电压降幅。

    一种实现低功耗低噪声的数模转换器和模数转换器

    公开(公告)号:CN112332849B

    公开(公告)日:2022-03-29

    申请号:CN202011249988.7

    申请日:2020-11-11

    IPC分类号: H03M1/54 H03M1/66

    摘要: 一种实现低功耗低噪声的数模转换器和模数转换器,数模转换器采用C2C+二进制电容阵列,低位终端电容与最低位的低位权重电容并联,高位终端电容与M个高位权重电容并联,L个低位权重电容和高位终端电容的第二连接端分别作为一个节点,每相邻两个节点中插入一个桥接电容;L+1个节点分别通过第二开关连接共模电压进行复位,低位终端电容和L个低位权重电容不参与采样,其第一连接端分别通过第一开关连接参考电压或地电压;高位终端电容和M个高位权重电容参与采样,其第一连接端分别通过第三开关连接输入电压、参考电压或地电压。本发明既具有C2C+二进制结构的面积小和功耗低的特点,又解决了其存在的噪声大和可靠性问题。

    采样保持电路、模数转换器及wifi芯片

    公开(公告)号:CN113078905A

    公开(公告)日:2021-07-06

    申请号:CN202110344042.7

    申请日:2021-03-30

    发明人: 何力 杨奕

    IPC分类号: H03M1/12 H03M1/54

    摘要: 本发明揭示了一种采样保持电路、模数转换器及wifi芯片,采样保持电路包括时钟产生子电路、栅压自举子电路和采样场效应管,栅压自举子电路对采样场效应管的栅极输出控制采样保持电路处于跟踪阶段的第二控制信号,其电压为导通电压与信号输入端的输入电压之和,导通电压大于外部电源的输入电压;该电路不会引入非理想谐波,排除了信号输入端的输入电压对采样场效应管的干扰,不会对模数转换器的输出信噪比产生负面影响,同时由于包括了大于输入电压的导通电压,减小了采样场效应管的导通电阻,提高了开关的响应速度,既保障了采样保持电路的输入与输出信号呈严格的线性关系,又提高了电路的性能。

    传感器信号处理电路
    9.
    发明授权

    公开(公告)号:CN108574488B

    公开(公告)日:2021-06-25

    申请号:CN201710132519.9

    申请日:2017-03-07

    摘要: 本发明提供一种传感器信号处理电路,包括:传感器模块;差分放大电路,差分放大电路的信号输入端与传感器模块的信号输出端连接;比较器电路,比较器电路的正相输入端与差分放大电路的信号输出端连接;占空比调整模块,差分放大电路的信号输出端与占空比调整模块的第一信号输入端连接;比较器电路的信号输出端与占空比调整模块的第二信号输入端连接,占空比调整模块的信号输出端与比较器电路的反相输入端连接。本发明具有以下优点:不需要很大的片上电阻及电容,有利于芯片集成。解决了传感器上电状态后的真实状态需求和高质量方波信号输出需求之间的矛盾。解决了通过AC耦合方式或RC滤波方式对传感器交变信号最低频率的限制。

    基于FPGA的非均匀超宽带稀疏信号采样方法

    公开(公告)号:CN108155911B

    公开(公告)日:2021-06-25

    申请号:CN201711258042.5

    申请日:2017-12-04

    IPC分类号: H03M7/30 H03M1/12 H03M1/54

    摘要: 本发明公开了一种基于FPGA的非均匀超宽带稀疏信号采样方法,解决了现有压缩采样方法硬件实现难,以及传统均匀采样方法受奈奎斯特定理限制的问题。实现步骤是:搭建硬件平台;确定采样率参数;根据需要的压缩比,设置AD采样率;确定伪随机码元公式;生成伪随机序列;将伪随机序列存入FPGA的RAM中;通过FPGA内部的吉比特收发器发送并作为采样保持器工作时钟,完成对稀疏信号的非均匀采样;通过恢复算法重构信号。本发明能够实现对最大4GHz的奈奎斯特采样率的10倍压缩,后端通过一个400MHz采样率的AD完成对2GHz带宽范围内稀疏信号的压缩采样。本发明大大降低了整个压缩采样系统实现的复杂度和开销,易工程化实现,应用于电子侦察中,采集频域稀疏雷达信号。