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公开(公告)号:CN119562175A
公开(公告)日:2025-03-04
申请号:CN202411723902.8
申请日:2024-11-27
Applicant: 维沃移动通信有限公司
Inventor: 蒙万盼
IPC: H04N25/78 , H04N25/75 , H04N5/04 , H04N25/531 , H04N25/705
Abstract: 本申请公开了一种摄像头同步方法、装置、电子设备和存储介质,属于电子设备技术领域。该方法包括:在第一摄像头向第二摄像头发送帧同步信号的情况下,基于第二摄像头采集的第一图像帧对应的图像数据,确定第二摄像头读出第二图像帧中的目标对象时的第一时间戳信息;确定第一摄像头对目标对象进行曝光的第二时间戳信息;根据第一时间戳信息和第二时间戳信息的时间差信息,分别确定第一摄像头和第二摄像头采集第二图像帧时的第一采集时间和第二采集时间;在第一采集时间时向第一摄像头发送第一采集控制信号,以及在第二采集时间时向第二摄像头发送第二采集控制信号,以使第二摄像头读出目标对象的时间与第一摄像头对目标对象的曝光时间同步。
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公开(公告)号:CN119299881B
公开(公告)日:2025-03-04
申请号:CN202411814242.4
申请日:2024-12-11
Applicant: 安徽大学
IPC: H04N25/78 , H04N25/616 , H04N25/709 , H04N25/571
Abstract: 本发明属于集成电路领域,具体涉及一种全局同步及局部异步的单斜ADC及CMOS图像传感器。其包括:时序控制电路、动态斜坡发生器、行判断模块、列读出电路和列判断模块。时序控制电路用于使得各像素单元在量化过程中的总转换时间保持一致。行判断模块用于确定自适应斜坡的摆幅范围;列读出电路结合各个阶段的量化结果生成最终的像素值;列判断模块用于在像素多采样量化阶段根据各个像素单元的全量程量化结果生成控制动态斜坡发生器和列读出电路的使能信号,必要时将电路关闭,以降低整体电路的功耗。本发明解决了现有的单斜ADC采用自适应相关多采样机制的情况下仍然存在的整体帧率差异较大的问题。
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公开(公告)号:CN115883991B
公开(公告)日:2025-02-25
申请号:CN202211519260.0
申请日:2022-11-30
Applicant: 天津大学
IPC: H04N25/59 , H10F39/12 , H10F39/18 , H04N25/626 , H04N25/616 , H04N25/65 , H04N25/585 , H04N25/77 , H04N25/78
Abstract: 本发明公开了一种提升高动态范围像素转换节点信噪比的像素电路,包括P型衬底,P型衬底设置大光电二极管、一号传输门、一号电荷‑电压转换节点、二号传输门、二号电荷‑电压转换节点、三号传输门、三号电荷‑电压转换节点、四号传输门、小光电二极管,大光电二极管左侧设置四号电荷‑电压转换节点,四号电荷‑电压转换节点和大光电二极管之间连接电荷防溢晶体管,四号电荷‑电压转换节点经二号横向溢流集成电容接地,四号电荷‑电压转换节点和二号电荷‑电压转换节点之间连接溢出电荷的传输栅。本发明在保证高动态范围像素满阱容量不发生明显变化的同时显著提高了SP1L向SP2H信号切换时的信噪比大小,显著优化了该高动态像素的成像质量。
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公开(公告)号:CN119485054A
公开(公告)日:2025-02-18
申请号:CN202411918832.1
申请日:2024-12-25
Applicant: 荣耀终端有限公司
Inventor: 赵海天
IPC: H04N25/75 , H04N25/78 , H04N25/709
Abstract: 本申请涉及摄像技术领域,提供了一种图像读出方法、电子设备和计算机可读存储介质,应用于摄像模组。该方法包括:获取多个特征像素单元,多个特征像素单元为第一图像中的第一特征区域对应的多个像素单元;按照第一模式读出多个特征像素单元的多个第一电荷量,以及按照第二模式读出多个非特征像素单元的多个第二电荷量,以得到第二图像;其中,多个非特征像素单元为摄像模组的像素阵列中除多个特征像素单元之外的部分或全部的像素单元,多个第一电荷量的数量比多个特征像素单元的数量的第一比值,大于多个第二电荷量的数量比多个非特征像素单元的数量的第二比值,第一比值小于或等于1。以上方法可以图像的清晰度的同时,还降低功耗。
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公开(公告)号:CN119485047A
公开(公告)日:2025-02-18
申请号:CN202411487058.3
申请日:2024-10-24
Applicant: 中国电子科技集团公司第十一研究所
Abstract: 本发明提出了一种小像元内低噪声和高动态范围读出电路及红外焦平面阵列,该读出电路包括CTIA电路、CDS电路、列级传输电路以及时序控制电路;CTIA电路包括:光电探测器D1、单端共源共栅放大器AMP、复位开关RST、版图提取寄生电容C0、一档电容C1及选择开关GS0、二档电容C2及选择开关GS1、三档大电容C3及选择开关GS2/GS2_、AMP带宽限制电容C4;CTIA电路配置为根据光电流的大小选择对应输出通道的积分电容组合;时序控制电路用于产生电路工作所需的时序控制信号,包括输出通道选择开关。本申请根据光强可以切换不同的积分电容进行积分,可以处理fA级别的注入电流;输出结果具有超高线性度;同时在像元内实现CTIA和CDS结构,CTIA噪声更低,拥有更高的动态范围。
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公开(公告)号:CN115802185B
公开(公告)日:2025-02-18
申请号:CN202211519278.0
申请日:2022-11-30
Applicant: 天津大学
IPC: H04N25/76 , H04N25/78 , H04N25/779
Abstract: 本发明公开了一种两步锯齿状单斜ADC,包括像素阵列、行驱动电路、斜坡发生器、比较器模块、计数器及寄存器组成,每个比较器模块中一号比较器连接一号MOS管、二号MOS管,二号比较器连接三号MOS管、四号MOS管;一号比较器正向输入端经一号电容接至列像素电路输出端,一号比较器负向输入端经一号开关接至斜坡发生器输出端,一号开关两端间并联相互串联的二号开关和四号电容,五号MOS管栅极接至二号开关和四号电容之间,三号开关一端连接至二号开关和四号电容之间,另一端接入参考电压;一号比较器和二号比较器之间连接二号电容、三号电容。本发明既可节省SS ADC的长转换时间,又可降低SS ADC电路的功耗,结构简单,保证了ADC的高精度。
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公开(公告)号:CN119450253A
公开(公告)日:2025-02-14
申请号:CN202410660613.1
申请日:2024-05-27
Applicant: 豪威科技股份有限公司
IPC: H04N25/78 , H04N25/772
Abstract: 本申请涉及一种用以改进CIS中ADC范围的列斜坡缓冲器设计。一种成像系统包括像素阵列及耦合到所述像素阵列的读出电路系统。所述读出电路系统包含斜坡产生器及多个列单元胞元,每一列单元胞元包括列斜坡缓冲器及列比较器,且每一列斜坡缓冲器包括经耦合以接收来自所述斜坡产生器的斜坡信号的输入节点、具有耦合到所述输入节点的栅极端子及耦合到电力线的漏极端子的晶体管、耦合于所述晶体管的源极端子与所述列比较器之间的输出节点以及耦合于所述输入节点与所述晶体管之间的交流AC耦合单元。所述AC耦合单元包括耦合于所述输入节点与所述晶体管的所述栅极端子之间的电容器,以及耦合于所述输入节点与所述晶体管的所述栅极端子之间的复位开关。
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公开(公告)号:CN119450248A
公开(公告)日:2025-02-14
申请号:CN202410676396.5
申请日:2024-05-29
Applicant: 豪威科技股份有限公司
Abstract: 本公开涉及一种分布式斜坡线性度补偿电路。一种成像系统包括经配置以响应于入射光而产生多个图像电荷电压信号的像素阵列,及耦合到所述像素阵列的读出电路系统,所述读出电路系统包含多个列单元胞元。每一列单元胞元包括多个比较器中的至少一者,其中每一比较器经耦合以通过斜坡信号线而接收来自斜坡产生器的斜坡信号。每一列单元胞元还包括耦合到所述斜坡信号线的补偿电流单元,每一补偿电流单元包括补偿电流源及耦合到所述补偿电流源的补偿电流开关,其中所述补偿电流源及所述补偿电流开关耦合于所述斜坡信号线上的第一节点与第二节点之间。
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公开(公告)号:CN116057957B
公开(公告)日:2025-02-11
申请号:CN202180044992.6
申请日:2021-05-07
Applicant: 索尼半导体解决方案公司
IPC: H04N25/76 , H04N25/78 , H04N25/77 , H04N25/772 , H04N25/779
Abstract: 本发明提高了使用比较器的固态成像元件中的图像数据的图像质量。固态成像元件配备有电流源、像素电路、比较电路、控制部和计数器。电流源生成恒定电流。像素电路生成电压高于与电流源的电导相对应的预定的下限电压的像素信号。比较电路以预定的放大率放大像素信号,并将其与预定的参考信号进行比较。当放大率增加时,控制部降低电导。计数器贯穿持续至来自比较电路的比较结果被反转的时间段计数并输出计数值。
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公开(公告)号:CN113055620B
公开(公告)日:2025-02-11
申请号:CN202011012368.1
申请日:2020-09-23
Applicant: 三星电子株式会社
Abstract: 提供了一种图像传感器的驱动器电路。该驱动器电路包括:行解码器,解码对像素阵列的目标行加以指示的地址,并生成与目标行相对应的操作指示信号;数字逻辑电路,包括:目标行逻辑电路,基于操作指示信号生成像素控制信号;电力开关,被配置为基于操作指示信号在第一时间期间将电源电压连接到目标行逻辑电路,并且在第二时间期间将电源电压与目标行逻辑电路隔离;以及输出电路,被配置为在第二时间期间输出缺省信号;以及行驱动器,被配置为在第一时间期间基于像素控制信号驱动目标行,并在第二时间期间基于缺省信号驱动目标行。
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