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公开(公告)号：CN101383954A
公开(公告)日：2009-03-11
申请号：CN200710121439.X
申请日：2007-09-06
Applicant: 北京中电华大电子设计有限责任公司
Inventor： 蒙卡娜
IPC: H04N7/24
Abstract: 本发明公开了一种支持多种音视频标准的媒体处理芯片的实现方法，该芯片基于CPU处理器核，集成了可编程视频协处理器、熵解码器、存储器控制器、DMA控制器等，采用了标准的AMBA总线结构，能够支持MPEG4、H.264、AVS等主要的视频编码格式。该方法的优点在于采用软硬件结合的方法，以较低的成本，实现了高效、灵活的音视频解码功能。能够通过软件的修改，灵活的实现不同的音视频编码标准。通过扩展多个可编程视频协处理器，可以提高系统性能，支持高清视频播放。标准的总线结构可以方便的增加功能模块，扩展系统应用。
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公开(公告)号：CN101193287A
公开(公告)日：2008-06-04
申请号：CN200610144229.8
申请日：2006-11-30
Applicant: 北京中电华大电子设计有限责任公司
Abstract: JPEG2000标准中，MQ解码流程需要进行很多判断、分支及循环的操作。在电路设计时，如果完全按照标准流程设计，将极大的降低解码器的效率。为此，本发明对MQ解码流程进行了化简和改进，优化了概率估计和解码过程，重新设计了上下文状态表，使解码器在接收到CX后，不需要查询ROM中的PET表，通过译码即可得到解码数据D，减少了位平面解码器的等待时间。同时改进了重整流程中的移位和字节输入操作，使重整和字节输入操作可在一个周期内完成。本发明提高了MQ解码的效率，解码电路能够实现每两个时钟周期解码一个CX，输出一个解码数据D。
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公开(公告)号：CN1991373A
公开(公告)日：2007-07-04
申请号：CN200510135527.6
申请日：2005-12-30
Applicant: 北京中电华大电子设计有限责任公司
IPC: G01R11/02
Abstract: 一种电能表专用集成电路的抗干扰电路，包括：电量计度硬件逻辑电路、MCU、存储器数据接口控制电路。所述电路结构中，电量计度硬件逻辑电路独立于MCU完成电量计度、最大需量计算、预付费、字轮驱动和继电器控制功能；MCU完成通信规约处理和显示功能；存储器数据接口控制电路完成MCU与计度电路访问存储器的总线仲裁，并在外电上电时从存储器加载电量处理参数到硬件逻辑。这种电路结构将电能表计度这一核心功能从原来由MCU处理中独立出来，避免了MCU程序执行过程易受外界干扰影响导致电量丢失这一严重缺陷。经实际测试证明，采用这种电路结构后，即便MCU在实际工作过程中受到严重干扰后程序不能正常执行，也不影响电量的记录。
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Patent Agency Ranking
公开(公告)号：CN119670167A
公开(公告)日：2025-03-21
申请号：CN202411759243.3
申请日：2024-12-03
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本申请公开了一种安全芯片的状态管理方法及装置，状态管理方法包括：安全芯片上电复位后判断所述安全芯片的用户程序区的首个数据是否为特定值；当用户程序区的首个数据是特定值时，判断第一固件程序是否与预存程序相同；当所述第一固件程序与所述预存程序相同时，判断第二固件程序是否正确；当所述第二固件程序校验正确时，向所述存储器的用户程序区内下载用户程序；以及在下载所述用户程序后，删除所述存储器的所述安全数据区内的至少部分固件程序。本申请的安全芯片的状态管理方法及装置，可以在用户程序使用阶段删除至少部分固件程序，以对安全芯片的存储空间进行回收，同时保障芯片的安全。
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公开(公告)号：CN106445851A
公开(公告)日：2017-02-22
申请号：CN201610739399.4
申请日：2016-08-26
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F13/24
CPC classification number: G06F13/24
Abstract: 以Flash为主存储器的NFC-SIM芯片在Flash擦写期间CPU无法读取存储在Flash中的程序，无法响应接口中断，会影响NFC-SIM芯片的接口响应能力。为了解决此问题，本发明提出了一种提高Flash NFC-SIM芯片接口响应能力的实现方法。在接口产生需要CPU快速响应的中断时，产生Flash擦写中止请求信号，中止Flash擦写操作后CPU恢复运行，快速响应中断，之后再通过判断Flash擦写中止标志启动恢复Flash擦写操作。通过采用该方法，使Flash NFC-SIM芯片能够支持7816和SWP接口并行进行Flash擦写操作，有效提高了Flash擦写期间的接口响应能力。
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公开(公告)号：CN103914578A
公开(公告)日：2014-07-09
申请号：CN201210595906.3
申请日：2012-12-28
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F17/50
Abstract: 本发明提出了一种保持占空比的组合逻辑电路实现结构，该电路结构具有保持输入输出信号占空比的特点。该发明适用于输入输出信号占空比一致性要求较高的电路设计领域，如双沿采样的同步电路设计领域。通过本发明可完成集成电路中时钟路径占空比保持，优势在于使得经组合逻辑的时钟信号占空比保持与输入信号一致，使得集成电路中数字电路建立(setup)时间更易满足收敛要求。
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公开(公告)号：CN101192303A
公开(公告)日：2008-06-04
申请号：CN200610144044.7
申请日：2006-11-24
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种针对ISO/IEC JPEG2000图像压缩编解码标准中EBCOT系数比特平面快速解码的实现方法及其电路结构，以提高JPEG2000 EBCOT解码效率。本发明提出的位平面解码电路将原码块扩展虚拟象素构成新的码块，分三个bank存储系数及系数的状态信息，减小了存储器的访问量。并且采用6×4的窗口对系数进行扫描，加速了解码过程；同时利用并行技术进一步提高了总的EBCOT解码吞吐量。本发明可以提高JPEG2000图像解码效率，可以广泛应用于数码影像产品中。
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公开(公告)号：CN119376641A
公开(公告)日：2025-01-28
申请号：CN202411689770.1
申请日：2024-11-25
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F3/06
Abstract: 本发明公开了一种信号处理装置。根据本发明实施例的信号处理装置包括随机存储器，所述随机存储器用于存储数据的存储；计算单元，所述计算单元与所述随机存储器相连接以获取所述存储数据，并对所述存储数据进行计算；以及控制单元，所述控制单元与所述随机存储器相连接，以控制所述随机存储器的读写。根据本发明实施例的信号处理装置，节约了芯片面积、降低了生产成本。
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