一种SPARC V8处理器中断嵌套处理方法

    公开(公告)号:CN118426931A

    公开(公告)日:2024-08-02

    申请号:CN202410607233.1

    申请日:2024-05-16

    Abstract: 本发明涉及技术领域,公开了一种SPARC V8处理器中断嵌套处理方法,应用在嵌入式计算机系统中,所述系统以SPARC V8处理器为核心,并加载应用程序,包括:S1:进行系统通用化处理流程,结合当前中断优先级level和中断号设置中断级别PIL值,然后所述系统通用化处理流程使能中断并调用相应的中断服务子程序;S2:在所述中断服务子程序设计时,将所述中断优先级level为0的低优先级中断号和为1的高优先级中断号进行比较,主动下调对应的所述中断级别PIL值,并临时屏蔽对应范围内的中断。明确了不同优先级中断响应和处理的时序,保障了高优先级中断响应和处理的实时性,提高了软件设计通用性,避免因中断优先级错误带来的软件运行时序风险。

    基于PCIe总线的通信方法及系统

    公开(公告)号:CN111400211A

    公开(公告)日:2020-07-10

    申请号:CN202010267176.9

    申请日:2020-04-07

    Abstract: 本发明提供了一种基于PCIe总线的通信方法及系统,应用在包含主控CPU、从设备FPGA、状态监控高可靠反熔丝FPGA、可控的主控CPU供电DC_DC模块,以及从设备FPGA启动程序存储芯片的通信系统中,方法包括:启动状态监控高可靠反熔丝FPGA、主控CPU,并建立从设备FPGA与主控CPU之间的PCIe连接;通过状态监控高可靠反熔丝FPGA对主控CPU和从设备FPGA之间的通信状态进行监控。从而通过状态监控高可靠反熔丝FPGA对整个PCIe总线通信系统状态监控、控制PCIe子设备与主设备的供电时序及系统重载,实现整个通信系统可靠性提升,并使系统具备故障恢复能力。

    三机异构冗余系统和控制方法

    公开(公告)号:CN111880971B

    公开(公告)日:2024-02-02

    申请号:CN202010756190.5

    申请日:2020-07-30

    Abstract: 本发明提供了一种三机异构冗余系统和控制方法,该系统包括:处理器A模块、处理器B模块、处理器C模块、功能模块A、功能模块B、电源模块A、电源模块B、电源模块C,所述电源模块A向所述处理器A模块、功能模块A提供电能,并向所述处理器A模块输出控制权状态A;所述电源模块B向所述处理器B模块、功能模块B提供电能,并向所述处理器B模块输出控制权状态B;所述电源模块C向所述处理器C模块、功能模块B提供电能,并向所述处理器C模块输出控制权状态C。从而实现了不同处理器对功能模块的访问和互相间的信息替换,满足多种冗余模式重构方法,有效地提(56)对比文件Jian-xiao Zou等.Design andreliability analysis of emergency tripsystem with triple modular redundancy.《2009 International Conference onCommunications, Circuits and Systems》.2009,1006-1009.

    基于PCIe总线的通信方法及系统

    公开(公告)号:CN111400211B

    公开(公告)日:2022-08-12

    申请号:CN202010267176.9

    申请日:2020-04-07

    Abstract: 本发明提供了一种基于PCIe总线的通信方法及系统,应用在包含主控CPU、从设备FPGA、状态监控高可靠反熔丝FPGA、可控的主控CPU供电DC_DC模块,以及从设备FPGA启动程序存储芯片的通信系统中,方法包括:启动状态监控高可靠反熔丝FPGA、主控CPU,并建立从设备FPGA与主控CPU之间的PCIe连接;通过状态监控高可靠反熔丝FPGA对主控CPU和从设备FPGA之间的通信状态进行监控。从而通过状态监控高可靠反熔丝FPGA对整个PCIe总线通信系统状态监控、控制PCIe子设备与主设备的供电时序及系统重载,实现整个通信系统可靠性提升,并使系统具备故障恢复能力。

    三机异构冗余系统和控制方法

    公开(公告)号:CN111880971A

    公开(公告)日:2020-11-03

    申请号:CN202010756190.5

    申请日:2020-07-30

    Abstract: 本发明提供了一种三机异构冗余系统和控制方法,该系统包括:处理器A模块、处理器B模块、处理器C模块、功能模块A、功能模块B、电源模块A、电源模块B、电源模块C,所述电源模块A向所述处理器A模块、功能模块A提供电能,并向所述处理器A模块输出控制权状态A;所述电源模块B向所述处理器B模块、功能模块B提供电能,并向所述处理器B模块输出控制权状态B;所述电源模块C向所述处理器C模块、功能模块B提供电能,并向所述处理器C模块输出控制权状态C。从而实现了不同处理器对功能模块的访问和互相间的信息替换,满足多种冗余模式重构方法,有效地提高了系统的可靠性。

    1553B总线数据通信方法和系统

    公开(公告)号:CN111541595A

    公开(公告)日:2020-08-14

    申请号:CN202010302532.6

    申请日:2020-04-16

    Abstract: 本发明提供了一种1553B总线数据通信方法和系统,应用在嵌入式操作系统中,所述嵌入式操作系统中加载有总线控制器BC的驱动程序和应用程序;该方法包括:步骤S1:将所有数据包分成不大于32个字的单消息;步骤S2:BC按照轮转的RT子地址,向RT发送单消息,并在消息内容中约定数据传输协议;步骤S3:RT按照单消息中断方式,依次接收各个RT子地址传输的单消息,并对所述单消息进行协议解析。本发明简化了1553B总线应用程序与驱动程序之间的接口,实现了1553B总线驱动软件的通用化设计,通过驱动软件对应用软件的透明化、标准化设计,降低了1553B总线应用程序的开发难度,提升了软件开发效率。

    一种航天器用磁力距器驱动及遥测采集电路

    公开(公告)号:CN116834974A

    公开(公告)日:2023-10-03

    申请号:CN202310763487.8

    申请日:2023-06-27

    Abstract: 本发明公开一种航天器用磁力距器驱动及遥测采集电路,用于将接收的数字量遥控信号转换成模拟电压量输出至驱动功率放大电路的驱动控制电路。用于接收模拟电压量,并根据电压的高低按比例输出相应的驱动电流至外部的驱动功率放大电路。用于采集驱动功率放大电路对外输出的驱动电流大小和方向,以对数字量遥控信号响应正确与否判断的驱动电流遥测采集电路。本发明使用复合三极管构成的达林顿驱动电路结构,提高输出电流的驱动能力和稳定性。使用运算放大器输入端“虚短”和“虚断”特性,提高输出电流控制精度。采用两路稳压二极管并联的结构,可使输出端两端电压控制在安全范围内。采用电流采样电阻经三极管输出电流遥测可实现电流的实时准确监测。

    一种可扩展的高性能多接口星载存储系统

    公开(公告)号:CN111522513B

    公开(公告)日:2022-08-12

    申请号:CN202010336358.7

    申请日:2020-04-24

    Abstract: 本申请公开了可扩展的高性能多接口星载存储系统,包括:至少一套存储系统,存储系统包括电源模块、存储模块和网络交换模块;存储模块包括第一存储单元和第二存储单元,第一存储单元和第二存储单元分别包括一个提供标准PCIe及以太网接口的固存模块和一个提供定制接口与PCIe接口相互转换的接口模块;电源模块用于为所述存储模块和网络交换模块供电;网络交换模块用于提供可扩展及标准以太网接口。本发明利用成熟的以太网交换通信技术,提升了星载存储系统数传接口通用性同时保留了定制化设计、提高了星载存储系统的可扩展性,提升存储性能的同时保留了传统星载存储系统可靠性,对于提高星载数传系统传输速率、可扩展性及可靠性保障有着积极的借鉴意义。

    1553B总线数据通信方法和系统

    公开(公告)号:CN111541595B

    公开(公告)日:2022-02-15

    申请号:CN202010302532.6

    申请日:2020-04-16

    Abstract: 本发明提供了一种1553B总线数据通信方法和系统,应用在嵌入式操作系统中,所述嵌入式操作系统中加载有总线控制器BC的驱动程序和应用程序;该方法包括:步骤S1:将所有数据包分成不大于32个字的单消息;步骤S2:BC按照轮转的RT子地址,向RT发送单消息,并在消息内容中约定数据传输协议;步骤S3:RT按照单消息中断方式,依次接收各个RT子地址传输的单消息,并对所述单消息进行协议解析。本发明简化了1553B总线应用程序与驱动程序之间的接口,实现了1553B总线驱动软件的通用化设计,通过驱动软件对应用软件的透明化、标准化设计,降低了1553B总线应用程序的开发难度,提升了软件开发效率。

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