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公开(公告)号：CN110380916A
公开(公告)日：2019-10-25
申请号：CN201910793175.5
申请日：2019-08-26
Applicant: 上海航天测控通信研究所
IPC: H04L12/24 , H04L12/26 , H04L12/703 , H04L12/707
Abstract: 本发明提供了一种自适应切换的以太网交叉冗余备份系统和方法，包括独立供电的主份电路和备份电路；主份电路和备份电路中均包含有冗余控制模块；主份电路还包括光纤物理通道M_A和光纤物理通道M_B；备份电路还包括光纤物理通道S_A和光纤物理通道S_B；光纤物理通道M_A、光纤物理通道S_A均与网络交换机主份连接，光纤物理通道M_B、光纤物理通道S_B均与网络交换机备份连接；冗余控制模块用于实现各个光纤物理通道的自适应切换。本发明提高了接口电路和拓扑可靠性，适于宇航等高可靠应用领域；可以在链路出现问题时进行自适应切换，提高了切换的实时性、灵活性和有效性，避免了切换过程中链路中断导致大量数据丢失。
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公开(公告)号：CN107395264A
公开(公告)日：2017-11-24
申请号：CN201710592610.9
申请日：2017-07-19
Applicant: 上海航天测控通信研究所
Abstract: 本发明涉及高级在轨系统技术领域，具体来说是一种基于IP+over+CCSDS+AOS标准的通信装置及方法，包括用IP数据输入接口、FPGA程序存储器、晶体振荡器、输出接口、遥测输出模块、电源模块、协议控制器等组成通信装置，利用FPGA内部缓存资源，通过复用的物理链路和共享缓存，从而将来自不同IP地址的终端数据按照IP OVER CCSDS AOS协议进行处理并下传，即使其中某个终端数据传输量较大时，保证了较为充分的缓存资源以供该虚拟信道使用，大大提高了传输效率和数据的实时性，从而为航天或其他军事领域提供高速、稳定、可靠并具有通用性和可扩展性的数据传输。
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公开(公告)号：CN110380916B
公开(公告)日：2022-05-27
申请号：CN201910793175.5
申请日：2019-08-26
Applicant: 上海航天测控通信研究所
IPC: H04L41/0663 , H04L41/0823 , H04L43/0811 , H04L43/16 , H04L45/247 , H04L45/28
Abstract: 本发明提供了一种自适应切换的以太网交叉冗余备份系统和方法，包括独立供电的主份电路和备份电路；主份电路和备份电路中均包含有冗余控制模块；主份电路还包括光纤物理通道M_A和光纤物理通道M_B；备份电路还包括光纤物理通道S_A和光纤物理通道S_B；光纤物理通道M_A、光纤物理通道S_A均与网络交换机主份连接，光纤物理通道M_B、光纤物理通道S_B均与网络交换机备份连接；冗余控制模块用于实现各个光纤物理通道的自适应切换。本发明提高了接口电路和拓扑可靠性，适于宇航等高可靠应用领域；可以在链路出现问题时进行自适应切换，提高了切换的实时性、灵活性和有效性，避免了切换过程中链路中断导致大量数据丢失。
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公开(公告)号：CN111404750A
公开(公告)日：2020-07-10
申请号：CN202010201920.5
申请日：2020-03-20
Applicant: 上海航天测控通信研究所
Abstract: 本发明公开了一种高级在轨系统集中式参数管理装置与方法，包括1553B总线控制模块、参数管理模块、出厂参数存储单元和工作参数存储单元。参数管理模块采用高可靠反熔丝FPGA芯片，实现对高级在轨系统(AOS)参数的集中式统一管理，支持通过1553B总线上注参数进行在轨更改，同时支持参数分组选择、参数恢复出厂设置等。本发明通过将高级在轨系统(AOS)各类参数进行统一管理和分发，提高了系统集成度、通用性、灵活性和可靠性；同时，通过采用出厂参数和工作参数独立存储、参数三模冗余和回写等手段，进一步增强了参数管理装置的抗单粒子翻转能力，确保了空间应用环境下参数的可靠性。
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公开(公告)号：CN113612699A
公开(公告)日：2021-11-05
申请号：CN202110883813.X
申请日：2021-08-02
Applicant: 上海航天测控通信研究所
IPC: H04L12/835 , H04L29/06
Abstract: 本发明公开了一种提高IP over CCSDS传输效率的方法，包括：在IP over CCSDS协议转换设备的网络接口处按照实时数据和延时数据对星上网络数据进行分包；将网络固存集成在IP over CCSDS协议转换设备中，并针对网络延时数据增加开辟大容量延时IP缓存；在网络固存与大容量延时IP缓存间使用LVDS接口进行匀速IP数据传输，并使用专用直连通道实时反馈当前IP缓存列队状态；网络固存根据当前IP缓存列队状态对LVDS传输速率进行快速、平滑调整。本方法基于在IP over CCSDS协议转换设备中进行网络分包和大容量固存集成，将外部延时网络数据的波动、突发传输转换为设备内部LVDS接口IP匀速传输，结合输出接口的优先级调度，既保证了关键数据传输的实时性，又大大提高了IP over CCSDS传输效率。
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Patent Agency Ranking
公开(公告)号：CN103595447A
公开(公告)日：2014-02-19
申请号：CN201310617718.0
申请日：2013-11-29
Applicant: 上海航天测控通信研究所
Abstract: 一种基于高速LVDS信号进行网络通信的设备，其包括顺序连接的核心处理器、网络接口处理器以及中继处理器；所述核心处理器完成网络层协议解帧，所述网络接口处理器完成数据链路层协议解帧，所述中继处理器完成物理层数据处理并进行接口串并联转换；所述网络接口处理器与所述中继处理器进行高速LVDS信号的传输，所述中继处理器通过两同轴电缆接口与两同轴电缆连接，通过其中的一根同轴电缆发送信号，通过另一根同轴电缆接收信号。本发明提供的同轴电缆的传输接口稳定，采用该接口的基于高速LVDS信号进行网络通信的设备可以实现采用2根高速同轴电缆进行千兆以太网通信。
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公开(公告)号：CN111404750B
公开(公告)日：2022-11-01
申请号：CN202010201920.5
申请日：2020-03-20
Applicant: 上海航天测控通信研究所
IPC: H04L41/0803 , H04L12/40
Abstract: 本发明公开了一种高级在轨系统集中式参数管理装置与方法，包括1553B总线控制模块、参数管理模块、出厂参数存储单元和工作参数存储单元。参数管理模块采用高可靠反熔丝FPGA芯片，实现对高级在轨系统(AOS)参数的集中式统一管理，支持通过1553B总线上注参数进行在轨更改，同时支持参数分组选择、参数恢复出厂设置等。本发明通过将高级在轨系统(AOS)各类参数进行统一管理和分发，提高了系统集成度、通用性、灵活性和可靠性；同时，通过采用出厂参数和工作参数独立存储、参数三模冗余和回写等手段，进一步增强了参数管理装置的抗单粒子翻转能力，确保了空间应用环境下参数的可靠性。
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公开(公告)号：CN112887544A
公开(公告)日：2021-06-01
申请号：CN202110086139.2
申请日：2021-01-21
Applicant: 上海航天测控通信研究所
Abstract: 本发明提供了一种适用于运载火箭的一体化无线WIFI摄像装置，包括：可见光高清图像采集单元，用于对可见光彩色图像数据进行光学采集，并对高清图像数据进行光电转换及图像预处理，再转换成BT1120图像数据；H.265编码单元，用于将所述BT1120图像数据按照H.265编码标准进行编码，得到编码数据；WIFI处理单元，用于接收所述编码数据并对码流进行WIFI协议组帧，并且通过无线信道输出，以及进行电源管理；锂离子电池单元，用于为装置供电。
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公开(公告)号：CN106851749B
公开(公告)日：2020-04-07
申请号：CN201710221987.3
申请日：2017-04-06
Applicant: 上海航天测控通信研究所
Abstract: 一种基于资源预留的中继卫星系统资源调度方法，在预设条件下进行中继卫星系统资源调度，具体包括步骤：判断待调度业务集是否为空；若否，从待调度业务集中选取优先级最高的业务，并判断选定的业务是突发业务还是常规业务；若选定的业务为突发业务，则对选定的业务进行调度，若选定的业务为常规业务，判断可用资源集占总资源集的比例是否大于预设的资源预留率，若大于，则对选定的业务进行调度，否则，对选定的业务进行降级处理，继续选取优先级最高的业务；对调度的业务进行资源匹配。通过资源预留机制，解决了突发业务快速调度的问题，可用于卫星网络中大规模的动态资源调度问题，加快了调度的响应速度，并提高了资源的有效利用率。
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公开(公告)号：CN107547162A
公开(公告)日：2018-01-05
申请号：CN201710866715.9
申请日：2017-09-22
Applicant: 上海航天测控通信研究所
Abstract: 一种抗空间单粒子翻转的并行加扰方法，包括步骤：在FPGA内部创建第一扰码表、第二扰码表和第三扰码表；根据加扰多项式采用8级移位寄存器动态生成扰码序列；将生成的扰码序列按字节同时写入第一扰码表、第二扰码表和第三扰码表的相同地址中；读取格式化数据的同时从第一扰码表读取第一扰码、从第二扰码表读取第二扰码和从第三扰码表读取第三扰码，并对第一扰码、第二扰码和第三扰码进行三取二操作获得最终扰码；将最终扰码对读取的格式化数据进行加扰操作。由于在FPGA内部创建三份相同的扰码表，并三取二操作获得最终的扰码，三份码表同一位置同时发生单粒子翻转的概率极低，从而提高了并行加扰设计的抗单粒子翻转能力与可靠性。
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