基于异构流水线的高效通用处理器执行方法及系统

    公开(公告)号:CN111008042A

    公开(公告)日:2020-04-14

    申请号:CN201911157048.2

    申请日:2019-11-22

    Inventor: 王剑

    Abstract: 本发明提出基于异构流水线的高效通用处理器执行方法及系统,包括:将通用处理器中计算部件整合为计算单元阵列,基于计算单元阵列构建顺序执行的计算流水线;并基于通用处理器中通用部件构建乱序执行的通用流水线;获取待执行指令,通用处理器中译码模块识别待执行指令属于通用指令或计算指令,若待执行指令属于通用指令,则将属于通用指令的待执行指令发送至通用流水线,得到待执行指令的执行结果,若待执行指令属于计算指令,则将属于计算指令的待执行指令发送至计算流水线,得到待执行指令的执行结果。本发明将通用处理器中计算指令和通用指令的流水线独立开来,使得两条流水线可以采用各自最高效的结构设计方法。

    产生LTEPRACH基带信号的方法及其系统

    公开(公告)号:CN101938329A

    公开(公告)日:2011-01-05

    申请号:CN201010267934.3

    申请日:2010-08-30

    Abstract: 本发明公开了产生LTE PRACH基带信号的方法及系统,方法包括:步骤1,依据LTE协议规定计算出LTE PRACH基带信号产生所需的参数;步骤2,计算前导序列的DFT序列的相位值,依次写入频域信号相位缓存中,写入NZC个相位值后执行步骤3;步骤3,依据前导格式配置不包含倒序的IFFT运算的长度为NIFFT,组数为a,进行a次不包含倒序的NIFFT点的IFFT运算;步骤4,从基带信号缓存中读取数据发送循环前缀和全部的序列部分,完成后将频域信号相位缓存和基带信号缓存清零。本发明能够降低LTE PRACH基带信号产生过程中高点数IDFT所需的复数乘法与复数加法次数。

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