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公开(公告)号:CN108764466B
公开(公告)日:2022-02-11
申请号:CN201810187619.6
申请日:2018-03-07
Applicant: 东南大学
Abstract: 本发明公开了一种基于现场可编程门阵列的卷积神经网络硬件及其加速方法,现场可编程门阵列平台包括软件部分以及硬件部分。其中软件部分负责Off‑Chip memory的读写以及bit stream的加载控制,硬件部分负责卷积神经网络的加速处理,包括以下步骤:根据卷积神经网络的各层配置数据的不同,由软件部分控制加载不同的配置数据对现场可编程门阵列进行实时重构;根据卷积神经网络计算中的内存的读写需求,搭建软硬件协作系统;根据卷积神经网络的特点,对数据进行并行分批次处理,加速计算进行。该发明能够在现场可编程门阵列的硬件资源基础上搭建出符合卷积神经网络结构特点的硬件处理单元,相比于通用处理器具有低功耗、高性能的特点。
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公开(公告)号:CN113604345A
公开(公告)日:2021-11-05
申请号:CN202110923970.9
申请日:2021-08-12
Applicant: 东南大学
Abstract: 本发明公开了基于磁镊系统中纳米孔检测芯片的便携式装夹装置,包括左上液池、左下液池、C型装载台、紧定螺钉、橡胶垫圈和右液池,通过胶水将左下液池和右液池紧密连接固定,右液池作为与左下液池相通的溶液存储容器。将氮化硅芯片放入有橡皮垫圈的左下液池和左上液池之间。同时将装配好的液池放置在C型装载台上,使得左上液池和左下液池侧面紧贴C型装载台侧面。位于芯片和上、下液池之间的橡胶垫圈保证芯片与左上液池和左下液池之间的密封连接,通过旋转位于C型装载台上端的四个紧定螺钉,紧定左上液池和左下液池,保证左上液池和左下液池紧密贴合。本发明利用组合可拆装式液池设计,能够方便快捷、准确高效地实现液池与芯片连接时的定位与夹紧,从而快速更换所需芯片且不会损坏芯片。
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公开(公告)号:CN113336520A
公开(公告)日:2021-09-03
申请号:CN202110110141.9
申请日:2021-01-27
Applicant: 京沪高速铁路股份有限公司 , 东南大学 , 中国国家铁路集团有限公司
IPC: C04B28/34 , E01B37/00 , C04B12/02 , C04B111/72
Abstract: 本发明公开了一种高铁砼基层修补材料及其修补方法,属于建筑修补材料及修补方法技术领域,修补材料由磷酸铵镁水泥、添加剂、矿物掺合料、骨料和纤维在水环境下复合搅拌而成,本发明的修补材料具有以下优点:具有高早期和高强特性,可实现在高铁窗口期内的快速修补;粘结力强和线膨胀系数接近;具有良好的耐久性,可克服有机修补材料易老化、使用寿命短的缺陷;克服水泥基材料脆性破坏的缺陷;修补方法采用纳米渗透型材料可对劣化混凝土基层密封和补强,克服了其他修补材料无法改善基层混凝土性能的缺陷,且使基层和修补层的粘结力增强;采用独立包装适应窗口期时间短的需求,高效完成高铁砼基层的修补,适合大面积推广。
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公开(公告)号:CN107729774B
公开(公告)日:2021-02-19
申请号:CN201710953022.3
申请日:2017-10-13
Applicant: 东南大学
Abstract: 本发明公开了一种基于反馈延时差调整的高稳定APUF电路,包括:PUF延时链模块、正跳变信号加载模块、反馈控制模块、计数器模块、仲裁器,通过将PUF延时链模块输出的正跳变信号反馈重新施加给PUF延时链模块,扩大上下两条路径中的正跳变信号到达仲裁器的时序差别,以克服仲裁器的亚稳态,使仲裁器稳定地输出0或1,从而提高APUF的稳定性。本发明提出的高稳定APUF电路具有高稳定性、实现简单、资源消耗少等特点。
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公开(公告)号:CN107682311B
公开(公告)日:2020-03-31
申请号:CN201710733565.4
申请日:2017-08-24
Applicant: 东南大学
IPC: H04L29/06 , G06F16/953
Abstract: 本发明公开了一种硬件实现的多链接TCP数据重组系统,包括TCP报头载荷分离模块,用于提取数据包中相关信息,并完成数据报头与载荷的分开存储;HASH链表模块,根据相关的报头信息完成HASH链表的添加、查找、删除操作,生成链接号,对数据包进行多链接管理;TCP数据重组管理模块,根据报头信息和链接号通过通道缓存技术和通道移位技术完成乱序数据包的重组管理;大容量外部存储器控制模块,用于完成载荷数据的顺序的拼接存储。本发明采用硬件方式实现多链接环境下TCP数据重组,能够获得比现有软件实现方式更高的网络传输速率和带宽利用率。
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公开(公告)号:CN110084739A
公开(公告)日:2019-08-02
申请号:CN201910241645.7
申请日:2019-03-28
Applicant: 东南大学
Abstract: 本发明公开了一种基于CNN的画质增强算法的FPGA并行加速系统,包括:中央处理器、DMA控制器、总线模块、加速器IP核模块、片上存储器BRAM、片外存储器SDRAM;所述中央处理器对训练完成的卷积神经网络模型的权值数据进行定点量化,得到量化完成的权值数据并存储在片外的SRDAM中;DMA控制器将预先存储在片外SDRAM的权值数据和待处理的视频图像数据搬运至片上存储器BRAM进行分块存储;加速器IP核模块采用乘法器并行优化和维度变换、流水线化的行缓存和共享padding设计优化操作,由中央处理器进行启动并从BRAM中取得数据进行网络的正向计算,计算得到的图片搬运至片外SDRAM。本发明功耗大幅降低,实现了FPGA资源利用和运算效率的平衡,能够满足实际嵌入式场景下的视频图像应用需求。
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公开(公告)号:CN110077495A
公开(公告)日:2019-08-02
申请号:CN201910328762.7
申请日:2019-04-23
Applicant: 东南大学
Abstract: 本发明公开了一种单车解锁方法、电子锁及解锁控制系统,涉及共享交通工具技术领域,一种单车解锁方法,包括步骤:用户在移动终端设备录入个人身份信息;带有电子锁的单车端采集用户信息,用户身份有效的情况下执行解锁操作;后台服务器负责移动终端和单车端间通信,用以存储和验证用户身份信息。利用本发明,能够实现单车的智能解锁,操作方便快捷且安全,从而提升了用户体验。
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公开(公告)号:CN109945873A
公开(公告)日:2019-06-28
申请号:CN201910270314.6
申请日:2019-04-04
Applicant: 东南大学
IPC: G01C21/20
Abstract: 本发明公开一种用于室内移动机器人运动控制的混合路径规划方法,属于机器人技术领域,其结合了静态环境的全局路径规划方法和动态环境的局部路径规划方法。本发明通过外部传感器为系统提供外部环境信息输入,由此建立栅格模型;本发明提出并行Bi-directional A-star算法与改进人工势场Artificial Potential Field算法融合的混合路径规划方法,通过并行Bi-directional A-star算法进行全局、静态路径搜索,通过改进APF算法进行局部、动态路径搜索。最后由以上混合方法得到的路径数据控制机器人的运动。本发明采用的混合路径规划方法对室内环境具有更强的适应能力,并且本发明所采用的一系列措施和优化方法所得到的路径具有很强的完备性和较好的最优性。
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公开(公告)号:CN109299622A
公开(公告)日:2019-02-01
申请号:CN201811009811.2
申请日:2018-08-31
Applicant: 东南大学
IPC: G06F21/73
Abstract: 本发明公开了一种基于Raspberry Pi B+的DRAM PUF测试系统,包括DRAM、CPU端和GPU端,CPU端包括UART数据获取模块和Mailbox数据发送模块,GPU端包括Mailbox数据接收模块、DRAM初始化模块、DRAM刷新控制模块、CPU代码手动刷新模块和DRAM内容读取模块;本发明还公开了一种基于Raspberry Pi B+的DRAM PUF测试系统的DRAM PUF提取方法,本发明可以用于在任意Raspberry Pi B+设备上测试DRAM PUF数据,并且用户能够通过串口打印数据,生成文件便于分析;在启动阶段以及运行阶段均可以进行DRAM PUF的提取,尤其在运行阶段,在DRAM停止刷新的情况下,能够通过手动刷新保证原有运行代码的不丢失,进行正常的DRAM PUF测试流程,通过串口打印最终结果。
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公开(公告)号:CN106484366B
公开(公告)日:2018-12-14
申请号:CN201610899987.4
申请日:2016-10-17
Applicant: 东南大学
IPC: G06F7/72
Abstract: 本发明公开了椭圆曲线加密算法领域的一种利用串并结合方式实现的模乘运算器。本发明所述的二元域位宽可变的模乘运算器包括部分积乘法单元、字级乘法单元、输出缓存单元、数据移位单元以及控制单元。本发明基于二元域下的多项式基,采用MSB‑first方式读取输入数据,利用状态机,根据计算的位数控制循环计算的步数,在每一步中并行的进行字乘和部分乘的运算,最后再将所有步骤的计算结果整合进行串行的输出。通过串并结合的方式提高运算速度,降低计算复杂性。同时,本发明在内部设计了一种可以兼容多种位宽的数据进行计算的比特乘法器,实现对硬件结构的重复利用,使得本发明在面积、灵活性等方面相较现有技术更具优势,同时保证了有较高的运算速度。
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