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公开(公告)号：CN117251393B
公开(公告)日：2024-04-12
申请号：CN202311539242.3
申请日：2023-11-17
Applicant: 北京智芯微电子科技有限公司 , 国网山西省电力公司信息通信分公司 , 国家电网有限公司
Abstract: 本申请公开一种处理器的中断响应方法、中断响应装置、芯片、计算机设备和非易失性计算机可读存储介质。处理器的中断响应方法包括根据当前中断的中断号获取当前中断的入口地址，并取出入口地址的第一条指令，执行第一条指令时流经多级流水；从响应当前中断到执行第一条指令时流经的目标级流水之前，保持全局中断使能开启，以响应目标中断，目标级流水为多级流水中的任一级，目标中断的中断优先级高于当前中断的中断优先级。根据当前中断的中断号获取入口地址，执行入口地址中的第一条指令，在响应当前中断到第一指令执行时对应的流水线最后一个阶段之前，通过将全局中断使能打开，将等待的高优先级中断进行响应，能够及时对高优先级中断进行响应。
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公开(公告)号：CN117632411A
公开(公告)日：2024-03-01
申请号：CN202311513955.2
申请日：2023-11-14
Applicant: 北京智芯微电子科技有限公司 , 国网山西省电力公司信息通信分公司 , 国家电网有限公司
IPC: G06F9/48
Abstract: 本发明实施例提供一种中断处理程序的处理方法、中断控制方法及处理器，属于芯片领域。所述方法包括：生成第一指令和第二指令，其中所述第一指令被配置为指示是否进行硬件自动保存中断上下文，且所述第二指令被配置为指示是否进行硬件自动恢复中断上下文；以及将所述第一指令放置在指定中断处理程序的入口处，且将所述第二指令放置在所述指定中断处理程序的结尾处。本发明实施例改进了默认中断处理程序，能够使普通向量中断的处理过程和例如任务切换中断的处理过程分开。
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公开(公告)号：CN116107641A
公开(公告)日：2023-05-12
申请号：CN202310181347.X
申请日：2023-02-27
Applicant: 北京智芯微电子科技有限公司 , 国网江苏省电力有限公司信息通信分公司 , 国家电网有限公司
IPC: G06F9/38
Abstract: 本发明公开了一种指令存储系统、方法、装置、计算机设备及可读存储介质，所述指令存储系统包括暂存模块，用于在回填处理模块获得指令缓存模块的访问权限的情况下，存储所述回填处理模块发送的指令数据，以向所述取指流水线提供目标指令。由此通过增加暂存模块，用于暂存回填处理模块回填至指令缓存模块中的数据，并为取指流水线提供需要的数据，在不引起流水线停顿的前提下有效提高回填处理模块回填的速度。
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公开(公告)号：CN118331493A
公开(公告)日：2024-07-12
申请号：CN202410433380.1
申请日：2024-04-11
Applicant: 北京智芯微电子科技有限公司 , 清华大学
Abstract: 本发明提供一种缓冲存储器数据同步方法、装置和电子设备，属于电子技术领域，数据同步方法包括：获取访问请求对应的目标数据在可见阵列的缓存单元状态变化以及在隐藏阵列中的缓存单元状态；基于访问请求的请求类型、目标数据在可见阵列的缓存单元状态变化和目标数据在隐藏阵列中的缓存单元状态，确定可见阵列和隐藏阵列之间的数据同步策略；其中，可见阵列表征所述访问请求当前使用的存储阵列；隐藏阵列表征所述访问请求当前未使用的另一个存储阵列。本发明用以解决第一存储阵列和第二存储阵列可以在不同的时间点使用相同的数据，完全隔绝两个缓存路径可能带来数据不一致的缺陷。此外，该发明也不会产生新的时间侧信道，保证了数据安全。
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公开(公告)号：CN119718421A
公开(公告)日：2025-03-28
申请号：CN202411592713.1
申请日：2024-11-08
Applicant: 北京智芯微电子科技有限公司 , 国网山西省电力公司信息通信分公司
IPC: G06F9/30
Abstract: 本发明公开了一种基于RISC‑V向量扩展的字节序交换方法和交换装置、芯片，所述方法包括：确定RISC‑V向量扩展的源向量寄存器和目的向量寄存器，将待转换数据加载到源向量寄存器中；加载RISC‑V向量扩展的新增向量指令，新增向量指令用于实现字节序的交换操作；采用新增向量指令对源向量寄存器中待转换数据进行字节序的交换操作，并将交换操作后的数据存储至目的向量寄存器。本发明的字节序交换方法，能够减少指令执行的次数，提高转化的效率。
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Patent Agency Ranking
公开(公告)号：CN119292673A
公开(公告)日：2025-01-10
申请号：CN202411229524.8
申请日：2024-09-03
Applicant: 北京智芯微电子科技有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心)
Abstract: 本发明公开了一种分支预测攻击的防范方法、装置、芯片和介质，所述方法包括：确定目标分支指令所属程序的程序类别；若程序类别为安全受信程序，则确定分支预测器的配置情况；根据分支预测器的配置情况确定存在第一预设分支预测器和第二预设分支预测器时，利用第二预设分支预测器对目标分支指令进行预测；根据分支预测器的配置情况确定存在第一预设分支预测器时，确定第一预设分支预测器预测目标分支指令的使能状态，并根据使能状态，对目标分支指令进行处理；其中，第一预设分支预测器用于对非安全受信程序的分支指令进行预测。采用该方法能够在硬件和软件上降低分支预测的风险，保证了分支预测的安全性，降低了敏感信息泄露的概率。
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公开(公告)号：CN116522967A
公开(公告)日：2023-08-01
申请号：CN202310316246.9
申请日：2023-03-28
Applicant: 北京智芯微电子科技有限公司 , 北京航空航天大学
Abstract: 本发明涉及芯片技术领域，公开一种乘法器与芯片。所述乘法器包括：存储阵列，用于存储权重矩阵；输入模块，用于按多个周期依次输入一向量中的每个元素中的多个数据块；编码器，用于对每个周期输入的每个数据块进行编码，以获得每个元素在每个周期内的编码数据；部分积生成模块，用于将编码数据与权重矩阵相乘，以得到每个周期内的多组部分积；加法模块，用于将每个周期内的每组部分积相加，以得到每个周期内的每组部分积的总和；以及累加器，用于将每组部分积的总和进行移位相加，由此实现了数字存算一体电路，消除存储器与处理器之间的数据搬移，极大地提高能效与算力。
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公开(公告)号：CN116702224A
公开(公告)日：2023-09-05
申请号：CN202310491843.5
申请日：2023-05-04
Applicant: 北京智芯微电子科技有限公司 , 西北工业大学
Abstract: 本说明书涉及一种密码核的安全验证方法、装置、电子设备及存储介质。其中，安全验证方法包括：以密码核的执行逻辑为参考，基于信息流模型库中的目标基础模型生成密码核对应的目标信息流模型；其中，密码核对应有逻辑函数，逻辑函数包括运算单元，目标基础模型用于描述在执行运算单元时对电路信号的运算过程；目标信息流模型用于描述在执行密码核时对电路信号的运算过程；针对密码核需要验证的安全属性构建对应的安全属性断言；其中，安全属性断言用于加入目标信息流模型中；通过执行加入安全属性断言后的目标信息流模型，对密码核进行安全验证。本说明书实施例能够基于信息流分析的方式，处理RTL级代码，具有更高的验证效率和验证精度。
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公开(公告)号：CN116700671A
公开(公告)日：2023-09-05
申请号：CN202310744910.X
申请日：2023-06-21
Applicant: 北京智芯微电子科技有限公司 , 北京航空航天大学
IPC: G06F7/523
Abstract: 本申请提供了一种存算一体芯片及数据处理方法，涉及芯片设计技术领域。存算一体芯片中的预处理装置能够将输入的浮点数的尾数划分为多个第一尾数组，存算一体阵列继而能够直接确定各个第一尾数组与多个第二尾数组中每个第二尾数组的初始乘积。然后，求和装置能够对多个初始乘积进行对齐处理得到多个目标乘积，并确定多个目标乘积的和值，从而得到浮点数的尾数的乘积。由此可见，本申请提供的存算一体芯片能够直接确定第一尾数组与第二尾数组的初始乘积，继而将对齐后的多个初始乘积(即目标乘积)累加，得到浮点数的尾数的乘积，因此该存算一体芯片确定浮点数的尾数的乘积的效率较高。
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公开(公告)号：CN119473707A
公开(公告)日：2025-02-18
申请号：CN202411243693.7
申请日：2024-09-05
Applicant: 北京智芯微电子科技有限公司 , 西北工业大学
Abstract: 本申请公开了一种处理器的故障处理方法、芯片、故障处理装置、容错系统、电子设备及存储介质。故障处理方法包括：在由第一时段切换至第二时段的第一时刻，获取处理器在第一时段内对存储器执行的第一访问请求，处理器在第一时段内处于第一状态，处理器在第二时段内处于第二状态；确定第一访问请求执行读取请求和写入请求的先后顺序；在第一访问请求先执行读取请求后执行写入请求的情况下，读取第一数据，以使处理器再次执行第一访问请求的读取请求，第一数据为处理器第一时段内读取的数据。故障处理方法在确定处理器存在读后写访存冲突的风险较高的情况下，处理器可以读取第一数据，解决了在处理器出现的读后写访存冲突的技术问题。
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