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公开(公告)号：CN106991201B
公开(公告)日：2020-08-28
申请号：CN201610038229.3
申请日：2016-01-20
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: G06F30/20
Abstract: 本发明提供一种SOI MOSFET总剂量模型参数确定方法，包括如下步骤：S1：获取SOI MOSFET在不同剂量辐照下开、关两种工作状态下的转移特性数据与传输特性数据；S2：筛选步骤S1得到的数据，并导入测试数据到参数提取软件；S3：提取上边角等效晶体管参数及场氧侧壁等效晶体管参数；S4：导出总剂量集约模型卡文件；S5：导入各个单点的总剂量模型到所述参数提取软件，生成全区域的总剂量Bin模型卡文件。本发明采用了与主晶体管分立的方式进行参数提取，细化了物理模型中各个区域的敏感参数，提高了参数拟合的准确度，可以准确地拟合出SOI MOSFET受总剂量辐射效应影响时在亚阈值区产生的hump效应，模型以Bin模型卡的形式存在，可以仿真全区域尺寸器件总剂量效应。
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公开(公告)号：CN105895703B
公开(公告)日：2019-09-13
申请号：CN201610237275.6
申请日：2016-04-15
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L29/78 , H01L21/336
Abstract: 本发明提供一种N型动态阈值晶体管、制备方法及提高工作电压的方法，该N型动态阈值晶体管至少包括：衬底结构，位于所述衬底结构上的n个阈值可调结构；所述阈值可调结构至少包含两个NMOS管和两个二极管，两个NMOS管共用体区，所述体区为N型重掺杂区；两个二极管共用N区，并以两个NMOS管共用的体区作为N区；所述第一二极管的N区与所述第一NMOS管的栅连接，所述第二二极管的N区与所述第二NMOS管的栅连接。本发明通过在两个NMOS管的栅体连接通路上各形成一个反偏PN结，来提升体区电压、降低阈值电压、提高驱动电流，实现工作电压的提高，扩展了N型动态阈值晶体管在低功耗电路设计领域的应用价值。
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公开(公告)号：CN105845733A
公开(公告)日：2016-08-10
申请号：CN201610236397.3
申请日：2016-04-15
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L29/78 , H01L21/336
Abstract: 本发明提供一种P型动态阈值晶体管、制备方法及提高工作电压的方法，包括衬底结构，PMOS器件及PN结器件；PN结器件的N区与PMOS器件的体接触区连接，PN结器件的P区与PMOS器件的栅连接。在N型本征区中进行两次P型重掺杂分别形成PMOS器件的源、漏区和PN结器件，再进行N型重掺杂形成PMOS器件的体接触区；在沟道区上方依次形成栅氧化层、多晶硅层，对多晶硅层进行P型重掺杂形成栅；通过通孔和金属将PMOS器件的栅和PN结器件的P区相连。本发明通过在栅体连接通路上形成一个反偏PN结，来提升体接触区电压、降低阈值电压、提高驱动电流，实现工作电压的提高，扩展了P型动态阈值晶体管在低功耗电路设计领域的应用价值。
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公开(公告)号：CN104716191A
公开(公告)日：2015-06-17
申请号：CN201510131999.8
申请日：2015-03-24
Applicant: 中国科学院上海微系统与信息技术研究所
CPC classification number: H01L29/7831 , H01L29/66045
Abstract: 本发明提供一种双栅双极石墨烯场效应晶体管及其制作方法，包括：提供半导体衬底； 在半导体衬底的正面形成石墨烯沟道层；在石墨烯沟道层上形成源电极及漏电极；去除源电极及漏电极外围的石墨烯沟道层；对石墨烯沟道层进行表面功能化处理或等离子体物理吸附；形成高k栅介质层；在源电极及漏电极之间的高k栅介质层上形成第一栅电极；在半导体衬底的背面形成第二栅电极。直接将石墨烯附着于所需的衬底上，无需进行繁琐的转移，避免了对石墨烯结构造成破坏和杂质污染；该方法制备的双栅双极石墨烯场效应晶体管具备更加优异的开断性能，更高的载流子迁移率以及更小的栅漏电流；工艺流程简单，成本经济，适合基于石墨烯场效应晶体管的大规模生产。
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公开(公告)号：CN102800589B
公开(公告)日：2014-10-08
申请号：CN201210304134.3
申请日：2012-08-24
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L21/331 , H01L21/266 , H01L29/737
CPC classification number: H01L29/7378 , H01L29/66242
Abstract: 本发明提供一种基于SOI的SiGe-HBT晶体管的制备方法，该方法通过在所述外基区注入杂质由硼改为氟化硼，并将注入能量和剂量限定在特定范围内，有效解决了薄膜SOI上（小于等于150nm）的SiGe-HBT器件的集电极电阻大幅增加和最高截止频率Ft参数明显降低的问题。同时，相对于增大集电区注入剂量和掺杂浓度的其它方法，该方法避免了集电区掺杂浓度增加导致的器件耐压降低。此外，该制备工艺简单，易于实现。
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Patent Agency Ranking
公开(公告)号：CN103094178A
公开(公告)日：2013-05-08
申请号：CN201310015290.2
申请日：2013-01-16
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L21/762 , H01L27/12
Abstract: 本发明提供一种提高部分耗尽型SOI器件射频性能的制备方法。根据本发明的方法，先在绝缘体上材料结构上形成至少一个器件的源区、栅区、及漏区；随后，对所述源区再进行掺杂使所述源区的部分区域为N型、部分区域为P型；最后再在进行了再掺杂的绝缘体上材料结构上再制备电极层以形成SOI器件。由于所制作的结构在源区存在重掺杂的P+区，源区N+区与P+区形成二级管结构，有效释放器件体区的空穴，使得体区电势与源区相等，因此器件的阈值电压不再漂移，从而提高器件的射频性能；此外，相对于业界普遍采用的TB结构，本发明的器件也不需要额外增加器件面积。
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公开(公告)号：CN102800590A
公开(公告)日：2012-11-28
申请号：CN201210304149.X
申请日：2012-08-24
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L21/331 , H01L21/266 , H01L29/737
CPC classification number: H01L29/7378 , H01L29/66242
Abstract: 本发明提出了一种基于SOI的SiGe-HBT晶体管的制备方法，该制备方法通过在基于SOI的SiGe-HBT工艺流程中增加使用一个特定的光刻版，将外基区注入限定在指定的区域，有效解决了薄膜SOI上（小于等于150nm）的SiGeBJT器件的集电极电阻大幅增加和最高截止频率Ft参数明显降低的问题。同时，相对于增大集电区注入剂量和掺杂浓度的其它方法，该方法避免了集电区掺杂浓度增加导致的器件耐压降低。此外，该制备工艺简单，易于实现。
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公开(公告)号：CN102800589A
公开(公告)日：2012-11-28
申请号：CN201210304134.3
申请日：2012-08-24
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L21/331 , H01L21/266 , H01L29/737
CPC classification number: H01L29/7378 , H01L29/66242
Abstract: 本发明提供一种基于SOI的SiGe-HBT晶体管的制备方法，该方法通过在所述外基区注入杂质由硼改为氟化硼，并将注入能量和剂量限定在特定范围内，有效解决了薄膜SOI上（小于等于150nm）的SiGe-HBT器件的集电极电阻大幅增加和最高截止频率Ft参数明显降低的问题。同时，相对于增大集电区注入剂量和掺杂浓度的其它方法，该方法避免了集电区掺杂浓度增加导致的器件耐压降低。此外，该制备工艺简单，易于实现。
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公开(公告)号：CN102779837A
公开(公告)日：2012-11-14
申请号：CN201210289657.5
申请日：2012-08-15
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L29/08 , H01L27/11 , H01L21/8244 , G11C11/413
CPC classification number: H01L27/1104 , G11C11/412 , H01L29/66659 , H01L29/7835
Abstract: 本发明提供一种六晶体管静态随机存储器单元及其制作方法，属于存储器设计及制造技术领域，所述存储器单元包括两个反相器及传输门，所述反相器由一结构对称的NMOS晶体管及结构对称的PMOS晶体管互连组成，所述传输门由两个源漏结构非对称的NMOS晶体管组成，所述源漏结构非对称NMOS晶体管的源极结构具有袋区及浅掺杂延伸区，而漏极结构不具有袋区及浅掺杂延伸区。本发明采用了具有非对称结构的传输门N型晶体管，通过去掉漏极的浅掺杂延伸区（LDD）和袋区（Pocket）引入的非对称，不改变器件加工工艺，不额外增加版图，不破坏器件使用寿命，且由此引起的电学非对称性明显优于现有的结构。本发明工艺简单，有利于降低成本，适用于工业生产。
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公开(公告)号：CN105870186B
公开(公告)日：2019-09-13
申请号：CN201610237267.1
申请日：2016-04-15
Applicant: 中国科学院上海微系统与信息技术研究所
IPC: H01L29/78 , H01L21/336
Abstract: 本发明提供一种P型动态阈值晶体管、制备方法及提高工作电压的方法，所述P型动态阈值晶体管至少包括：衬底结构，PMOS器件及PN结器件；PN结器件的N区与PMOS器件的体区连接，PN结器件的P区与PMOS器件的栅连接。在N型本征区中进行P型重掺杂分别形成PMOS器件的源、漏区和体区，同时形成PN结器件；在沟道区上方依次形成栅氧化层、多晶硅层，对多晶硅层进行P型重掺杂形成栅；通过通孔和金属将PMOS器件的栅和PN结器件的P区相连。本发明通过在栅体连接通路上形成一个反偏PN结，来提升体区电压、降低阈值电压、提高驱动电流，实现工作电压的提高，扩展了P型动态阈值晶体管在低功耗电路设计领域的应用价值。
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