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公开(公告)号：CN118467311A
公开(公告)日：2024-08-09
申请号：CN202410444363.8
申请日：2024-04-12
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F11/34
Abstract: 本发明公开了一种服务器能效测试方法、装置、设备及介质，涉及服务器测试技术领域。该方法中，通过神经网络模型预测待测服务器的在当前配置时的能效值，大大减少了测试的时长，提高了测试效率；将样本服务器中的非数值类的配置参数转换为数值类的配置参数，使得非数值类的配置参数可以作为神经网络模型的训练数据，且转换时，直接依据样本服务器中的非数值类的配置参数转换为数值类的配置参数的转换规则进行转换，使得待测服务器中的非数值类的配置参数能够输入至神经网络模型中，提高了神经网络模型预测的能效值的准确性；根据中央处理器的架构类型和服务器的类型建立了多种类型的神经网络模型，实现了对各种类型的服务器能效值的较准确地预测。
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公开(公告)号：CN118113446A
公开(公告)日：2024-05-31
申请号：CN202410537427.9
申请日：2024-04-30
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本申请公开了一种中断处理方法、装置及设备、存储介质和计算机程序产品，涉及计算机技术领域，该方法应用于网卡，包括：当目标事件需要上报至处理器时，将所述目标事件的事件信息存储至目标事件队列中；判断所述目标事件队列的中断控制信号是否为有效；若是，则以中断的方式将所述目标事件队列中的事件上报至所述目标事件队列对应的处理器核心，并将所述中断控制信号设置为无效；其中，当所述处理器核心处理完成上报的事件之后，将所述中断控制信号设置为有效。本申请避免了中断上报对处理器核心性能的影响。
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公开(公告)号：CN117234977A
公开(公告)日：2023-12-15
申请号：CN202311490238.2
申请日：2023-11-10
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F13/38
Abstract: 本发明公开了一种数据处理方法、系统、设备及计算机可读存储介质，涉及数据传输领域，为解决非标准的数据封装格式产生的非标准数据流不能与用户逻辑适配的问题，该数据处理方法包括：当接收到实时数据，确定实时数据的当前数据流封装格式；数据流封装格式包括满足目标传输协议要求的标准数据流封装格式；判断是否存储器中未存储待传输数据且当前数据流封装格式为标准数据流封装格式；若是，将实时数据作为当前传输数据输出；若否，将实时数据写入存储器，基于待传输数据和/或实时数据得到标准数据流封装格式的当前传输数据并输出。本发明能够将非标准数据流转换为标准数据流，以适配后端的用户逻辑设备。
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公开(公告)号：CN116737618B
公开(公告)日：2023-11-14
申请号：CN202311013808.9
申请日：2023-08-14
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本发明在计算机应用技术领域，公开了一种FPGA架构、器件、数据处理方法、系统及存储介质。在本发明提供的FPGA架构中，划分静态区和动态区，可实现动静分离，基于映射表，又可将静态区中的虚拟功能与动态区的算法模块实现动态结合。虚拟功能的特定访问接口和通用访问接口可以实现与外部主机相对接，基于映射表，可以确定虚拟功能与算法模块的映射关系，因而，基于该FPGA架构可以在算法模块与虚拟功能松耦合即动态结合的情况下，实现VF功能。本发明所提供的FPGA器件、数据处理方法、系统及可读存储介质具有上述技术效果。
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公开(公告)号：CN116069711B
公开(公告)日：2023-07-14
申请号：CN202310362884.4
申请日：2023-04-07
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本申请公开了一种直接内存访问控制器、异构设备、内存访问方法及介质，涉及内存访问技术领域。该直接内存访问控制器包括：多个读描述符管理模块、多个写描述符管理模块、读数据搬移器和写数据搬移器；一个读描述符管理模块/写描述符管理模块对应一个物理功能/虚拟功能的管理通道；读描述符管理模块用于将描述符寄存器中内容转换为读描述符，将读描述符数据转换为读描述符；写描述符管理模块用于将写描述符数据转换为写描述符；读数据搬移器用于根据读描述符向上位机发送读请求，接收读请求对应的第一数据并进行数据处理；写数据搬移器用于根据写描述符读取对应的第二数据，基于第二数据生成写请求发送给上位机。能支持单根I/O虚拟化。
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Patent Agency Ranking
公开(公告)号：CN111736867A
公开(公告)日：2020-10-02
申请号：CN202010506249.5
申请日：2020-06-05
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F8/65
Abstract: 本申请公开了一种FPGA更新设备、方法以及存储介质。FPGA更新设备包括控制芯片以及逻辑运算芯片，逻辑运算芯片通过协议转换接口以及指令接口分别与控制芯片连接，在此基础上，逻辑运算芯片通过指令接口接收控制芯片传入的FPGA更新指令，并利用协议转换接口接收基于初始传输协议传入的FPGA固件，进而根据FPGA更新指令控制协议转换接口将FPGA固件以目标传输协议传输至FPGA的配置接口，以此实现了对FPGA的更新。此外，本申请还提供一种FPGA更新方法以及存储介质，有益效果同上所述。
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公开(公告)号：CN120011292A
公开(公告)日：2025-05-16
申请号：CN202510488868.9
申请日：2025-04-18
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F13/42
Abstract: 本申请公开了一种直接内存访问控制器、方法、计算机程序产品及电子设备，涉及内存访问技术领域，包括：拆分模块、转化模块、互联模块以及数据搬移管理模块；拆分模块被配置为接收请求包，将第一请求包分发至转化模块，将第二请求包分发至数据搬移管理模块，以及输出完成包；转化模块被配置为根据第一请求包通过互联模块读写本地存储；数据搬移管理模块被配置为根据第二请求包获取描述符，根据描述符生成并输出请求包，接收完成包，以及通过互联模块读写本地存储。通过上述各模块可以实现直接内存访问控制器支持P2P，解决了直接内存访问控制器不支持P2P的问题，能够降低数据传输延迟与额外的开销，实现高速的数据传输，提升系统整体的性能。
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公开(公告)号：CN119766709A
公开(公告)日：2025-04-04
申请号：CN202510252588.8
申请日：2025-03-05
Applicant: 浪潮电子信息产业股份有限公司
IPC: H04L43/50 , H04L43/0894
Abstract: 本发明公开了一种回环测试方法、装置、系统、电子设备、介质及程序产品，涉及通信技术领域。部署在不支持寄存器控制收发两端的回环读写的处理器上，并测试其网络质量的回环测试装置包括数据缓存模块和读写控制逻辑模块。数据缓存模块与处理器自身的分段式接口与网络通信模块相连，其对通过网络通信模块和分段式接口收发的数据包进行缓存。读写控制逻辑模块与数据缓存模块相连，其根据数据包的包结束位置可在当数据缓存模块达到临界存储阈值条件时，保证从数据缓存模块中读写完最后一个数据包。本发明可以解决相关技术在对处理器进行MAC测试时，控制逻辑复杂的问题，能够高效简单地实现对处理器的MAC回环测试，控制逻辑简单且资源占用少。
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公开(公告)号：CN118132243B
公开(公告)日：2024-07-19
申请号：CN202410552501.4
申请日：2024-05-07
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F9/48
Abstract: 本发明公开了计算机技术领域内的一种中断信号处理方法、装置、设备、介质、电路及系统。本发明在目标设备运行过程中监测到至少两个中断信号时，利用汇聚模块存储至少两个中断信号，并对至少两个中断信号进行轮询选择，将当前轮询到的中断信号传输至中断控制器；使中断控制器根据当前轮询到的中断信号和相应状态机进行控制时序的状态跳转，以实现单一中断接口支持多中断信号的处理；并且，至少两个中断信号基于目标设备支持的中断类型和中断需求量确定，能够有效满足用户应用程序和系统应用程序的中断需求，中断设计更具灵活性，也更贴合实际需求。
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公开(公告)号：CN115800992B
公开(公告)日：2023-06-02
申请号：CN202310070901.7
申请日：2023-02-07
Applicant: 浪潮电子信息产业股份有限公司
IPC: H03K19/0175
Abstract: 本发明公开了一种握手信号的拆分电路、方法、装置、设备及存储介质，属于数字电路领域，用于对握手信号进行拆分。逻辑控制电路可以在与第二电平处理模块的配合下，在前端模块的有效信号输出端输出第一电平且自身对应的后端模块的反馈信号输出端输出第二电平时，仅控制自身对应的后端模块完成本次握手，并在前端模块完成本次握手前，向自身对应的后端模块的有效信号接收端输出与第一电平相反的电平，以防其再次接收数据，并向第一电平处理模块输出第二电平，以便第一电平处理模块在所有后端模块完成本次握手后输出第二电平，使前端模块完成本次握手，使多个后端模块可以同时/分时接收数据，提升了后端数据计算的灵活性，扩展了应用场景。
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