一种数据传输方法、系统、装置及存储介质

    公开(公告)号:CN114827234B

    公开(公告)日:2024-09-06

    申请号:CN202210466741.3

    申请日:2022-04-29

    Abstract: 本申请公开了一种数据传输方法、系统、装置及存储介质,应用于通信技术领域,该数据传输方法应用于请求端中时,包括:请求端QP装置向应答端应答器发送命令数据包;请求端应答器接收应答端QP装置发送的针对命令数据包的读请求数据包;请求端应答器解析读请求数据包,确定出待传输数据,并将确定出的待传输数据发送至应答端QP装置;请求端QP装置接收应答端应答器发送的,表示命令数据包执行完毕的命令响应数据包。应用本申请的方案,不需要建立连接过程便可以进行数据传输,因此可以大幅降低数据传输的总体延迟时间,也减少了对网卡硬件资源的需求。

    一种应用于服务器的加速卡设置方法、装置及介质

    公开(公告)号:CN114780241A

    公开(公告)日:2022-07-22

    申请号:CN202210469708.6

    申请日:2022-04-30

    Abstract: 本发明公开了一种应用于服务器的加速卡设置方法,装置及介质,适用于服务器技术领域。若确定出服务器当前所需的算力支持的数据超过服务器当前加速卡所能提供的算力支持的数据,则向加速卡资源池内申请对应的目标加速卡;将目标加速卡的IP地址发送至服务器;根据IP地址建立服务器与目标加速卡的通信连接以便目标加速卡投入服务器的算力支持服务中。当前服务器的加速卡较少,可以根据算力支持进行调用加速卡,避免现有的算力较少需要寻找算力支持较大的服务器进而迁移整个软件环境导致的维护成本高的问题。不需要改变自身软件环境,实现动态申请加速卡,节省维护成本,从而提高服务器的算力能力。

    数据处理方法、FPGA加速卡及计算机可读存储介质

    公开(公告)号:CN113867945A

    公开(公告)日:2021-12-31

    申请号:CN202111112236.0

    申请日:2021-09-18

    Abstract: 本发明提供一种数据处理方法,应用于FPGA加速卡,包括:数据包处理模块对数据发送端发送的第一数据包进行解包处理得到待处理数据,并将待处理数据发送至内核模块;内核模块对待处理数据进行运算处理得到已处理数据,并将已处理数据发送至数据包处理模块;数据包处理模块对已处理数据进行封包处理得到第二数据包,并将第二数据包发送至数据接收端;本发明在数据包处理模块和内核模块之间设置了直通的数据通路,可确保FPGA加速卡能够直接且主动地进行数据处理及发送,可避免反复读写低速缓存对多加速卡加速任务的效率损耗,提升多加速卡整体的加速性能。本发明还提供一种FPGA加速卡及计算机可读存储介质,具有上述有益效果。

    一种数据传输方法、装置、设备及存储介质

    公开(公告)号:CN113746754A

    公开(公告)日:2021-12-03

    申请号:CN202110866023.0

    申请日:2021-07-29

    Abstract: 本发明公开了一种数据传输方法、装置、设备及存储介质;在本方案中,主机设备及FPGA加速设备在向对方发送数据时,不仅仅需要发送当前待发送的数据,还需要发送历史数据,通过该方式,可以使得主机设备和FPGA加速设备在传输数据时,就算出现超时和丢包现象,也可以从后续发送的命令组及命令反馈组中的历史命令及历史命令反馈中获取相关数据,避免重新获取,提高数据传输效率。

    显卡通信方法、装置、显卡设备、主机设备、系统及介质

    公开(公告)号:CN117251406A

    公开(公告)日:2023-12-19

    申请号:CN202311279144.0

    申请日:2023-09-28

    Abstract: 本发明提供显卡通信方法、装置、显卡设备、主机设备、系统及介质,涉及显卡间通信领域,方法应用于显卡设备,包括:在接收到主机设备下发的控制指令时,从显卡设备的存储器中读取主机设备下发的内核任务、内核任务参数及数据传输任务标志位;当确定数据传输任务标志位处于有效状态时,确定内核任务参数为数据传输参数,利用数据传输参数并经过显卡设备中的通信模块与目标显卡设备进行数据传输,或利用数据传输参数、内核任务并经过显卡设备中的通信模块与目标显卡设备进行数据传输;显卡设备可经过其设备中专属的通信模块与另一目标显卡设备进行通信,从而可降低显卡设备间通信链路的冗余程度,并可解决显卡间通信速率较慢的技术问题。

    一种网络拓扑结构获取方法、装置、设备及介质

    公开(公告)号:CN116389280A

    公开(公告)日:2023-07-04

    申请号:CN202310573372.2

    申请日:2023-05-19

    Abstract: 本发明公开了一种网络拓扑结构获取方法、装置、设备及介质,涉及分布式异构计算系统领域。各图形处理器节点专属的网络通信模块中集成的动态主机配置协议客户端从主机节点的预先存储的多个互联网协议地址中获取到了对应的图形处理器节点的互联网协议地址,并发送包含获取到的互联网协议地址的信息至主机节点,实现了各图形处理器节点在分布式计算系统的网络中的自动注册,以及通过主机节点发送的依据各动态主机配置协议客户端发送的信息建立的节点表,使得各图形处理器节点能够根据节点表确定分布式计算系统中的网络拓扑结构,不需要依赖与该图形处理器连接的中央处理器才能实现图形处理器在网络上的注册,提高了网络拓扑的灵活性和可扩展性。

    计算引擎通信方法及装置
    7.
    发明公开

    公开(公告)号:CN116028238A

    公开(公告)日:2023-04-28

    申请号:CN202211347106.X

    申请日:2022-10-31

    Abstract: 本申请公开了计算引擎通信方法及装置,应用于计算引擎通信技术领域,包括:获取主机端计算引擎发送的设备端程序数据;其中,所述设备端程序数据为对包含通信函数以及计算任务函数的程序代码编译得到的程序数据,所述通信函数为基于通信需求创建的函数;利用设备端计算引擎执行所述设备端程序数据,基于所述计算任务函数对目标数据进行计算以得到计算结果,并基于所述通信函数将所述计算结果发送至目标接收端,以实现所述设备端计算引擎与所述目标接收端中计算引擎之间的通信。能够避免主机端计算引擎分配通信任务,释放主机端计算引擎的算力,并且,适应于同一节点内不同计算引擎以及不同节点之间计算引擎的通信场景。

    数据处理方法、FPGA加速卡及计算机可读存储介质

    公开(公告)号:CN113867945B

    公开(公告)日:2025-03-21

    申请号:CN202111112236.0

    申请日:2021-09-18

    Abstract: 本发明提供一种数据处理方法,应用于FPGA加速卡,包括:数据包处理模块对数据发送端发送的第一数据包进行解包处理得到待处理数据,并将待处理数据发送至内核模块;内核模块对待处理数据进行运算处理得到已处理数据,并将已处理数据发送至数据包处理模块;数据包处理模块对已处理数据进行封包处理得到第二数据包,并将第二数据包发送至数据接收端;本发明在数据包处理模块和内核模块之间设置了直通的数据通路,可确保FPGA加速卡能够直接且主动地进行数据处理及发送,可避免反复读写低速缓存对多加速卡加速任务的效率损耗,提升多加速卡整体的加速性能。本发明还提供一种FPGA加速卡及计算机可读存储介质,具有上述有益效果。

    一种FPGA加速板卡及其行情数据处理方法

    公开(公告)号:CN114328348B

    公开(公告)日:2024-12-27

    申请号:CN202111552899.4

    申请日:2021-12-17

    Abstract: 本申请提供一种FPGA加速板卡,包括:网络接口,用于接收交易所行情数据;CAM表,用于存储证券代码和行情存储地址的映射关系;与网络接口和报文缓冲区均相连,并包含内置量化交易算法的RISC‑V处理器,用于解析交易所行情数据,得到行情信息、交易信息和包含证券代码的委托信息;当检测到交易时,根据委托信息中的委托信息记录号查询委托价格;并根据委托价格和行情存储地址计算最新市场行情信息,并输出最新市场行情信息。申请利用FPGA低延迟特性及RISC‑V开源、指令集可扩展等特性,高了金融交易行情的重构效率。本申请还提供一种行情数据处理方法,具有上述有益效果,此处不再赘述。

    现场可编程门阵列加速器集群的广播方法和系统

    公开(公告)号:CN116668217A

    公开(公告)日:2023-08-29

    申请号:CN202310721964.4

    申请日:2023-06-16

    Abstract: 本发明提供一种现场可编程门阵列加速器集群的广播方法和系统,涉及通信领域,包括:在嗅探广播阶段内,控制服务器通过所有通信链路对所有子网节点进行嗅探广播;在拓扑填充阶段内,将进行嗅探广播报文转发的两个现场可编程门阵列加速器作为相连接的现场可编程门阵列,将相连接的现场可编程门阵列加速器的信息上传至本地子网的路由器,再记录至直连链路表;在正式广播阶段内,根据广播需求向所管理的目标节点进行定向广播。本发明解决了分布式现场可编程门阵列加速器集群网络的路由链路对现场可编程门阵列加速器之间的路由链路不可知问题,避免了环形广播风暴的出现,进一步解决了网络阻塞和数据报文反复重传导致的高时延和高能耗问题。

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