一种含有N2-酰基-2-氨基咪唑环的化合物及其制备方法和应用

    公开(公告)号:CN118440006A

    公开(公告)日:2024-08-06

    申请号:CN202410490093.4

    申请日:2024-04-23

    Abstract: 本发明提供一种含有N2‑酰基‑2‑氨基咪唑环的化合物,所述含有N2‑酰基‑2‑氨基咪唑环的化合物结构式如下所示:#imgabs0#其对HepAD38细胞的毒性低,且能显著降低HepAD38细胞中HBV DNA的水平。本发明还提供上述含有N2‑酰基‑2‑氨基咪唑环的化合物的制备方法,其操作简便,收率高。本发明还提供一种药物组合物,其包含上述含有N2‑酰基‑2‑氨基咪唑环的化合物或其药学上可接受的盐。本发明进一步提供上述含有N2‑酰基‑2‑氨基咪唑环的化合物和/或上述药物组合物在制备乙肝病毒DNA抑制剂或抗乙肝病毒感染药物中的应用。

    一种采用液相色谱串联质谱直接检测血清中生长激素20kDa和22kDa的方法

    公开(公告)号:CN120009435A

    公开(公告)日:2025-05-16

    申请号:CN202510210501.0

    申请日:2025-02-25

    Abstract: 本发明公开了一种采用液相色谱串联质谱直接检测血清中生长激素20kDa和22kDa的方法。本发明采用免疫富集来进行样品前处理,结合LC‑MS/MS,对人血清中生长激素22kDa GH和20kDa GH两种亚型进行检测,无需复杂的变性酶解等过程,即可实现生长激素22kDa和20kDa两种分型的分别检测,本发明基于质谱法对质荷比的特异性选择,在离子通道上将两种分型进行特异性区分,实现互不干扰且能分别检测的目的;解决了只能检测总量无法分别检测两种亚型的问题,该检测方法检验特异性好,灵敏度高,并且整个流程时间短,通量高,能极大的节约耗材和时间成本。

    一种级联板间流水线的“蝶式”传输方法

    公开(公告)号:CN107844451B

    公开(公告)日:2020-11-20

    申请号:CN201710990297.4

    申请日:2017-10-23

    Applicant: 复旦大学

    Abstract: 本发明属于微电子技术领域,具体涉及一种级联板间流水线的“蝶式”传输方法。本发明将主机与板卡间PCIe总线的定期通信作为独立流水级的完全流水线工作模式,使分布在各块板卡上的所有用户逻辑能以紧凑的流水线方式不间断工作,显著地增加计算的粘性。总的系统吞吐率仅取决于用户逻辑的计算耗时,不受级联板卡数量增加的影响;针对完全流水线工作模式下的数据传输进一步提出了“蝶式”构型的访存方法;通过分离读/写数据通道从而充分利用板载的双DDR控制器的带宽,相比单DDR控制器提升近一倍的传输性能。本发明适用于任意用户逻辑单元及级联板卡的数量组合,以及用户逻辑单元在不同板卡上的分配方案。

    基于FPGA局部动态重构技术的异型流水线设计方法

    公开(公告)号:CN108228966A

    公开(公告)日:2018-06-29

    申请号:CN201711278509.2

    申请日:2017-12-06

    Applicant: 复旦大学

    Abstract: 本发明属于微电子技术领域,具体为一种基于FPGA局部动态重构技术的异型流水线设计方法。本发明利用FPGA局部动态重构技术,在FPGA上划分出若干个局部可重构区块,于运行时依次动态重构,通过以时间换空间的方式循环复用FPGA可编程逻辑资源,使原本无法部署在单块FPGA上的大规模应用能够完整呈现,很大程度上突破了FPGA硬件资源的限制;此外,将重构块的重构过程作为独立流水级,与用户逻辑的运算过程并行进行,显著地增加了计算的粘性。当流水线饱和时,所有的运算‑重构过程以及结果输出、数据输入的过程均处在深度流水状态,达到同等资源消耗下的最优系统吞吐率与可接受的运算延时。本发明具有很强的通用性和扩展性。

    基于FPGA局部动态重构技术的异型流水线设计方法

    公开(公告)号:CN108228966B

    公开(公告)日:2021-08-20

    申请号:CN201711278509.2

    申请日:2017-12-06

    Applicant: 复旦大学

    Abstract: 本发明属于微电子技术领域,具体为一种基于FPGA局部动态重构技术的异型流水线设计方法。本发明利用FPGA局部动态重构技术,在FPGA上划分出若干个局部可重构区块,于运行时依次动态重构,通过以时间换空间的方式循环复用FPGA可编程逻辑资源,使原本无法部署在单块FPGA上的大规模应用能够完整呈现,很大程度上突破了FPGA硬件资源的限制;此外,将重构块的重构过程作为独立流水级,与用户逻辑的运算过程并行进行,显著地增加了计算的粘性。当流水线饱和时,所有的运算‑重构过程以及结果输出、数据输入的过程均处在深度流水状态,达到同等资源消耗下的最优系统吞吐率与可接受的运算延时。本发明具有很强的通用性和扩展性。

    一种级联板间流水线的“蝶式”传输方法

    公开(公告)号:CN107844451A

    公开(公告)日:2018-03-27

    申请号:CN201710990297.4

    申请日:2017-10-23

    Applicant: 复旦大学

    CPC classification number: G06F13/4221 G06F13/102

    Abstract: 本发明属于微电子技术领域,具体涉及一种级联板间流水线的“蝶式”传输方法。本发明将主机与板卡间PCIe总线的定期通信作为独立流水级的完全流水线工作模式,使分布在各块板卡上的所有用户逻辑能以紧凑的流水线方式不间断工作,显著地增加计算的粘性。总的系统吞吐率仅取决于用户逻辑的计算耗时,不受级联板卡数量增加的影响;针对完全流水线工作模式下的数据传输进一步提出了“蝶式”构型的访存方法;通过分离读/写数据通道从而充分利用板载的双DDR控制器的带宽,相比单DDR控制器提升近一倍的传输性能。本发明适用于任意用户逻辑单元及级联板卡的数量组合,以及用户逻辑单元在不同板卡上的分配方案。

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