一种硬件描述语言增量编译方法及装置

    公开(公告)号:CN116627426A

    公开(公告)日:2023-08-22

    申请号:CN202310620173.2

    申请日:2023-05-29

    IPC分类号: G06F8/41 G06F8/71

    摘要: 本申请属于计算机技术领域,公开了一种硬件描述语言增量编译方法及装置,该方法包括:步骤S1,接收用户输入代码,将用户输入代码分别与热点代码区块和新代码区块进行对比,得到对比结果和用户输入代码中的无匹配部分;步骤S2,根据对比结果将新代码区块中的无修改部分移入热点代码区块中,将无匹配部分和热点代码区块中的修改部分移入新代码区块中;步骤S3,对新代码区块重新编译,得到增量数据库并将其合并到当前数据库。本申请能够大大减少了编译的迭代次数和仿真所需的时间,缩短模块的开发时间。

    一种硬件描述语言增量编译方法及装置

    公开(公告)号:CN116627426B

    公开(公告)日:2023-11-24

    申请号:CN202310620173.2

    申请日:2023-05-29

    IPC分类号: G06F8/41 G06F8/71

    摘要: 本申请属于计算机技术领域,公开了一种硬件描述语言增量编译方法及装置,该方法包括:步骤S1,接收用户输入代码,将用户输入代码分别与热点代码区块和新代码区块进行对比,得到对比结果和用户输入代码中的无匹配部分;步骤S2,根据对比结果将新代码区块中的无修改部分移入热点代码区块中,将无匹配部分和热点代码区块中的修改部分移入新代码区块中;步骤S3,对新代码区块重新编译,得到增量数据库并将其合并到当前数据库。本申请能够大大减少了编译的迭代次数和仿真所需的时间,缩短模块的开发时间。

    一种提升缓存带宽的方法、装置、设备及存储介质

    公开(公告)号:CN116701246B

    公开(公告)日:2024-05-07

    申请号:CN202310587200.0

    申请日:2023-05-23

    IPC分类号: G06F12/0831

    摘要: 本申请属于缓存技术领域,公开了一种提升缓存带宽的方法、装置、设备及存储介质,该方法应用于缓存微结构中,该方法包括:步骤S1,接收新请求,并获取新请求的命中情况;步骤S2,基于命中情况和新请求确定执行条件;步骤S3,将新请求与缓存微结构中的旧请求进行地址对比,得到对比结果;若对比结果满足执行条件,则执行新请求。本申请可以提高缓存的并行处理能力,使得每个请求从进入缓存到被分发到并行处理状态机中执行的延时更小、单位时间内工作的并行处理状态机的个数更多,从而提升缓存整体的带宽和吞吐量。

    一种低延迟处理缓存读取请求的方法、设备及存储介质

    公开(公告)号:CN116719760A

    公开(公告)日:2023-09-08

    申请号:CN202310545923.4

    申请日:2023-05-15

    IPC分类号: G06F13/16

    摘要: 本申请属于计算机技术领域,公开了一种低延迟处理缓存读取请求的方法、设备及存储介质,该方法包括:在检测到读取队列旁路空闲时,向处理器核发送旁路空闲信号;接收处理器核发送的读取请求;判断处理器核是否申请占用读取队列旁路;若是,则将读取请求通过读取队列旁路发送到缓存流水线,否则将读取请求发送至读取队列中。本申请能够当正在处理的读取请求数量较少时,省去读取队列仲裁请求的时间,实现了在不增加逻辑级数的情况下降低缓存处理读取请求的延迟。

    一种提升缓存带宽的方法、装置、设备及存储介质

    公开(公告)号:CN116701246A

    公开(公告)日:2023-09-05

    申请号:CN202310587200.0

    申请日:2023-05-23

    IPC分类号: G06F12/0831

    摘要: 本申请属于缓存技术领域,公开了一种提升缓存带宽的方法、装置、设备及存储介质,该方法应用于缓存微结构中,该方法包括:步骤S1,接收新请求,并获取新请求的命中情况;步骤S2,基于命中情况和新请求确定执行条件;步骤S3,将新请求与缓存微结构中的旧请求进行地址对比,得到对比结果;若对比结果满足执行条件,则执行新请求。本申请可以提高缓存的并行处理能力,使得每个请求从进入缓存到被分发到并行处理状态机中执行的延时更小、单位时间内工作的并行处理状态机的个数更多,从而提升缓存整体的带宽和吞吐量。

    一种处理器核外缓存模型及模拟方法

    公开(公告)号:CN116627857B

    公开(公告)日:2023-11-24

    申请号:CN202310602633.9

    申请日:2023-05-25

    摘要: 本申请属于处理器技术领域,公开了一种处理器核外缓存模型及模拟方法,该模型包括:请求接口模块,用于将读取请求和写入请求分别转换为读取事件和写入事件以及根据模式配置信息修改请求接口时序;数据缓存模块,用于将读取数据发送给读取处理模块以及根据模式配置信息修改数据缓存模块的容量;读取处理模块,用于基于模式配置信息和命中检测模块的读取命中结果获取读取数据;写入处理模块,用于基于模式配置信息和写入命中结果,根据写入事件或写入数据更新数据缓存模块;总线请求处理模块,用于获取读取数据和写入数据和根据模式配置信息修改总线接口时序。本申请可通用于多种

    一种二级缓存的数据检测方法、系统及计算机设备

    公开(公告)号:CN116643945A

    公开(公告)日:2023-08-25

    申请号:CN202310638726.7

    申请日:2023-05-31

    摘要: 本发明涉及计算机技术领域,尤其涉及一种二级缓存的数据检测方法、系统及计算机设备,包括:将激励产生器生成的请求打包成请求数据包后,存入与请求的类型对应的请求队列;请求包括取指请求、访问请求、存储请求和地址转换请求;监测并获取二级缓存中与请求对应的关键信息,以从请求队列中查找与关键信息具有相同请求标识的请求数据包;根据查找到的请求数据包访问内存模型,并将从内存模型中获取的数据与关键信息进行比较,若数据不一致,则报错;将经过比较后的请求数据包从请求队列中删除。本发明通过监测少量的请求关键信息实现快速有效地定位二级缓存读写数据的错误,并通过对读写请求执行顺序的检测,使其满足地址相关性要求。