双面图像识别硬币处理装置
    4.
    发明公开

    公开(公告)号:CN112150698A

    公开(公告)日:2020-12-29

    申请号:CN202011022760.4

    申请日:2020-09-25

    Abstract: 本发明公开了一种双面图像识别硬币处理装置,包括装置本体、硬币投入口、用于识别硬币的识别装置、用于分拣硬币的分拣装置、储存硬币的装置以及出币口,识别装置包括电磁识别器和图像识别器,分拣装置内设置有用于开合硬币传送通道的拉力杆挡板;储存硬币的装置包括暂存硬币的暂存部和集备用找零和循环找零为一体的备用循环找零钱箱。本发明在原有电磁识别技术基础上增加双面图像识别功能,能够兼容不同版本、不同尺寸及未来发行的新版本硬币,提高对假币的识别率;采用电磁铁拉力杆分拣技术,提高分拣速度和准确性;采用互换型钱箱,将硬币循环找零与备用找零合为一体,缩小机身的空间占比,硬币的循环使用能够减少人工成本,提高工作效率。

    轨道交通安检通行装置
    7.
    实用新型

    公开(公告)号:CN216412235U

    公开(公告)日:2022-04-29

    申请号:CN202122537523.8

    申请日:2021-10-21

    Abstract: 本实用新型公开了一种轨道交通安检通行装置,包括安检门、识别装置、隔档和摆门。其中识别装置设置于安检门的通行入口方向,隔档设置于安检门的通行出口方向,隔档与安检门的通行方向平行。摆门设置于安检门的通行出口方向,摆门的宽度与安检门的宽度相同,摆门的转轴距隔档及安检门的距离均大于等于摆门的宽度,摆门可往返运动于与隔档平行或垂直方向,安检门及摆门均与识别装置电性连接。根据上述技术方案的轨道交通安检通行装置,可以自动对未通过信息识别、通过信息识别但未通过安检和既通过信息识别也通过安检的通行者自动分流,避免因为安检问题导致人员堵塞于安检处,提高安检通行效率。

    可拼装组合式自动检票机

    公开(公告)号:CN210776813U

    公开(公告)日:2020-06-16

    申请号:CN201921033864.8

    申请日:2019-07-04

    Abstract: 本实用新型公开了一种可拼装组合式自动检票机,包括中间闸门箱体段、前箱体段和后箱体段,三个箱体段之间可拆卸连接,所述前箱体段上设置有进站刷卡面板,所述后箱体段上设置有出站刷卡回收面板。本实用新型主体结构为相对独立的三段箱体,通过拼装组合的方式来装配成自动检票机机箱,使得自动检票机在生产制造易于安排计划及提高生产装配的效率,并且当地铁闸机阵列调整时对生产计划及制造活动造成的影响极小,也有利于地铁站在线自动检票机的调整与改造;而且还可灵活拼装组合成简易版自动检票机,可补充使用临时放置在地铁车站内所需的位置。还能节省设备的投入成本,以及后续的设备维护改造费用。

    一种组合式地铁客服中心的服务终端

    公开(公告)号:CN221101413U

    公开(公告)日:2024-06-07

    申请号:CN202322893176.1

    申请日:2023-10-27

    Abstract: 本实用新型公开了一种组合式地铁客服中心的服务终端,属于轨道交通技术领域,包括中心柜体、转接柜体、侧柜体、入口门、侧围板以及半自动售票机、全功能售票机、补票机中的至少一种或组合,中心柜体供工作人员扫码打印操作,转接柜体包括设置在服务终端转角的至少一个,侧柜体供办公资料或工具存储;其中,中心柜体、转接柜体、侧柜体、入口门、侧围板与所选用功能机组成封闭围圈结构,且封闭围圈结构操作台面高度一致。本实用新型采用组合式结构,可依据需求选用各个功能机组合成整体服务终端,节约对车站的空间占用,便于乘客购票,节省乘客时间,提高服务终端的使用效率。

    一种轨道交通票务终端主控单元

    公开(公告)号:CN217061044U

    公开(公告)日:2022-07-26

    申请号:CN202123137014.2

    申请日:2021-12-14

    Abstract: 本实用新型公开了一种轨道交通票务终端主控单元,包括工控单元和与工控单元相连接的FPGA扩展单元,其中工控单元包括CPU、NPU;NPU通过MIPI接口与摄像头连接,NPU对摄像头采集的人脸图像进行本地生物特征识别,识别结果发送至CPU;FPGA扩展单元外接通行控制模块、票卡解密模块和票卡射频通信模块;通行控制模块用于根据CPU的指令控制闸机的开启和关闭;票卡解密模块用于对票卡进行解密,票卡射频通信模块用于与票卡进行射频通信。该主控单元采用神经网络处理器NPU实现生物识别功能,FPGA扩展单元扩展多种外围接口,由此在主控单元集成多种功能的情况下降低对CPU算力资源的占用,从而提高效率。

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