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公开(公告)号：CN119576220A
公开(公告)日：2025-03-07
申请号：CN202411518217.1
申请日：2024-10-29
Applicant: 北京智芯微电子科技有限公司 , 国网山西省电力公司信息通信分公司 , 国家电网有限公司
IPC: G06F3/06
Abstract: 本发明公开了一种处理器私有存储架构、访问方法和装置。该处理器私有存储架构包括：私有存储访问单元，用于在接收到目标私有存储指令时，对私有存储单元执行与目标私有存储指令对应的目标操作。该处理器架构具有仅处理器内核可以访问的私有存储单元，用于对私有存储单元进行访问的私有存储访问单元，私有存储单元和私有存储访问单元以及私有存储指令为处理器提供严格意义上的快速数据访问通路，提高处理器访存的性能和实时性。
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公开(公告)号：CN117251266A
公开(公告)日：2023-12-19
申请号：CN202311206795.7
申请日：2023-09-18
Applicant: 北京智芯微电子科技有限公司 , 国网陕西省电力有限公司电力科学研究院 , 国家电网有限公司
Abstract: 本发明公开了一种中断事件的处理方法、装置、电子设备、介质以及芯片。中断事件的处理方法包括：响应于接收到针对第一中断事件的中断请求，将存储于基础寄存器中的第一中断上下文信息写入备份寄存器，其中，第一中断上下文信息用于表征在第一中断事件发生的情况下中央处理单元的现场信息；响应于确定将存储于基础寄存器中的第一中断上下文信息写入备份寄存器完成，处理第一中断事件；在处理第一中断事件的过程中，并行地将存储于备份寄存器中的第一中断上下文信息写入存储器。本发明缩短了中断响应时间，提高了中断事件的处理效率。
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公开(公告)号：CN115543443A
公开(公告)日：2022-12-30
申请号：CN202211301981.4
申请日：2022-10-24
Applicant: 北京智芯微电子科技有限公司 , 国网江苏省电力有限公司信息通信分公司 , 国家电网有限公司
Abstract: 本发明公开了一种向量指令执行方法、处理器、计算机设备及存储介质。通过向量指令锁定机制，向量指令被第二流水线接收后设置为锁定状态。向量指令标识随第一流水线流到写回级时解除向量指令的锁定状态；向量指令的顺序在第二流水线内部维护；第二流水线在向量指令的执行过程中，若处于锁定状态的所述向量指令没有被解锁，不能将执行结果写入向量寄存器，等待锁定解除后进行向量寄存器的写操作；从而确保向量指令的写回操作晚于向量指令前面的非向量指令的写回操作，从而在高效的执行向量扩展指令集V中的向量指令的同时，防止主流水线被陷阱事件打断而向量指令超前更新向量寄存器导致的程序一致性问题。
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公开(公告)号：CN114327367A
公开(公告)日：2022-04-12
申请号：CN202210217293.3
申请日：2022-03-07
Applicant: 北京智芯微电子科技有限公司 , 国家电网有限公司
Abstract: 本公开实施例公开了一种伪数据处理方法、装置、执行单元以及处理器。其中，伪数据处理方法包括：伪数据获取步骤，执行单元获取伪数据；伪数据操作步骤，在执行单元的状态为空闲状态的条件下，执行单元根据获取的伪数据，执行特定操作，得到伪输出数据，伪数据包括以下的至少一项：输入常数信息、第一随机数，从而用伪数据处理模拟有效操作，防止执行单元在空闲状态下的电流、电压、功耗发生变化，而被外部检测，遭受攻击。输入常数信息作为伪数据易于实现，第一随机数作为伪数据可以更真实的模拟有效操作。
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公开(公告)号：CN113176983A
公开(公告)日：2021-07-27
申请号：CN202110720483.2
申请日：2021-06-28
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心) , 国家电网有限公司
Abstract: 本发明涉及CPU技术领域，提供一种程序流监控方法及程序流监控系统、CPU、芯片。所述程序流监控方法包括：通过在程序中设置的监控点对所述程序的程序流的执行信息进行记录，确定所述程序流的执行轨迹；根据记录的所述程序流的执行信息确定所述程序流的预期执行时间；统计所述程序流的实际执行时间；根据所述程序流的实际执行时间与所述程序流的预期执行时间的对比结果确定所述程序流是否按照预期执行。本发明从时间和空间相结合的维度来判断程序流是否按照预期执行，提高程序流监控的准确性，可同时实现对程序流的执行时间和执行轨迹进行监控，增强程序流执行的可靠性。
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Patent Agency Ranking
公开(公告)号：CN111708707A
公开(公告)日：2020-09-25
申请号：CN202010573848.9
申请日：2020-06-22
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心) , 国家电网有限公司
Abstract: 本发明提供一种嵌入式微处理器的调试方法及嵌入式微处理器，属于微处理器领域。所述方法包括：确定外部调试访问是否具有访问微处理器内某一区域的权限；在确定所述外部调试访问具有访问所述某一区域的权限的情况下，执行所述外部调试访问的调试请求。本发明通过对外部调试访问的区域以及权限进行管理，在调试过程中对访问区域和读写权限进行控制，有效提高硬件调试过程中微处理器内数据和系统的安全性。
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公开(公告)号：CN110008154B
公开(公告)日：2020-08-21
申请号：CN201910304546.9
申请日：2019-04-16
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网宁夏电力有限公司电力科学研究院
Abstract: 本发明公开了一种提高处理器与访存总线时序的方法及内存属性预测器，该方法包括：将处理器中设置内存属性预测器，内存属性预测器包括多个存储内存属性的寄存器单元，每个寄存器单元的地址是内存空间的地址范围按照内存属性类别进行分类后的每一类别中的所有地址的tag位段；当处理器接收到访问指令后对内存属性进行预测，该预测过程包括：内存属性预测器根据所述访问指令中的访问地址找到该访问地址的tag位段从而找到其对应的区域，将该区域中的寄存器单元的内存属性作为预测的内存属性；处理器将该预测的内存属性输出。该提高处理器与访存总线时序的方法及内存属性预测器能够提高CPU与外围总线或设备的接口时序，从而提高MCU的性能。
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公开(公告)号：CN110083551A
公开(公告)日：2019-08-02
申请号：CN201910344205.4
申请日：2019-04-26
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网宁夏电力有限公司电力科学研究院
IPC: G06F12/14
Abstract: 本发明公开了一种安全紧耦合存储器及其访问方法和存储介质，所述安全紧耦合存储器与处理器相连接，所述安全紧耦合存储器中预设有多个不同安全级别的存储区，每个存储区用于存储与该存储区安全级别对应的数据，所述访问方法包括：接收访问操作信息，其中所述访问操作信息包括：存储区中的数据地址以及该访问操作信息的安全属性标识，根据所述访问操作信息的安全属性标识以及所述数据地址判断所述访问操作信息是否具有访问所述数据地址的权限；若具有访问所述数据地址的权限，则对与所述数据地址对应的存储区进行访问操作。本发明提供的安全紧耦合存储器及其访问方法和存储介质满足了安全可信处理器架构中对存储程序和数据安全性的要求。
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公开(公告)号：CN110008154A
公开(公告)日：2019-07-12
申请号：CN201910304546.9
申请日：2019-04-16
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司 , 国网宁夏电力有限公司电力科学研究院
Abstract: 本发明公开了一种提高处理器与访存总线时序的方法及内存属性预测器，该方法包括：将处理器中设置内存属性预测器，内存属性预测器包括多个存储内存属性的寄存器单元，每个寄存器单元的地址是内存空间的地址范围按照内存属性类别进行分类后的每一类别中的所有地址的tag位段；当处理器接收到访问指令后对内存属性进行预测，该预测过程包括：内存属性预测器根据所述访问指令中的访问地址找到该访问地址的tag位段从而找到其对应的区域，将该区域中的寄存器单元的内存属性作为预测的内存属性；处理器将该预测的内存属性输出。该提高处理器与访存总线时序的方法及内存属性预测器能够提高CPU与外围总线或设备的接口时序，从而提高MCU的性能。
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公开(公告)号：CN109993005A
公开(公告)日：2019-07-09
申请号：CN201910288507.4
申请日：2019-04-11
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网有限公司
IPC: G06F21/75
Abstract: 本发明公开了一种对CPU总线的数据信号加解扰的方法及装置，方法包括：第一加扰模块接收第一随机信号，其中，第一随机信号包括第一随机数；获取预存的与所述第一随机数匹配的加扰算法以及第一总线数据，使用所述加扰算法对所述第一总线数据进行加扰处理，并将所述加扰处理后的数据以及所述第一随机数作为第一总线信息进行发送；第一解扰模块接收第一总线信息；根据与第一随机数匹配的解扰算法对加扰处理后的数据进行解扰处理。本发明提供的对CPU总线的数据信号加解扰的方法及装置，增加了功耗数据的随机性及抗破解难度，提高了芯片抵抗功耗旁路攻击的能力。
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