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公开(公告)号：CN110415659A
公开(公告)日：2019-11-05
申请号：CN201910339581.4
申请日：2019-04-25
Applicant: 夏普株式会社
Abstract: 一种显示装置，能迅速且可靠地进行栅极线向非选择状态的转变。显示装置针对显示面板中的多条栅极线中的每一条栅极线而具有多个驱动电路和多个辅助电路。驱动电路和辅助电路被供应M(M≥4)相的驱动用信号中的一个驱动用信号。驱动电路将驱动用信号的电位输出到栅极线。栅极线的选择期间包含预充电期间和正式充电期间，相互相邻的2个栅极线中在先的栅极线的正式充电期间与在后的栅极线的预充电期间是重复的。辅助电路至少在对应的栅极线的正式充电期间和下一级的栅极线的正式充电期间进行驱动，在栅极线的正式充电期间输出驱动用信号的第1电位电平(选择电位)，在下一级的栅极线的正式充电期间输出驱动用信号的第2电位电平(非选择电位)。
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公开(公告)号：CN102741937A
公开(公告)日：2012-10-17
申请号：CN201180007991.0
申请日：2011-02-10
Applicant: 夏普株式会社
CPC classification number: G11C19/28 , G09G3/3677
Abstract: 一种移位寄存器，其包括多级的包含触发器的单位电路，各单位电路基于触发器的输出取入同步信号，由此生成本级的输出信号，在上述触发器中设置有：第一开关和第二开关（11、12）；以及将被输入的信号锁存而作为触发器的输出的锁存电路（LC），并且第一移位方向信号（UD）经由第一开关（11）输入锁存电路（LC），且第二移位方向信号（UDB）经由第二开关（12）输入锁存电路（LC），在初级和末级以外的各单位电路中，前一级的输出信号被输入第一开关的控制端子，并且后一级的输出信号被输入第二开关的控制端子。由此，能够减少移位寄存器的元件数，实现移位寄存器的小型化和低成本化。
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公开(公告)号：CN102576517A
公开(公告)日：2012-07-11
申请号：CN201080046262.1
申请日：2010-06-04
Applicant: 夏普株式会社
CPC classification number: G09G3/3614 , G09G3/3655 , G09G2310/0267
Abstract: 在进行CC驱动的显示装置，将在列方向将视频信号的分辨率转换为2倍进行显示的第一模式，切换为以视频信号的分辨率进行显示的第二模式。在第一模式，向与相邻的2条扫描信号线对应的在列方向相邻的2个像素所包括的各像素电极，供给相同极性且相同灰度等级的信号电位，并且使被写入像素电极的信号电位的变化方向按每相邻的2行而不同(2线反转驱动)。在第二模式，使被写入像素电极的信号电位的变化方向按每相邻的1行而不同(1线反转驱动)。提供如下的显示驱动电路：在进行CC驱动的显示装置，能够不引起显示品质的下降地在第一模式与第二模式之间相互切换，该第一模式是将视频信号的分辨率转换为n倍(n为整数)进行显示的模式，该第二模式是将视频信号的分辨率转换为m倍(m是与n不同的整数)进行显示的模式。
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公开(公告)号：CN101868919A
公开(公告)日：2010-10-20
申请号：CN200880116731.5
申请日：2008-08-19
Applicant: 夏普株式会社
IPC: H03K19/0175 , G09G3/20 , G09G3/36 , H03F1/02 , H03F1/56 , H03K17/687 , H03K19/0185 , H03K19/094
CPC classification number: G09G3/3677 , G09G2310/0291 , G09G2330/021 , H03K19/0013 , H03K19/01714 , H03K19/018507 , H03K19/09441
Abstract: 具备：缓冲器部(32)，其具有包括相互串联连接的n沟道型的2个晶体管(4、6)的第1串联电路、包括相互串联连接的n沟道型的2个晶体管(5、7)的第2串联电路以及电容(101)；和反转信号生成部(31)，其仅采用n沟道型的沟道极性的晶体管(1～3)构成，生成输入信号的反转信号，输入信号输入到晶体管(6)的栅极和晶体管(7)的栅极，由反转信号生成部(31)生成的反转信号输入到晶体管(4)的栅极，从第2串联电路的2个晶体管彼此的连接点(OUT)输出输出信号，由此实现包括单极性沟道晶体管、能够抑制消耗电流并且加大负载的驱动能力的单相输入的缓冲器。
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公开(公告)号：CN101218623A
公开(公告)日：2008-07-09
申请号：CN200680024865.5
申请日：2006-07-11
Applicant: 夏普株式会社
CPC classification number: G09G3/3648 , G09G3/3688 , G09G2310/0245 , G09G2330/02 , G09G2330/027
Abstract: 在各源极总线(11)上具备电荷释放晶体管(31)，电荷释放晶体管(31)的极性和像素晶体管(14)的极性相同，像素晶体管(14)的截止电位信号(VSS)被发送给电荷释放晶体管(31)的栅极，在有源矩阵型液晶显示装置的电源关断时，使截止电位信号(VSS)在像素晶体管的导通电位信号(VDDG)达到GND电平电位之前先达到GND电平电位，从而使像素晶体管(14)和电荷释放晶体管(31)成为半导通状态，释放被蓄积在各像素(13)中的电荷。
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Patent Agency Ranking
公开(公告)号：CN100370510C
公开(公告)日：2008-02-20
申请号：CN200510008173.9
申请日：2005-02-06
Applicant: 夏普株式会社
CPC classification number: G09G3/3688 , G09G2310/0248
Abstract: 本发明揭示一种显示装置的驱动器电路和显不装置。显不装置驱动器电路的组成为：在控制对数据信号线及其连接的选择像素的预充电的开关的输入端设置或非(NOR)电路，在对部分数据信号线供给视频信号的期间，从移位寄存器将指示对其他数据信号线预充电的信号输入到或非电路，同时还从外部将指示对各数据信号线同时进行预充电的成批预充电指示信号输入到或非电路。由此，在对数据信号线供给视频信号的时间和不供给视频信号的时间都进行预充电。因而，即使驱动能力较低的预充电电源也能进行预充电，而且能对显示装置的信号供给线充分进行预充电。
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公开(公告)号：CN112014986B
公开(公告)日：2023-06-27
申请号：CN202010454136.5
申请日：2020-05-26
Applicant: 夏普株式会社
IPC: G02F1/133 , G02F1/1345 , G09G3/36
Abstract: 一种电路基板和显示面板，优化多个电路部的位置关系并且解决随之产生的问题。多个电路部(19)包含：中央侧电路部(19C)，其连接到多个配线引出部(20)中的至少中央侧配线引出部(20C)；以及端侧电路部(19E)，其连接到多个配线引出部(20)中的至少端侧配线引出部(20E)，并且相对于中央侧电路部(19C)在作为呈直线状的中央侧外形部(12C)的延伸方向的第1方向上位于端侧，构成为在作为多个电路部(19)与中央侧区域(AAC)的排列方向的第2方向上的尺寸比中央侧电路部(19C)在第2方向上的尺寸小。
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公开(公告)号：CN109416492B
公开(公告)日：2021-09-10
申请号：CN201780042791.6
申请日：2017-07-10
Applicant: 夏普株式会社
IPC: G02F1/1345 , G02F1/1333 , G02F1/1368
Abstract: 提供在具有非矩形形状的显示区域的液晶显示装置中，不会限制数据线的配置而能抑制闪烁等显示不良的技术。液晶显示装置具备有源矩阵基板(10)、相对基板以及液晶层。有源矩阵基板(10)具备多个栅极线(11)和多个数据线(12)。在由栅极线(11)和数据线(12)规定的各像素中配置有像素电极(14)，在显示区域(R)中设置有共用电极(15)。在显示区域(R)的外侧，设置有在多个栅极线(11)中的一部分栅极线(11)与共用电极之间形成电容的电容形成部(C)。一部分栅极线(11)比长度最大的栅极线短，与多个数据线(12)中的一部分数据线(12)交叉。对一部分栅极线(11)中的一个栅极线(11)设置有至少1个电容形成部(C)。
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公开(公告)号：CN109427312A
公开(公告)日：2019-03-05
申请号：CN201810961295.7
申请日：2018-08-22
Applicant: 夏普株式会社
IPC: G09G3/36
Abstract: 本发明防止栅极驱动电路的误动作。栅极驱动电路具备按每一上述扫描线设置的多个选择电路(60)，以使得从时钟信号选择一个时钟脉冲并进行扫描信号输出。选择电路(60)具有：晶体管(T1)，其输出扫描信号；晶体管(T4)，其将输出晶体管(T1)的控制端子的电位控制为低电位；晶体管(T5)，其在输出晶体管(T1)没有输出扫描信号时将晶体管(T4)的控制端子的电位控制为高电位；以及晶体管(Tx)，其在选择电路(60)中止动作的中止期间中的晶体管(T5)不动作的期间内将晶体管(T4)的控制端子的电位控制为高电位。
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公开(公告)号：CN102741937B
公开(公告)日：2015-11-25
申请号：CN201180007991.0
申请日：2011-02-10
Applicant: 夏普株式会社
CPC classification number: G11C19/28 , G09G3/3677
Abstract: 一种移位寄存器，其包括多级的包含触发器的单位电路，各单位电路基于触发器的输出取入同步信号，由此生成本级的输出信号，在上述触发器中设置有：第一开关和第二开关（11、12）；以及将被输入的信号锁存而作为触发器的输出的锁存电路（LC），并且第一移位方向信号（UD）经由第一开关（11）输入锁存电路（LC），且第二移位方向信号（UDB）经由第二开关（12）输入锁存电路（LC），在初级和末级以外的各单位电路中，前一级的输出信号被输入第一开关的控制端子，并且后一级的输出信号被输入第二开关的控制端子。由此，能够减少移位寄存器的元件数，实现移位寄存器的小型化和低成本化。
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