一种高效并行GCM实现方法
    11.
    发明授权

    公开(公告)号:CN111064563B

    公开(公告)日:2023-04-07

    申请号:CN201911272368.2

    申请日:2019-12-12

    Abstract: 本发明涉及一种高效并行GCM模块,其中,包括:运算调度模块、n个加解密模块、乘法核模块和参数配置模块;运算调度模块对多个加解密模块进行管理,包括预设各个加解密模块的初始加密数据,启动加解密模块运算,将加密结果依次传输到乘法核模块;n个加解密模块进行分组数据加解密,并输出密文和明文;乘法核模块根据附加信息A和密文C,产生鉴别标识T,用于指示根据GCM模式经加密的消息是否可信;参数配置模块根据GCM运算速率配置加解密模块的数量及乘法核运算速率。本发明的目的是提供一种高效GCM模块方式,该实现方式可根据GCM加解密速率要求配置加解密模块的数量和乘法核的运算速率,实现速度与面积的动态调整。

    一种高速数据加密NVMe-SATA转换器电路

    公开(公告)号:CN109240952A

    公开(公告)日:2019-01-18

    申请号:CN201810994587.0

    申请日:2018-08-27

    Abstract: 本发明公开了一种高速数据加密NVMe-SATA转换器电路,其中,主机通过NVMe控制器进行初始化配置,密钥注入单元将初始密钥注入系统总控制器进行密钥的分发,NVMe控制器分别将接受的命令与数据通过系统总控制器发送至片内缓存与SATA控制器中,加解密引擎控制器根据系统总控制器配置的命令参数从片内缓存中搬运数据至高速缓存寄存器中去,以及从高速缓存寄存器读取数据,写入至片内缓存中,高速缓存寄存器将数据整理为相应的数据格式写入至加解密计算单元进行加解密处理过程,将结果写回高速缓存寄存器,经SATA控制器写入至固态盘中或将解密的数据经NVMe控制器输出;系统总线控制器查询加解密引擎的状态使能信号,获取每个加解密引擎的状态,并调用闲置的加解密引擎进行加解密运算。

    一种适用于可更换密码算法IP核的通用更替电路

    公开(公告)号:CN109120406B

    公开(公告)日:2022-02-01

    申请号:CN201810981041.1

    申请日:2018-08-27

    Abstract: 本发明涉及公开了一种适用于可更换密码算法IP核的通用更替电路,包括:AXI接口用于向可更换密码算法IP核中配置参数,外部功能模块向输入数据FIFO写入待加解密的明问和密文数据,可更换密码算法IP核从输入数据FIFO读出待加解密的明文和密文数据,可更换密码算法IP核将加解密计算得到的明文和密文数据写入输出数据FIFO,外部功能模块从输出数据FIFO读出加解密计算后的明文和密文数据;输入数据FIFO的写时钟和外部功能模块时钟一致,输入数据FIFO的读时钟与可更换密码算法IP核的时钟一致;输出数据FIFO的写时钟和可更换密码算法IP核的时钟一致,输出数据FIFO的读时钟与外部功能模块时钟一致。使用本发明设计的通用更替电路可以减少密码算法更换时接口模块的工作量,使ASIC、FPGA设计、升级更简便。

    一种基于动态可重构密码芯片的无密钥数据加解密方法

    公开(公告)号:CN110298186B

    公开(公告)日:2021-04-06

    申请号:CN201910587598.1

    申请日:2019-07-02

    Abstract: 本发明涉及一种基于动态可重构密码芯片的无密钥数据加解密方法,其中,包括:加密流程:输入明文D,使用杂凑算法1计算明文D的杂凑值d;使用加密算法2,杂凑值d作为密钥对明文D进行加密,生成密文E;使用杂凑算法3计算密文E的杂凑值e;使用加密算法4,杂凑值e作为密钥对杂凑值d进行加密,生成密钥密文t,存储于安全UKey中;解密流程:输入密文E,使用杂凑算法3计算密文E的杂凑值e;使用加密算法4,杂凑值e作为密钥对密钥密文进行解密,生成杂凑值d;使用加密算法2,杂凑值d作为密钥对密文E进行解密,生成明文D。加密方法无需使用单独生成的密钥,无需进行复杂的密钥管理流程,使用计算待加密信息得来的杂凑值作为密钥对待加密信息进行加密,减少了系统复杂度。

    一种基于物理页相对温度的SLC闪存磨损均衡方法

    公开(公告)号:CN110531935A

    公开(公告)日:2019-12-03

    申请号:CN201910807810.0

    申请日:2019-08-29

    Abstract: 本发明涉及一种基于物理页相对温度的SLC闪存磨损均衡方法,其中,包括:闪存控制器上电后,接收到写请求,写请求中带有待写入物理块中待选各页的对应数据,确定待选各页的相对温度数值未超过设定的温度阈值,并从待选各页中选取擦写次数最小的物理页作为待写入物理页;将写请求中带有的对应数据与待写入页中原有数据作比较,包括:对每页的数据写入前后各晶体管翻转情况进行统计,根据浮栅晶体管电气特性,获得对应页的相对温度,将相对温度与物理块PE次数共同作为磨损均衡方法的考核指标。

    一种物理不可克隆函数IP核自动化验证装置

    公开(公告)号:CN109032868A

    公开(公告)日:2018-12-18

    申请号:CN201810832769.8

    申请日:2018-07-26

    CPC classification number: G06F11/2236 G06F11/2273 G06F21/73

    Abstract: 本发明涉及一种物理不可克隆函数IP核自动化验证装置,其中,包括:辅助管理单元,用于根据接收的指令信息,对PUF测试记录存储单元、PUF挑战硬件生成单元以及挑战存储单元进行使能和配置,控制每次循环测试的进程;PUF挑战硬件生成单元,用于硬件生成符合位宽要求的强PUF挑战;挑战存储单元,用于存储软件下传的挑战或PUF挑战硬件生成单元生成的挑战,并将挑战输出给PUF IP核实现单元;PUF IP核实现单元,用于实现或例化PUF IP核,并能够发出符合待测PUF时序要求的挑战,并接收对应的响应,控制或调整IP;PUF测试记录存储单元,用于在强PUF的执行硬件挑战生成方式时,存储成对的挑战以及响应记录,在非强PUF的执行硬件挑战生成方式时,则存储PUF响应。

    一种分离式的点乘方法及硬件电路

    公开(公告)号:CN119728112A

    公开(公告)日:2025-03-28

    申请号:CN202411758266.2

    申请日:2024-12-03

    Abstract: 本发明涉及一种分离式的点乘方法及硬件电路,属于密码技术领域。本发明的方法包括:三个部分;其中,第一部分为NAF编码运算,第二部分的连续倍点计算过程为点扩展计算,第三部分的连续点加/减计算过程为点累加计算。本发明的方法包括:固定点预处理模式、随机点点乘串行模式、随机点点乘并行模式、随机点点乘流水模式、固定点加速点乘模式、随机点固定点混合流水模式。本发明结合ECC椭圆曲线密码体制的应用特点,提供了6种应用模式,具有更广泛的更灵活的适用效果,可以在不同的硬件资源约束下,取得更好的性能表现。

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