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公开(公告)号：CN101385008B
公开(公告)日：2011-07-13
申请号：CN200780005312.X
申请日：2007-03-13
Applicant: 英特尔公司
CPC classification number: G06F15/7832
Abstract: 在一个实施例中，本发明包括具有多个用于执行指令的处理器内核的处理器，其中所述内核中的每一个包括专用数字接口电路。所述处理器还包括通过所述数字接口电路耦合到所述内核的模拟接口。可以采用所述模拟接口在包括所述内核的封装和耦合到其上的诸如共享总线的互连之间传输业务。还描述了其他实施例，并要求对其进行保护。
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公开(公告)号：CN100524287C
公开(公告)日：2009-08-05
申请号：CN200480021474.9
申请日：2004-07-23
Applicant: 国际商业机器公司
Inventor： 克里斯托斯·J·乔吉奥 , 维克多·L·格雷古里克 , 英迪拉·奈尔 , 瓦伦蒂纳·萨拉普拉
CPC classification number: G06F15/7832 , H04L49/109 , H04L49/602
Abstract: 片上系统(SoC)部件包括单个独立多处理器子系统核心，多处理器子系统核心包含多个多处理器，每个多处理器具有与其相关的本地存储器，从而形成处理器集群；和开关网络装置，其连接SoC内的每个处理器集群。当被构造成IDSP，协处理器，混合ASIC或网络处理结构时，单个SoC独立多处理器子系统核心能够执行SoC设备的多线程操作处理。SoC核心可配置为单芯片协议转换器集成电路(IC)，其能够接收根据第一协议类型产生的分组和处理所述分组以实现协议转换，并且产生第二协议类型的转换分组以进行其输出，完全在核心内执行协议转换的处理。协议转换器芯片能够被实现成片上系统(SoC)实现中的宏核心，协议转换的处理被包含在SoC协议转换宏核心内，不需要主机系统的处理资源。
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公开(公告)号：CN1153129C
公开(公告)日：2004-06-09
申请号：CN96191245.6
申请日：1996-08-30
Applicant: 菲利浦电子北美公司
CPC classification number: G06T1/20 , G06F9/30014 , G06F9/30025 , G06F9/30036 , G06F9/30072 , G06F9/3885 , G06F15/7832 , G06F17/10
Abstract: 定制操作可用于执行包括多媒体功能在内等功能的处理器系统。这些定制操作在保留专用嵌入方案的成本低廉芯片数少等优点以及通用处理器可编程性等优点不变的同时，提高系统(诸如PC系统)提供实时多媒体功能的能力。这些定制操作所作用的计算机系统，提供带操作数的输入数据，对操作数进行操作，并将结果送到目的寄存器。所执行的操作包括包含剪切或饱和操作在内的视频与音频信号处理。本发明也以来自输入寄存器(rscr)的选定操作数为运算对象进行并行操作并将操作结果存入目的寄存器(rdes)。
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公开(公告)号：CN107133019A
公开(公告)日：2017-09-05
申请号：CN201710253696.2
申请日：2017-04-18
Applicant: 深圳市同泰怡信息技术有限公司
Inventor： 陈吉宝
CPC classification number: G06F9/30181 , G06F15/7832
Abstract: 本发明提供了一种智能BMC芯片控制指令设置方法，其包括以下步骤：存储IPMI标准命令文档；设置功能菜单；选择是否打开智能输入，如果是，则键入Net Function字符，在所述IPMI标准命令文档中检索所有紧跟该Net Function的下一个字节，列出匹配的Command，直接输入或根据提示选择输入Command字符，在IPMI标准命令文档中检索所有紧跟该Command的下一个字节，是否存在Data位，直接输入或根据提示选择输入Data位的字符，BMC指令设置成功。本发明的技术方案适用于所有安装有IPMITOOL工具的系统，节约用户输入IPMI或OEM命令的时间，提高了准确度和效率。
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公开(公告)号：CN1910571A
公开(公告)日：2007-02-07
申请号：CN200480021474.9
申请日：2004-07-23
Applicant: 国际商业机器公司
Inventor： 克里斯托斯·J·乔吉奥 , 维克多·L·格雷古里克 , 英迪拉·奈尔 , 瓦伦蒂纳·萨拉普拉
CPC classification number: G06F15/7832 , H04L49/109 , H04L49/602
Abstract: 片上系统(SoC)部件包括单个独立多处理器子系统核心，多处理器子系统核心包含多个多处理器，每个多处理器具有与其相关的本地存储器，从而形成处理器集群；和开关网络装置，其连接SoC内的每个处理器集群。当被构造成IDSP，协处理器，混合ASIC或网络处理结构时，单个SoC独立多处理器子系统核心能够执行SoC设备的多线程操作处理。SoC核心可配置为单芯片协议转换器集成电路(IC)，其能够接收根据第一协议类型产生的分组和处理所述分组以实现协议转换，并且产生第二协议类型的转换分组以进行其输出，完全在核心内执行协议转换的处理。协议转换器芯片能够被实现成片上系统(SoC)实现中的宏核心，协议转换的处理被包含在SoC协议转换宏核心内，不需要主机系统的处理资源。
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Patent Agency Ranking
公开(公告)号：CN1318172A
公开(公告)日：2001-10-17
申请号：CN00801023.4
申请日：2000-04-13
Applicant: 密克罗奇普技术公司
Inventor： 爱德华·B·博尔斯
CPC classification number: G06F11/261 , G06F15/7832 , G06F15/7842
Abstract: 一种提供在仿真器系统中存取用户存储器的装置、系统及方法。仿真器系统包含仿真器系统存储器、用户系统存储器和仿真装置。仿真装置工作在程序执行指令源自仿真存储器，而读和写指令目标为用户存储器的模式下。包括在仿真器芯片中的逻辑将读和写存储器存取指向用户存储器，而指令从仿真器存储器获取。
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公开(公告)号：CN1003962B
公开(公告)日：1989-04-19
申请号：CN85104133
申请日：1985-05-30
Applicant: 株式会社日立制作所
IPC: G06F7/50
CPC classification number: G06F7/508 , G06F5/015 , G06F13/4077 , G06F15/7832 , G06F2207/3872
Abstract: 在一个至少含有一组寄存器和一个算术运算电路的算术运算器中，混合使用双极型晶体管和场效应管。
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公开(公告)号：CN106528414A
公开(公告)日：2017-03-22
申请号：CN201610957030.0
申请日：2016-11-03
Applicant: 上海华虹集成电路有限责任公司
Inventor： 许国泰
CPC classification number: Y02D10/12 , G06F11/3652 , G06F11/3644 , G06F11/3656 , G06F15/7832
Abstract: 本发明公开了一种处理器芯片仿真器，包括：仿真芯片，监控模块以及安装在用户电脑上的集成开发环境软件和接口软件；仿真芯片内有处理器状态寄存器和PC记录寄存器；监控模块通过访问接口与仿真芯片连接，通过调试接口与用户电脑相连接，实现与接口软件进行信息传送，接口软件通过通信接口通过与集成开发环境软件进行信息传送；如果接口软件发现仿真芯片处于低功耗模式，则只通过监控模块读取PC记录寄存器的内容，然后把仿真芯片处于低功耗模式的信息、PC记录寄存器的内容返回给集成开发环境软件，集成开发环境软件上显示当前仿真芯片处于低功耗状态。本发明能够方便用户程序的开发和调试，提高用户程序的开发效率。
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公开(公告)号：CN106033521A
公开(公告)日：2016-10-19
申请号：CN201510115867.6
申请日：2015-03-17
Applicant: 鸿富锦精密工业(武汉)有限公司 , 鸿海精密工业股份有限公司
CPC classification number: G06F1/324 , G06F1/08 , G06F1/3287 , G06F1/3296 , G06F13/4022 , G06F15/7807 , G06F15/7832
Abstract: 一种供电保护系统，用以对一电源供应器的供电电压进行调节，所述电源供应器经由一第一电阻输出供电电压为一电脑主板供电，所述供电保护系统包括一电压转换单元、一比较单元及一开关单元，所述电压转换单元包括一电压转换芯片，所述电压转换芯片采集所述第一电阻两端的一第一直流电压，所述电压转换芯片将所述第一直流电压进行放大后转换为一第二直流电压，所述比较单元接收所述第二直流电压，并将所述第二直流电压和一参考电压进行比较后输出一开关信号，所述开关单元接收所述开关信号，并根据所述开关信号输出一控制信号给所述电脑主板上的一中央处理器，所述中央处理器根据接收到的控制信号对其工作频率进行调节。
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公开(公告)号：CN101069185A
公开(公告)日：2007-11-07
申请号：CN200580041321.5
申请日：2005-09-21
Applicant: 皇家飞利浦电子股份有限公司
IPC: G06F17/50
CPC classification number: G06F15/7832
Abstract: 一种用于诸如数据处理器的子系统(TMi)的硬宏器件(HMD)，包括处理核心(C)，所述处理核心(C)有：适于馈送要处理的时间关键输入数据的至少一个时间关键输入端(CIT)；适于传递已处理的时间关键输出数据的至少一个时间关键输出端(COT)。处理核心(C)至少部分地由连接接口区域(CIZ)包围，所述CIZ包括i)位于已选位置并适于接收要处理的时间关键输入数据的至少两个时间关键辅助输入端(AITj)的至少一输入组，和/或位于所选位置并适于传递已处理的时间关键输出数据的至少两个时间关键辅助输出端(AOTk)的至少一输出组，ii)输入连接装置(LO)，用于将所述输入组的每个时间关键辅助输入端(AITj)连接到时间关键输入端(CIT)，和/或iii)输出连接装置(Bk)，用于将时间关键输出端(COT)连接到所述输出组的每个时间关键辅助输出端。
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