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公开(公告)号：CN109564522B
公开(公告)日：2023-08-04
申请号：CN201780047299.8
申请日：2017-05-24
Applicant: 超威半导体公司
Abstract: 一种表遍历器从请求实体接收将第一地址转换成与存储器页相关联的第二地址的请求。在对应的表遍历期间，当所述页的反向映射表(RMT)中的条目中的锁定指示符被设置为将所述RMT中的所述条目标记为已锁定时，所述表遍历器停止处理所述请求并执行补救措施。此外，当所述请求与对所述页的写入访问相关联并且所述RMT中的所述条目中的不可变指示符被设置为将所述页标记为不可变时，所述表遍历器停止处理所述请求并执行所述补救措施。否则，当所述RMT中的所述条目未被锁定且所述页未被标记为对于写入访问不可变时，所述表遍历器继续处理所述请求。
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公开(公告)号：CN106062768A
公开(公告)日：2016-10-26
申请号：CN201580010043.0
申请日：2015-02-27
Applicant: 超威半导体公司
Abstract: 一种处理器[102]在所述处理器的存储器存取路径中采用硬件加密模块[115]来以密码方式将安全信息隔离。在一些实施方案中，所述加密模块位于所述处理器的存储器控制器[110](例如，北桥)处，并且向所述存储器控制器提供的每个存储器存取指示所述存取是安全存储器存取，从而指示与所述存储器存取相关联的数据被指定用于密码保护，或是非安全存储器存取。对于安全存储器存取，所述加密模块对与所述存储器存取相关联的所述数据执行加密(针对写入存取)或解密(针对读取存取)。
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公开(公告)号：CN109564522A
公开(公告)日：2019-04-02
申请号：CN201780047299.8
申请日：2017-05-24
Applicant: 超威半导体公司
CPC classification number: G06F12/1425 , G06F9/45558 , G06F9/52 , G06F12/1009 , G06F12/1483 , G06F2009/45583 , G06F2009/45587 , G06F2212/1052 , G06F2212/151 , G06F2212/65 , G06F2212/651
Abstract: 一种表遍历器从请求实体接收将第一地址转换成与存储器页相关联的第二地址的请求。在对应的表遍历期间，当所述页的反向映射表(RMT)中的条目中的锁定指示符被设置为将所述RMT中的所述条目标记为已锁定时，所述表遍历器停止处理所述请求并执行补救措施。此外，当所述请求与对所述页的写入访问相关联并且所述RMT中的所述条目中的不可变指示符被设置为将所述页标记为不可变时，所述表遍历器停止处理所述请求并执行所述补救措施。否则，当所述RMT中的所述条目未被锁定且所述页未被标记为对于写入访问不可变时，所述表遍历器继续处理所述请求。
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公开(公告)号：CN103299272A
公开(公告)日：2013-09-11
申请号：CN201180064250.6
申请日：2011-12-07
Applicant: 超威半导体公司
Inventor： 本杰明·C·谢列布林 , 大卫·A·卡普兰 , 安东·切尔诺夫
CPC classification number: G06F9/30189 , G06F9/3004 , G06F9/30076 , G06F9/30087 , G06F9/3834 , G06F9/467
Abstract: 一种多处理核心系统中的处理核心被配置来执行指令序列作为单原子内存事务。所述处理核心验证序列满足一组一个或多个原子性标准，包括序列中的没有指令指示处理核心访问共享内存。在验证序列后，所述处理核心诸如通过以下步骤执行序列作为单原子内存事务：锁定存储共享内存数据的源缓存线；执行验证的指令序列；将序列结果存储到所述源缓存线中；和将所述源缓存线解锁。
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Patent Agency Ranking
公开(公告)号：CN118575171A
公开(公告)日：2024-08-30
申请号：CN202280086623.8
申请日：2022-12-19
Applicant: 超威半导体公司 , ATI科技无限责任公司
Inventor： 菲利普·恩杰 , 尼蓬·拉瓦尔 , 大卫·A·卡普兰 , 唐纳德·P·小马修斯
IPC: G06F12/1081 , G06F12/14 , G06F12/0815 , G06F12/1072
Abstract: 限制机密计算架构中的外围设备协议，该方法包括：从支持第一协议的外围设备接收第一地址转换请求，其中该第一协议支持该外围设备与处理器高速缓存之间的高速缓存一致性；确定机密计算架构被启用；以及响应于该第一地址转换请求而提供包括对该外围设备的不使用该第一协议的指示的响应。
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公开(公告)号：CN106687985A
公开(公告)日：2017-05-17
申请号：CN201580051135.3
申请日：2015-09-22
Applicant: 超威半导体公司
CPC classification number: G06F21/62 , G06F21/606 , G06F21/74 , G06F21/83
Abstract: 公开一种系统和方法，用于从耦合到计算系统的输入设备安全地接收数据。该系统包括配置成从输入设备、协处理器和主机计算机接收数据的接口，其中所述主机计算机包括输入处理程序和主机处理器。主机处理器配置成以正常模式和以特权模式执行代码。在主机计算机处于安全输入模式时，有数据来自接口时，主机处理器从正常模式切换到安全模式。输入处理程序从接口接收数据，并响应于安全模式中操作时接收到数据，将接收的数据发送到协处理器。
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公开(公告)号：CN106062768B
公开(公告)日：2020-06-05
申请号：CN201580010043.0
申请日：2015-02-27
Applicant: 超威半导体公司
Abstract: 一种处理器[102]在所述处理器的存储器存取路径中采用硬件加密模块[115]来以密码方式将安全信息隔离。在一些实施方案中，所述加密模块位于所述处理器的存储器控制器[110](例如，北桥)处，并且向所述存储器控制器提供的每个存储器存取指示所述存取是安全存储器存取，从而指示与所述存储器存取相关联的数据被指定用于密码保护，或是非安全存储器存取。对于安全存储器存取，所述加密模块对与所述存储器存取相关联的所述数据执行加密(针对写入存取)或解密(针对读取存取)。
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公开(公告)号：CN106687985B
公开(公告)日：2018-09-21
申请号：CN201580051135.3
申请日：2015-09-22
Applicant: 超威半导体公司
Abstract: 公开一种系统和方法，用于从耦合到计算系统的输入设备安全地接收数据。该系统包括配置成从输入设备、协处理器和主机计算机接收数据的接口，其中所述主机计算机包括输入处理程序和主机处理器。主机处理器配置成以正常模式和以特权模式执行代码。在主机计算机处于安全输入模式时，有数据来自接口时，主机处理器从正常模式切换到安全模式。输入处理程序从接口接收数据，并响应于安全模式中操作时接收到数据，将接收的数据发送到协处理器。
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公开(公告)号：CN103299272B
公开(公告)日：2016-04-27
申请号：CN201180064250.6
申请日：2011-12-07
Applicant: 超威半导体公司
Inventor： 本杰明·C·谢列布林 , 大卫·A·卡普兰 , 安东·切尔诺夫
CPC classification number: G06F9/30189 , G06F9/3004 , G06F9/30076 , G06F9/30087 , G06F9/3834 , G06F9/467
Abstract: 一种多处理核心系统中的处理核心被配置来执行指令序列作为单原子内存事务。所述处理核心验证序列满足一组一个或多个原子性标准，包括序列中的没有指令指示处理核心访问共享内存。在验证序列后，所述处理核心诸如通过以下步骤执行序列作为单原子内存事务：锁定存储共享内存数据的源缓存线；执行验证的指令序列；将序列结果存储到所述源缓存线中；和将所述源缓存线解锁。
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