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公开(公告)号：CN112530506B
公开(公告)日：2024-09-06
申请号：CN201911373973.9
申请日：2019-12-27
申请人： 爱思开海力士有限公司
IPC分类号： G11C29/42
摘要： 本公开涉及减少基于校验子的准循环解码器的延迟以及减少准循环线性码解码器的延迟的装置、系统和方法。示例方法包括：接收噪声码字，该码字已经由准循环线性代码生成并且在被解码器接收之前被提供至通信信道；基于噪声码字计算校验子；生成多个存储器单元地址，第一存储器单元地址是校验子的函数，后续存储器单元地址在校验子的函数的预定地址范围内；以减少解码器的延迟的并行方式，根据多个存储器单元地址读取多个错误模式，计算多个错误模式中的每个的校验和；以及基于多个错误模式中的每个的校验和，确定发送码字的候选版本。
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公开(公告)号：CN112289360B
公开(公告)日：2024-06-14
申请号：CN202010469243.5
申请日：2020-05-28
申请人： 爱思开海力士有限公司
摘要： 实施例描述了一种用于从存储装置读取数据的方法，该方法包括：选择待读取的存储块；识别用于读取该块的读取重试表；确定所选择的存储块的读取重试表需要更新；并且使用来自该读取重试表的新读取阈值电压组读取存储块。响应于使用新电压组的成功读取操作，该方法还可包括：利用该新读取电压组来代替第一字段中的初始读取电压组；并且利用从读取重试邻居表中识别出的额外读取阈值电压组填充读取重试表中的多个后续字段，其中在读取电压空间中，额外读取电压组中的至少一个在距离上最接近初始读取电压组。
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公开(公告)号：CN117808059A
公开(公告)日：2024-04-02
申请号：CN202211599546.4
申请日：2022-12-12
申请人： 爱思开海力士有限公司
IPC分类号： G06N3/063 , G06N3/0464 , G06N3/048 , G06N3/084 , G11C16/34
摘要： 本公开描述了基于使用非均匀量化进行灵活的二次幂计算来改进使用深度神经网络(DNN)的存储器装置的操作的装置、系统和方法。一种示例方法包括接收DNN的多个初始权重，DNN被配置为确定与存储器装置相关联的读取电压的值，其中多个初始权重包括至少一个非二次幂量化值或者至少一个浮点值。然后，该方法聚合多个初始权重以生成多个量化函数，为多个量化函数中的相应量化函数确定多个量化权重中的每一个，使得多个量化权重中的每一个都是二次幂之和，配置DNN以使用多个量化权重，并使用DNN来生成读取电压的更新值以从存储器装置检索信息。
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公开(公告)号：CN112133358B
公开(公告)日：2024-01-19
申请号：CN201910866126.X
申请日：2019-09-09
申请人： 爱思开海力士有限公司
IPC分类号： G11C29/42
摘要： 本公开描述了与用于数据存储的QoS感知解码器架构相关的技术。在示例中，QoS规范包括指示用于完成数据读取命令的处理的可接受延迟的QOS延迟规范。解码器可以存储该QOS延迟规范。在操作中，解码器生成指示处理的实际延迟的延迟测量。如果延迟测量和QOS延迟规范的比较指示QOS延迟规范的违规，则解码器可终止解码并生成解码失败。
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公开(公告)号：CN110444245B
公开(公告)日：2023-07-18
申请号：CN201910359766.1
申请日：2019-04-30
申请人： 爱思开海力士有限公司
IPC分类号： G11C29/42
摘要： 本发明涉及一种对用户位和奇偶校验位执行解码的存储器控制器、解码器和方法，该奇偶校验位包括对应于低度变量节点的奇偶校验位。对于用户位中的每一个，解码器执行变量节点更新操作以及对连接的校验节点的校验节点更新操作。在处理了所有用户位之后，解码器使用对用户位所执行的变量节点更新操作和校验节点更新操作的结果，对奇偶校验位执行奇偶校验节点更新操作。
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公开(公告)号：CN109873646B
公开(公告)日：2023-04-07
申请号：CN201811394212.7
申请日：2018-11-21
申请人： 爱思开海力士有限公司
摘要： 本发明涉及一种根据使多个失败字线能够恢复的芯片猎杀方案的存储器读取和写入的技术。在示例中，当将数据写入至存储器的超级块时，超级块的字线存储“D+P”个奇偶校验位，该“D+P”个奇偶校验位保护长度为“2D+P”的码字的“D”个数据位。超级块的其他字线存储每个长度为“D+P”的码字(例如，“D”个数据位和“P”个奇偶校验位)。如果长度为“D+P”的这些码字中的任何一个的解码失败，则使用“D+P”个奇偶校验位来再次解码失败的字线。
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公开(公告)号：CN109545261B
公开(公告)日：2023-03-14
申请号：CN201810932555.8
申请日：2018-08-16
申请人： 爱思开海力士有限公司
IPC分类号： G11C16/12
摘要： 本发明涉及一种包括多个存储器单元的系统。每个存储器单元被编程到与多个单元编程电压中的一个对应的数据状态。读取存储器单元以确定每个存储器单元的编程数据状态。执行错误校正解码以确定每个存储器单元的校正数据状态。基于编程数据状态和校正数据状态来确定相应的单元水平或编程电压。第一错误计数表示编程数据状态的单元水平高于校正数据状态的单元水平的错误单元的总数量。第二错误计数表示编程数据状态的单元水平低于校正数据状态的单元水平的错误单元的总数量。该系统被配置成基于第一错误计数和第二错误计数来执行存储器操作。
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公开(公告)号：CN115762608A
公开(公告)日：2023-03-07
申请号：CN202210221777.5
申请日：2022-03-09
申请人： 爱思开海力士有限公司
摘要： 描述了用于提高存储器装置的性能的装置、系统和方法。示例方法包括：接收与对存储器装置的页面的多个先前读取操作相关联的一个或多个参数，其中先前读取操作基于多个读取电压；使用一个或多个参数作为包括多个层的深度神经网络的输入来确定更新的多个读取电压，其中多个层中的每一层都是全连接层；并且将更新的多个读取电压施加到存储器装置，以从存储器装置检索信息，其中深度神经网络使用已经使用(a)剪枝操作、(b)非均匀量化操作或(c)霍夫曼编码操作中的至少一个进行了处理的多个权重。
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公开(公告)号：CN115482866A
公开(公告)日：2022-12-16
申请号：CN202111571717.8
申请日：2021-12-21
申请人： 爱思开海力士有限公司
摘要： 本发明描述了用于提高存储器装置的性能的装置、系统和方法。示例方法包括：基于多个读取电压，对存储器装置的多个页面中的每一个执行读取操作；基于针对多个页面中的每个页面的读取操作，确定每个页面中的“1”计数以及每个页面的错误校正码的校验和；基于多项式回归生成校验和的第一估计器和“1”计数的第二估计器；基于第一估计器和第二估计器确定更新后的多个读取电压；并且将更新后的多个读取电压施加到存储器装置以从存储器装置检索信息。
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