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公开(公告)号：CN120017606A
公开(公告)日：2025-05-16
申请号：CN202510248544.8
申请日：2025-03-04
Applicant: 海光信息技术股份有限公司
IPC: H04L47/6275 , H04L47/62 , H04L47/52 , H04L47/19
Abstract: 一种数据传输控制器、方法、电子设备及计算机存储介质。该数据传输控制器包括N个协议层控制器、仲裁器和一个数据链路层控制器，N为大于等于2的整数；N个协议层控制器配置为传输N个协议层数据；仲裁器配置为接收N个协议层控制器的N个协议层数据，并确定N个协议层数据的传输优先级；数据链路层控制器配置为按照传输优先级传输N个协议层数据。该数据传输控制器使得不同协议层可以共享同一物理链路资源，提高了链路的利用率和灵活性；同时，实现了不同协议层数据的隔离和保护。
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公开(公告)号：CN117811590A
公开(公告)日：2024-04-02
申请号：CN202311830860.3
申请日：2023-12-28
Applicant: 海光信息技术股份有限公司
Abstract: 本申请实施例提供一种数据编码纠错方法、装置及相关设备，其中数据编码纠错方法包括：发送端生成原始数据，将所述原始数据分为至少2组交织的待编码数据；将所述待编码数据进行至少2编译单元的编译方法，生成与之一一对应的纠错码；将所述待编码数据和所述纠错码合并为待传输数据，并将待传输数据发送至接收端；接收端基于待传输数据中的纠错码进行纠错，得到所述待编码数据；合并所述待编码数据，生成所述原始数据。通过在获取待传输数据时，使得纠错码与待传输数据的比例大于3/128，从而可以使用数据量更大的纠错码纠正更多错误，减少传出过程中造成的数据错误及码间干扰带来的错误，降低数据传输的误码率。
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公开(公告)号：CN117544433A
公开(公告)日：2024-02-09
申请号：CN202311389522.0
申请日：2023-10-24
Applicant: 海光信息技术股份有限公司
IPC: H04L12/02 , H04L12/10 , H04L69/323 , H04L69/324
Abstract: 本申请实施例提供一种芯粒、低功耗控制方法、芯片及计算机设备，所述芯粒与互联的对端芯粒之间传输数据流，所述芯粒包括：芯粒互联接口；所述芯粒互联接口包括：链路层和物理层；所述链路层，用于在所述数据流的传输空闲时间，关闭所述链路层的数据传输通路，以使得所述链路层进入低功耗状态；其中，所述物理层维持工作状态不变。本申请实施例可以在芯粒互联场景下，降低芯粒互联的功耗。
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公开(公告)号：CN117294392A
公开(公告)日：2023-12-26
申请号：CN202311244792.2
申请日：2023-09-25
Applicant: 海光信息技术股份有限公司
Inventor： 周鹏
IPC: H04L1/00
Abstract: 本公开的至少一实施例提供了前向纠错方法、前向纠错装置、电子装置与存储介质。该前向纠错方法包括：接收系统总线上传输的数据包，其中数据包包括n个子数据包，n为正整数且n≥2；并且响应于接收到n个子数据包中的一个子数据包，将一个子数据包传输到n个前向纠错通道中的一个前向纠错通道，其中n个子数据包与n个前向纠错通道一一对应；以及在一个前向纠错通道对一个子数据包执行前向纠错操作。该前向纠错方法可以支持接收到数据包的一部分即可发出，以执行前向纠错操作，提高数据传输效率。
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公开(公告)号：CN117271193A
公开(公告)日：2023-12-22
申请号：CN202311280094.8
申请日：2023-09-28
Applicant: 海光信息技术股份有限公司
Inventor： 周鹏
IPC: G06F11/07
Abstract: 本发明实施例提供一种内存诊断方法、装置、电子设备及存储介质，其中，所述方法，包括：获取内存的当前可纠正错误的次数；以及，根据所述内存对应的系统应用需求，获取与所述系统应用需求适配的可纠正错误的次数阈值；所述可纠正错误的次数阈值用于区分内存的安全状态和非安全状态；将所述可纠正错误的次数阈值与所述当前可纠正错误的次数进行比较，并根据比较结果确定内存状态。本发明实施例所提供的技术方案，通过利用可纠正错误的次数阈值，可以对内存故障进行提前诊断，提高内存故障诊断的效率和计算机的稳定性。
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Patent Agency Ranking
公开(公告)号：CN112688693B
公开(公告)日：2023-12-05
申请号：CN202011471464.2
申请日：2020-12-14
Applicant: 海光信息技术股份有限公司
Inventor： 周鹏
Abstract: 一种内存多矩阵编码方法、纠错方法及相关装置。多矩阵编码方法，包括：接收要写入存储器的信息码数据，所述信息码数据包括r比特；以及基于预先设定的多个RS校验矩阵对所述信息码数据执行里德所罗门RS编码处理，得到n比特的RS编码数据。多矩阵纠错方法包括：读取存储器中存储的发生错误的RS编码数据，其中所述RS编码数据包括n比特，其中前r比特为待纠错的信息码数据，其包括h个信息码元，每个信息码元的长度是t比特，后k比特为读取的校验码数据；以及基于预先设定的多个RS校验矩阵，对所述RS编码数据进行纠错以获得纠错后的信息码数据。
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公开(公告)号：CN117014208A
公开(公告)日：2023-11-07
申请号：CN202311000886.5
申请日：2023-08-09
Applicant: 海光信息技术股份有限公司
Abstract: 本发明实施例提供一种数据加密方法、装置、系统、电子设备及存储介质，其中，所述方法，包括：获取待加密数据；在模逆运算过程中参与移位的第一移位参数和第二移位参数中的任一参数为移位完成时，获取移位完成时刻所对应的目标模逆运算结果；第一移位参数的初始值的比特位数量小于等于第二移位参数的初始值的比特位数量；利用通过目标模逆运算结果确定的密钥信息对待加密数据进行加密，得到加密数据。本发明实施例所提供的技术方案，通过根据第一移位参数和第二移位参数的移位完成时刻，确定移位完成时刻所对应的目标模逆运算结果，因此可以提升获取目标模逆运算结果的效率，提升数据加密的效率。
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公开(公告)号：CN113485866B
公开(公告)日：2023-05-09
申请号：CN202110751307.5
申请日：2021-07-02
Applicant: 海光信息技术股份有限公司
Inventor： 周鹏
IPC: G06F11/10
Abstract: 本公开提供了译码方法及相关装置、电子设备和存储介质。译码方法包括：读取里德所罗门RS编码数据；组织读取的RS编码数据；基于第一校验矩阵对组织后的RS编码数据执行第一RS译码，得到第一RS译码数据，第一RS译码数据包括第一译码的信息码数据和第一译码的虚拟比特码数据；基于读取的虚拟比特码数据对应的虚拟比特码数据被编码时的关系，对第一译码的虚拟比特码数据执行纠正，以得到正确的虚拟比特码数据；对正确的虚拟比特码数据以及读取的信息码数据和读取的校验码数据执行RS算法后处理；以及基于第二校验矩阵对读取的信息码数据和RS运算后校验码数据执行第二RS译码。根据本公开的实施例，可以实现虚拟比特码数据的解析与ECC纠错同时有效。
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公开(公告)号：CN114238208A
公开(公告)日：2022-03-25
申请号：CN202111527858.X
申请日：2021-12-14
Applicant: 海光信息技术股份有限公司
Abstract: 本申请实施例提供一种内存控制器及芯片产品，所述内存控制器包括：异步FIFO模块，被配置为同步源自第一时钟域和源自第二时钟域的数据或者命令，其中，所述第一时钟域是由内存控制器的时钟频率所限定的时钟域，所述第二时钟域是由内存的时钟频率所限定的时钟域；处理单元，被配置为根据测量延时值和内存协议所规定的任意两条相邻命令之间的协议延时值得到所述任意两条相邻命令之间的发送间隔延时值，其中，所述测量延时值是通过测量相邻两条命令或相邻两拍数据从内存控制模块传到内存物理接口上的间隔时间变化量确定的。通过本申请的一些实施例有效减少内存控制器从发射命令到完成传输数据的延时。
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公开(公告)号：CN118916210A
公开(公告)日：2024-11-08
申请号：CN202411187106.7
申请日：2024-08-27
Applicant: 海光信息技术股份有限公司
IPC: G06F11/10
Abstract: 本公开的至少一实施例提供了数据处理方法及装置、电子装置及计算机可读存储介质。该数据处理方法包括：接收第一数据和第一数据的第一循环冗余校核码；对第一数据进行循环冗余校核操作来生成第二循环冗余校核码；基于第一循环冗余校核码和第二循环冗余校核码生成伴随式；以及基于伴随式对第一数据进行纠错。该数据处理方法可以纠正数据错误，提高数据传输效率，实现例如低成本场景下的数据保护。
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