用于快速啁啾PLL的相位预设

    公开(公告)号:CN110572153A

    公开(公告)日:2019-12-13

    申请号:CN201910475001.4

    申请日:2019-05-31

    摘要: 具有相位预设的快速啁啾锁相环(70)包括产生调频连续波形FMCW(14)的压控振荡器VCO(12)。该VCO对连接到电荷泵(28)的滤波器(72)的滤波后输出电压(74)作出响应。数字控制器(82)修改该FMCW以产生啁啾相位(304)和返回相位(300)。该啁啾相位包括该FMCW从开始频率(202)到停止频率(204)的第一线性改变。该返回相位包括该FMCW从该停止频率到该开始频率的第二线性改变。相位预设电路(86)连接到该数字控制器和该滤波器。在该啁啾相位之前的开始频率时间(302)期间,该相位预设电路供应相位预设电流(98)。该相位预设电流与该VCO的VCO增益成比例并且与该啁啾相位期间的啁啾电流成反比。

    通信单元、集成电路和用于时钟和数据同步的方法

    公开(公告)号:CN110740029B

    公开(公告)日:2023-12-22

    申请号:CN201910593225.5

    申请日:2019-07-02

    摘要: 一种通信单元(900)包括多个级联装置,其包括以主从布置配置的至少一个主装置(910)和至少一个从属装置(920,923)。所述至少一个主装置(910)和至少一个从属装置(920,923)各自包括:解调器电路(964,965),其被配置成接收所分布的参考时钟信号(984)且由所述参考时钟信号(984)重新形成系统时钟信号(988,990);时钟产生电路,其包括被配置成接收所述重新形成的系统时钟信号(988,990)以形成主从时钟信号的在内部产生的参考锁相环路;和模/数转换器ADC(941,942),其联接到所述参考锁相环路且被配置成使用同一主从时钟信号(988,990)对准所述(56)对比文件Teerachot Siriburanon;Satoshi Kondo;Kento Kimura;Tomohiro Ueno Gunma R & DCenter, ADVANTEST Corporation, Gunma,Japan Satoshi Kawashima;Tohru Kaneko;WeiDeng;Masaya Mi.A 2.2 GHz -242 dB-FOM 4.2mW ADC-PLL Using Digital Sub-SamplingArchitecture.IEEE Journal of Solid-StateCircuits.2016,第1-13页.Ioannis L. Syllaios;Henrik T.Jensen.DPLL with hybrid ΔΣ phase/frequency detector.2015 IEEEInternational Symposium on Circuits andSystems (ISCAS).2015,第1-4页.

    相位旋转器控制设备及其方法
    6.
    发明公开

    公开(公告)号:CN113452373A

    公开(公告)日:2021-09-28

    申请号:CN202110273476.2

    申请日:2021-03-12

    IPC分类号: H03M3/00

    摘要: 提供了一种相位旋转器控制电路。所述相位旋转器控制电路耦合到相位旋转器核,且包括耦合以接收数字控制信号的第一组晶体管。所述第一组晶体管耦合到第二组晶体管,所述第二组晶体管被配置且布置成形成滤波后的电流镜。所述滤波后的电流镜的输出耦合以向所述相位旋转器核提供模拟相位控制信号。

    用于快速啁啾PLL的相位预设

    公开(公告)号:CN110572153B

    公开(公告)日:2024-09-10

    申请号:CN201910475001.4

    申请日:2019-05-31

    摘要: 具有相位预设的快速啁啾锁相环(70)包括产生调频连续波形FMCW(14)的压控振荡器VCO(12)。该VCO对连接到电荷泵(28)的滤波器(72)的滤波后输出电压(74)作出响应。数字控制器(82)修改该FMCW以产生啁啾相位(304)和返回相位(300)。该啁啾相位包括该FMCW从开始频率(202)到停止频率(204)的第一线性改变。该返回相位包括该FMCW从该停止频率到该开始频率的第二线性改变。相位预设电路(86)连接到该数字控制器和该滤波器。在该啁啾相位之前的开始频率时间(302)期间,该相位预设电路供应相位预设电流(98)。该相位预设电流与该VCO的VCO增益成比例并且与该啁啾相位期间的啁啾电流成反比。

    用于校准相位旋转器的方法及设备

    公开(公告)号:CN112118198A

    公开(公告)日:2020-12-22

    申请号:CN202010526070.6

    申请日:2020-06-10

    IPC分类号: H04L27/00 H04L25/49 G01S7/40

    摘要: 公开了用于通过以下提高与雷达信号相关联的相位的准确性的各个实施例:识别与引起相位旋转器输出的偏移或不平衡、引起信号失真或以其它方式降低所述信号的所述相位的射频(RF)损伤相关联的频谱特征;以及执行数字预失真以增强雷达性能并补偿所述损伤。本公开的自校准机制被配置成识别所述损伤,确定与所述损伤相关联的频谱特征并且通过至少部分地基于与所述损伤相关联的所述频谱特征的对RF信号的数字预失真来优化相位误差。

    快速啁啾PLL的经升压返回时间及校准方法

    公开(公告)号:CN110572152B

    公开(公告)日:2024-08-27

    申请号:CN201910474589.1

    申请日:2019-05-31

    IPC分类号: H03L7/089 G01S7/292

    摘要: 一种具有升压返回时间的快速啁啾锁相回路(70)包括产生调频连续波形FMCW(14)的压控振荡器VCO(12)。所述VCO对连接到电荷泵(28)的滤波器(72)的经滤波输出电压(74)作出响应。数字控制器(82)修改所述FMCW以产生啁啾相位(304)和返回相位(300)。所述啁啾相位包括所述FMCW从开始频率(202)到停止频率(204)的第一线性改变。所述返回相位包括所述FMCW从所述停止频率到所述开始频率的第二线性改变。升压电路(86)连接到所述数字控制器和所述滤波器。所述升压电路在所述返回相位期间供应升压电流(98)。所述升压电流与所述返回相位的返回斜率成正比且与所述VCO的VCO增益成反比。