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公开(公告)号:CN116663467B
公开(公告)日:2023-11-10
申请号:CN202310934158.5
申请日:2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/3323 , G06F30/331 , G06F30/3312 , G06F30/327
Abstract: 本发明实施例提供一种断言等效硬件库的构建方法、装置、电子设备及存储介质,涉及计算机技术领域。该方法包括:确定待处理的断言算子的输入信号与输出信号之间的逻辑关系;所述断言算子为所述断言语句中实现基础断言功能的算子;根据所述逻辑关系确定所述断言算子对应的逻辑器件和所述逻辑器件之间的连接方式;按照所述连接方式连接所述断言算子对应的各个逻辑器件,得到所述断言算子对应的基础电路模块;将所述断言算子对应的基础电路模块添加至断言等效硬件库中。本发明实施例可以提升断言语句的电路综合效率,进而实现基于断言的硬件验证。
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公开(公告)号:CN116663463B
公开(公告)日:2023-11-10
申请号:CN202310934163.6
申请日:2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/331 , G06F30/3312 , G06F30/3323 , G06F30/327
Abstract: 本发明实施例提供一种电路验证方法、装置、电子设备及可读存储介质,该方法包括:获取设计文件,所述设计文件包括被测设计和断言语句;所述断言语句用于验证所述被测设计是否满足测试条件;将所述断言语句转化为断言电路,所述断言电路为寄存器转换级电路;基于所述被测设计和所述断言电路,生成目标网表;根据所述目标网表将所述被测设计和所述断言电路配置到集成电路芯片中;运行所述集成电路芯片,并监测所述被测设计的断言结果;在所述被测设计的断言覆盖率满足预设条件的情况下,确定所述被测设计通过验证。本发明实施例可以利用断言电路来揭示被测设计内部状态和潜在问题,解决了FPGA仿真缺乏设计细节的低级可见性的问题。
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公开(公告)号:CN117076337B
公开(公告)日:2024-02-02
申请号:CN202311345094.1
申请日:2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F11/36 , G06F30/367
Abstract: 本发明实施例提供一种数据传输方法、装置、电子设备及可读存储介质,涉及计算机技术领域。该方法包括:在满足数据获取条件的情况下,利用逻辑读取模块获取大容量存储单元中的目标数据;按照目标数据在大容量存储单元中的存储地址,对目标数据进行打包,得到目标文件;在目标文件中,目标数据与所述存储地址一一对应;将目标文件发送至目标设备,以供目标设备对目标文件进行解析使用。本发明实施例为从可编程逻辑芯片的大容量存储单元中往目标设备读取配置数据提供了切实可行的实现方式,提高了从可编程逻辑芯片往目标设备读取配置数据的效率。
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公开(公告)号:CN116663462B
公开(公告)日:2023-11-17
申请号:CN202310934159.X
申请日:2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/331 , G06F30/3312 , G06F30/3323 , G06F30/327
Abstract: 本发明实施例提供一种断言验证方法、断言验证平台、电子设备及可读存储介质,涉及计算机技术领域。其中的断言验证方法应用于断言验证平台,所述断言验证平台包括可编程逻辑芯片,所述可编程逻辑芯片中配置有被测设计、覆盖率监视器和硬件化断言测试集;所述方法包括:利用所述硬件化断言测试集对所述被测设计进行断言验证,并通过所述覆盖率监视器确定所述被测设计的断言覆盖率;在所述被测设计的断言覆盖率满足预设条件的情况下,确定所述被测设计通过验证。在本发明实施例提供的断言验证平台中,不可综合的断言语句被转化为等效硬件化断言测试集,实现了用硬件对被测设计进行调试加速。
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公开(公告)号:CN116702663A
公开(公告)日:2023-09-05
申请号:CN202310937005.6
申请日:2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/327 , G06F30/331 , G06F30/3312 , G06F30/3323
Abstract: 本发明实施例提供一种电路综合方法、装置、电子设备及可读存储介质,该方法包括:对待综合的断言语句进行解析,识别所述断言语句对应的关键字和验证方式;将所述断言语句中的关键字例化为基础电路模块;根据所述验证方式确定所述基础电路模块对应的连接方式;按照所述连接方式对所述基础电路模块进行连接,得到所述断言语句对应的断言电路。本发明实施例可以将不可综合的断言语句转换为等效的可综合的断言电路,以便在硬件中实现基于断言的验证。
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公开(公告)号:CN116663467A
公开(公告)日:2023-08-29
申请号:CN202310934158.5
申请日:2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/3323 , G06F30/331 , G06F30/3312 , G06F30/327
Abstract: 本发明实施例提供一种断言等效硬件库的构建方法、装置、电子设备及存储介质,涉及计算机技术领域。该方法包括:确定待处理的断言算子的输入信号与输出信号之间的逻辑关系;所述断言算子为所述断言语句中实现基础断言功能的算子;根据所述逻辑关系确定所述断言算子对应的逻辑器件和所述逻辑器件之间的连接方式;按照所述连接方式连接所述断言算子对应的各个逻辑器件,得到所述断言算子对应的基础电路模块;将所述断言算子对应的基础电路模块添加至断言等效硬件库中。本发明实施例可以提升断言语句的电路综合效率,进而实现基于断言的硬件验证。
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公开(公告)号:CN117113908B
公开(公告)日:2024-02-02
申请号:CN202311345112.6
申请日:2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F30/367 , G06F30/373
Abstract: 本发明实施例提供一种验证方法、装置、电子设备及可读存储介质,涉及计算机技术领域,该方法包括:将软件设计下载到可编程逻辑芯片的处理系统中,将所述软件设计对应的硬件设计烧录到所述可编程逻辑芯片的可编程逻辑区域中;在所述可编程逻辑芯片中同步运行所述硬件设计和所述软件设计,并监测所述硬件设计的第一运行数据和所述软件设计的第二运行数据;在所述第一运行数据和所述第二运行数据不匹配的情况下,对所述可编程逻辑芯片进行硬件快照,以保存所述可编程逻辑芯片的状态信息;将所述状态信息导入到仿真软件中进行仿真,以对所述硬件设计进行调试。本发明实施例提升了验证效率,并且保证了仿真的自由度和调试效率。
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公开(公告)号:CN117112447B
公开(公告)日:2023-12-22
申请号:CN202311344665.X
申请日:2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F11/36 , G06F30/367
Abstract: 本发明实施例提供一种数据传输方法、装置、电子设备及可读存储介质,涉及计算机技术领域。该方法包括:利用仿真软件对待测设计进行调试;待测设计烧录在可编程逻辑芯片中,可编程逻辑芯片中还包括数据写入模块和大容量存储单元;在满足预设条件的情况下,停止仿真软件的运行,并获取目标数据;根据目标数据和目标数据在所述大容量存储单元中的存储地址,生成目标文件;在目标文件中,目标数据与存储地址一一对应;利用数据写入模块基于目标文件,将目标数据写入大容量存储单元。本发明实施例为仿真软件往可编程逻辑芯片的大容量存储单元写入目标数据提供了切实可行的实现方式,提高了仿真软件往可编程逻辑芯片写入数据的效率。
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公开(公告)号:CN117112447A
公开(公告)日:2023-11-24
申请号:CN202311344665.X
申请日:2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F11/36 , G06F30/367
Abstract: 本发明实施例提供一种数据传输方法、装置、电子设备及可读存储介质,涉及计算机技术领域。该方法包括:利用仿真软件对待测设计进行调试;待测设计烧录在可编程逻辑芯片中,可编程逻辑芯片中还包括数据写入模块和大容量存储单元;在满足预设条件的情况下,停止仿真软件的运行,并获取目标数据;根据目标数据和目标数据在所述大容量存储单元中的存储地址,生成目标文件;在目标文件中,目标数据与存储地址一一对应;利用数据写入模块基于目标文件,将目标数据写入大容量存储单元。本发明实施例为仿真软件往可编程逻辑芯片的大容量存储单元写入目标数据提供了切实可行的实现方式,提高了仿真软件往可编程逻辑芯片写入数据的效率。
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公开(公告)号:CN117076337A
公开(公告)日:2023-11-17
申请号:CN202311345094.1
申请日:2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F11/36 , G06F30/367
Abstract: 本发明实施例提供一种数据传输方法、装置、电子设备及可读存储介质,涉及计算机技术领域。该方法包括:在满足数据获取条件的情况下,利用逻辑读取模块获取大容量存储单元中的目标数据;按照目标数据在大容量存储单元中的存储地址,对目标数据进行打包,得到目标文件;在目标文件中,目标数据与所述存储地址一一对应;将目标文件发送至目标设备,以供目标设备对目标文件进行解析使用。本发明实施例为从可编程逻辑芯片的大容量存储单元中往目标设备读取配置数据提供了切实可行的实现方式,提高了从可编程逻辑芯片往目标设备读取配置数据的效率。
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