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公开(公告)号:CN118523986A
公开(公告)日:2024-08-20
申请号:CN202410718961.X
申请日:2024-06-05
申请人: 中国电子科技集团公司第二十四研究所
IPC分类号: H04L25/03
摘要: 本发明涉及一种用于低功耗SerDes的发送器,包括:并串转换模块、第一延时模块、第二延时模块、第一信号选择模块、第二信号选择模块、以及三抽头SST均衡模块;所述并串转换模块用于对输入并行数据进行串化得到Pre信号;所述第一延时模块和第二延时模块用于对Pre信号进行延时处理得到Main信号和Post信号;所述第一信号选择模块用于选择Pre信号或Main信号输入前抽头均衡模块;所述第二信号选择模块用于选择Main信号或Post信号输入后抽头均衡模块;所述前抽头均衡模块、后抽头均衡模块和主抽头均衡模块的输出端相连作为发送器的输出端,所述主抽头均衡模块的输入为Main信号,以减少整体的数据抖动。
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公开(公告)号:CN118764025A
公开(公告)日:2024-10-11
申请号:CN202410978597.0
申请日:2024-07-22
申请人: 中国电子科技集团公司第二十四研究所
摘要: 本发明涉及一种低抖动双路径的锁相环电路,包括:鉴频鉴相器、电平移位模块、第一电荷泵、第二电荷泵、低通滤波器、压控振荡器模块和分频器;所述低通滤波器包括:比例支路和积分支路;在第一电荷泵输出第一充电电流时,所述比例支路升高控制电压;在第一电荷泵输出放电电流时,所述比例支路降低控制电压;在第二电荷泵输出第二充电电流时,所述积分支路升高控制电压;在第二电荷泵输出放电电流时,所述积分支路降低控制电压;本发明具有独立积分和比例环路滤波器控制的双路电荷泵锁相环结构,可以独立控制两个支路径的Kvco,以此来改变闭环带宽和阻尼系数,为PLL环路参数设计带来了更大的灵活性,在降低环路噪声的同时并不需要牺牲面积。
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