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公开(公告)号：CN103067009A
公开(公告)日：2013-04-24
申请号：CN201210575588.4
申请日：2012-12-27
Applicant: 东南大学
IPC: H03M1/10
Abstract: 本发明公开了一种高精度数模转换器测试系统，其包括待测高精度数模转换器、测试用的低精度模数转换器以及提供抖动测试信号的信号发生单元，待测高精度数模转换器的输入端与DAC编码单元相连并从输出端不断重复产生输出一定的待测波形，信号发生单元的输入端与抖动信号编码单元相连并从输出端产生输出固定间隔的抖动信号，抖动信号与待测波形叠加后发送至低精度模数转换器，低精度模数转换器将所接收到叠加波形量化成不同的数字信号并输出，再将量化后的数字信号与待测高精度数模转换器的输入信号进行关联，进而计算待测高精度数模转换器的DNL和INL。本发明投入成本低，适应层面广，而且测试精度高，而有效解决上述测试精度、效率以及成本问题。
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公开(公告)号：CN103064066A
公开(公告)日：2013-04-24
申请号：CN201210581244.4
申请日：2012-12-27
Applicant: 东南大学
IPC: G01S7/02
Abstract: 本发明公开了一种双基站雷达网络中发射雷达与接收雷达的部署方法，包括以下步骤：A、在部署区域A内任意选取M个发射雷达及N个接收雷达的初始位置，确定发射雷达和接收雷达移动的距离阈值Thd1；B、固定M个发射雷达的位置，利用随机维诺算法部署N个接收雷达，更新N个接收雷达的位置；C、固定N个接收雷达的位置，利用随机维诺算法部署M个发射雷达，更新M个发射雷达的位置；D、重复步骤B和步骤C，直到发射雷达和接收雷达移动的距离均小于阈值Thd1。本发明通过将发射雷达与接收雷达的部署问题分解为两个子问题，然后分别对每个子问题进行优化设计，最后经过重复迭代地解两个子问题以得到发射雷达与接收雷达的部署，该方法有效、时间复杂度低。
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公开(公告)号：CN110401445B
公开(公告)日：2022-11-18
申请号：CN201910609894.7
申请日：2019-07-08
Applicant: 东南大学
Abstract: 本发明公开了一种低硬件开销的TIADC系统采样时刻失配数字后台校准方法。在拉格朗日内插基础上实现重构滤波器来对采样时刻失配进行补偿。通过简化内插系数的多项表达式，本发明提出的架构相较其他完美重构方法节省了约41％的乘法器另外加法器数量也大大减少。在四通道800MSPS 12‑bit TIADC系统进行仿真验证，结果显示在0.4fs输入信号带宽内TIADC系统能获得至少72dB的SNDR。由于校准算法的全数字实现特征，极其适合运用在FPGA或DSP设备实现数据后处理。同时在高速多通道的TIADC系统中，大大减少的乘法器和加法器数量更容易在片内集成，在不同先进工艺节点之间的转换也更加灵活。
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公开(公告)号：CN108519090B
公开(公告)日：2021-08-20
申请号：CN201810256124.4
申请日：2018-03-27
Applicant: 东南大学—无锡集成电路技术研究所
Abstract: 本发明提供了一种基于优化的UKF算法的双通道组合定姿算法的实现方法，包括步骤：步骤1：用加速度计与磁力计分别与陀螺仪组成滤波系统；通过MEMS九轴传感器采集九轴数据，并传输至主机端；步骤2：主机端通过UKF算法分别对陀螺仪/加速度计通道及陀螺仪/磁力计通道进行姿态解算，分别得到定姿系统的横滚角和俯仰角以及航向角；步骤3：将步骤2得到的定姿系统的横滚角和俯仰角以及航向角进行数据融合得到最终姿态。本发明针对常规的姿态解算系统，成功解决了速度、精度、稳定性之间的制约关系，在尽可能减少计算量的同时，提高了精度和系统稳定性。本发明提出的算法，使用全数字实现，且与平台无关，方式较为简单实用。
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公开(公告)号：CN111343614A
公开(公告)日：2020-06-26
申请号：CN201911421931.8
申请日：2019-12-31
Applicant: 东南大学
Abstract: 本发明公开了一种面向BLE主动扫描的快速发现机制，在一个信道发送广播包（ADV）后，可以休眠或者待机T_Sleep时间，然后无需等待扫描请求（SCAN_REQ）,直接发送扫描应答（SCAN_RSP）。本发明提出的强制扫描应答方式广播后，不需要对标准BLE扫描设备进行修改，这使得该机制能够与市场现有终端智能设备兼容；快速近邻发现的时间，不受BLE主动扫描设备数量的影响；多个请求扫描响应的BLE主动扫描设备可以同时获取BLE广播设备的扫描应答；BLE主动扫描设备甚至可以不需要退避算法，以进一步加快发现时间。能够有效提高密集BLE主动扫描设备网络的近邻发现性能，特别是少量广播设备，但存在大量主动扫描设备的应用场景，并且在硬件上改动较小。
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Patent Agency Ranking
公开(公告)号：CN109274372A
公开(公告)日：2019-01-25
申请号：CN201811031296.8
申请日：2018-09-05
Applicant: 东南大学
Abstract: 本发明公开了一种TIADC系统通道间采样时刻失配误差提取方法，包括：向存在采样时刻失配的TIADC系统输入一个已知频率的测试单音正弦信号；对存在采样时刻失配的TIADC系统的各通道采样，得到各通道的数字输出信号；利用各通道的数字输出信号分别调制数字域的同频载波信号，得到各通道调制后的数字信号；对各通道调制后的数字信号分别进行取平均操作，得到各通道的数字信号平均值；根据各通道的数字信号平均值，利用反三角函数运算估计出各通道的采样时刻失配值，并由所得各通道数字输出信号减去得到各通道校准后的数字输出信号。本发明可以精确提取TIADC系统中存在的采样时刻失配值，对SNR和SFDR的改善程度显著并且估计速度快，具有良好的有效性、广泛性和实用性。
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公开(公告)号：CN105045722B
公开(公告)日：2018-06-05
申请号：CN201510530922.8
申请日：2015-08-26
Applicant: 东南大学
IPC: G06F12/02
Abstract: 本发明公开了一种用于高性能RF自动测试平台的DDR2‑SDRAM控制器及相应的低延迟优化方法，该DDR2‑SDRAM控制器特点是，第一其并不将外部存储模组视为单个资源，而是根据DRAM模组的rank和bank结构，将存储器存储空间划为几个独立的逻辑资源，每个资源为一个有访存需求的任务私有，并在此基础上本发明设计了相应的仲裁方式和指令序列。第二是其改进了刷新机制，控制器在60个访存指令周期的结尾安排1个刷新周期，通过行访问刷新存储阵列中的指定行，将刷新时间化整为零，降低了访存请求和刷新请求冲突对访存延迟的影响。最终使得系统各任务的最大访存延迟性能得到比较大的改善。
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公开(公告)号：CN104270150B
公开(公告)日：2017-09-15
申请号：CN201410476642.9
申请日：2014-09-17
Applicant: 东南大学
IPC: H03M1/12
Abstract: 本发明公开了一种应用于流水线模数转换器的高速低功耗基准电压输出缓冲器，包括缓冲器反馈运放、共模反馈电路、输出缓冲器和电阻分压电路；电阻分压电路包括分压反馈运放、串联分压电阻和反馈尾电流管；输出缓冲器包括缓冲器和镜像电路；缓冲器反馈运放具有互补输入结构，缓冲器反馈运放与共模反馈电路相结合形成一个全差分运放，为正/负参考电平支路提供反馈回路，且将两个支路的尾电流合并。本发明在现有基准电压输出缓冲器基础上，对缓冲器反馈运放进行改进，通过互补型的输入结构，同时输入两个分压电路提供的参考电平以及两个反馈电平，将两个双输入单输出运放替换成经改进的全差分运放，且只使用一个缓冲器，节省了功耗以及芯片面积。
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公开(公告)号：CN104218949B
公开(公告)日：2017-09-15
申请号：CN201410441266.X
申请日：2014-09-01
Applicant: 东南大学
IPC: H03L7/18
Abstract: 本发明公开了一种适用于分数频率合成器的数字ΔΣ调制器结构，包括第一级误差反馈型调制器、反馈路径、第二级误差反馈型调制器以及误差抵消模块；反馈路径的输出与第一级调制器的输出之间的差值经过延迟单元后得到反馈路径的输出；经过噪声抑制增强单元的输入信号与经过滤波处理单元后的扰动信号之间的和值与反馈路径的输出之间的和值作为第一级误差反馈型调制器的输入；第一级误差反馈信号作为第二级误差反馈型调制器的输入；第一级误差反馈型调制器的输出与第二级误差反馈型调制器的输出经过误差抵消模块后得到整个调制器的输出。本发明引入反馈环路，实现了高阶噪声抑制、减小了输出量化电平的数目，降低了整体电路设计复杂度和功耗。
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公开(公告)号：CN105305968B
公开(公告)日：2017-05-31
申请号：CN201510786670.5
申请日：2015-11-16
Applicant: 东南大学
IPC: H03D7/16
CPC classification number: H03D7/16
Abstract: 本发明公开了一种自重构返回式混频器，包括自重构跨导级，输入的射频电压信号经过自重构跨导级转化为射频电流，射频电流经过下变频和低通滤波转化为中频信号，中频信号反馈回自重构跨导级；自重构跨导级对输入的射频电压信号呈现出开环结构，自重构跨导级对反馈的中频信号呈现出负反馈放大器的拓扑结构。本发明提出的自重构跨导级电路，在为射频信号提供高带宽的同时，实现了高线性度的中频增益；有效缓解了传统返回式结构中转换增益和中频线性度之间的矛盾。
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