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公开(公告)号：CN101719116B
公开(公告)日：2011-09-28
申请号：CN200910154752.2
申请日：2009-12-03
Applicant: 浙江大学
IPC: G06F15/167
Abstract: 本发明公开了一种共享存储式多处理器系统，包括2个以上的处理器，还包括存储器以及总线/片上网络，总线/片上网络的一端与每个处理器相连、总线/片上网络的另一端与存储器相连；在每个处理器内分别设置一个事务读写缓存和一个事务属性缓存；在处理器内设置与每个处理器相对应的处理器局部缓存。本发明还同时公开了利用上述共享存储式多处理器系统进行的基于异常处理的事务存储访问机制实现方法，其设置5种异常机制，分别为：事务初始异常机制、事务满异常机制、事务读写异常机制、事务提交异常机制和事务重启异常机制。本发明用于解决事务存储实现时的缓存溢出问题。
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公开(公告)号：CN101227486B
公开(公告)日：2010-11-17
申请号：CN200810059579.3
申请日：2008-02-03
Applicant: 浙江大学
Abstract: 本发明公开了一种适合于多处理器片上网络的传输协议，适用于片上网络节点间的数据传输，包括下列四类传输过程：过程一、主请求发送；过程二、主请求接收；过程三、从请求发送；过程四、从请求接收。本发明的适合于多处理器片上网络的传输协议，主要用于多处理器片上网络的节点间的数据传输。
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公开(公告)号：CN101365133B
公开(公告)日：2010-09-01
申请号：CN200810120837.4
申请日：2008-09-18
Applicant: 浙江大学
Abstract: 本发明公开了一种DCT域插值舍入误差补偿方法，该方法包括输入DCT域插值后的插值块；判断插值块的各像素的水平和垂直方向运动矢量的指向，将插值块分为水平插值块、垂直插值块和双向插值块；判断插值块的水平粗糙度和垂直粗糙度，确定插值块的类型；根据插值块的类型确定各个类型对应的DCT直流系数补偿值；分别对各个类型的插值块进行DCT直流系数补偿，补偿后的插值块与残差相加完成DCT域块重建五个步骤。本发明方法引入DCT域插值块的平滑性判决，给予DCT域平滑块和粗糙块不同的补偿值，抑制DCT域图像重建中的误差扩散现象，获得更好的DCT域双线性半像素插值舍入补偿效果，提高DCT域重建图像质量。
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公开(公告)号：CN100592255C
公开(公告)日：2010-02-24
申请号：CN200710071565.9
申请日：2007-10-09
Applicant: 浙江大学
IPC: G06F9/38
Abstract: 本发明公开了一种32位的多模式微处理器，该处理器核以两条六级流水线PIPE 1和PIPE 2结构为基础，PIPE 1和PIPE 2均包括取指、译码、执行、访存、TAG比较和回写这六个流水级；此处理器支持3种运行模式：双核模式、双发射模式或双线程模式；在双核模式下，处理器在微结构上分开，是两个高性能的单发射处理器；在双发射模式下，处理器在微结构上合拢，是一个高性能的双发射精简指令集计算机处理器；在双线程模式下，处理器是一个介于细粒度和同时多线程技术之间“伪”SMT处理器，此时处理器可以支持两种运行方式。使用本发明的微处理器，能根据应用的特点配置成不同的运行模式。
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公开(公告)号：CN100565472C
公开(公告)日：2009-12-02
申请号：CN200710164584.6
申请日：2007-12-11
Applicant: 浙江大学
Abstract: 本发明公开了一种适用于多处理器核系统芯片的调试方法：用一个运行在宿主机上的虚拟主控处理器核模块(111)来模拟一个主控处理器和调试控制站程序，负责发送和接收命令，控制多处理器核系统芯片的调试，发送调试命令给物理的每个处理器核上的运行调试服务站模块(131)，并接收回复信息到运行在宿主机上的带有图形化界面的软件调试器(110)。本发明方法占用较小的硬件资源，利用软件来进行调试，可移植性强，适用于多处理器核系统芯片/片上网络平台调试。
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Patent Agency Ranking
公开(公告)号：CN100514284C
公开(公告)日：2009-07-15
申请号：CN200710070104.X
申请日：2007-07-20
Applicant: 浙江大学
IPC: G06F9/38
Abstract: 本发明公开了一种内设集中式程序转移计算装置的微处理器，包含六级流水线，该六级流水线按顺序为：取指令和计算新的PC值的IF流水级模块；进行指令译码，并且从寄存器文件中读取数据的ID流水级模块；实现ALU操作、MAC操作、DIV操作的EX流水级模块；实现存储器访问，从存储器中读取数据的DM流水级模块；进行标志比较，实现cache的标志比较操作以及部分字的对齐写操作的TC流水级模块；将ALU或者Load指令的输出结果写入寄存器文件的WB流水级模块；还包括一种集中处理汇编程序的程序正常转移、绝对跳转转移、条件跳转转移、异常处理转移四种不同的程序转移方式的集中式程序转移计算装置。本发明的微处理器能够精简指令集。
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公开(公告)号：CN101227486A
公开(公告)日：2008-07-23
申请号：CN200810059579.3
申请日：2008-02-03
Applicant: 浙江大学
Abstract: 本发明公开了一种适合于多处理器片上网络的传输协议，适用于片上网络节点间的数据传输，包括下列四类传输过程：过程一、主请求发送；过程二、主请求接收；过程三、从请求发送；过程四、从请求接收。本发明的适合于多处理器片上网络的传输协议，主要用于多处理器片上网络的节点间的数据传输。
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公开(公告)号：CN101089809A
公开(公告)日：2007-12-19
申请号：CN200710070104.X
申请日：2007-07-20
Applicant: 浙江大学
IPC: G06F9/38
Abstract: 本发明公开了一种内设集中式程序转移计算装置的微处理器，包含六级流水线，按顺序为：取指令和计算新的PC值的IF流水级模块；进行指令译码，并且从寄存器文件中读取数据的ID流水级模块；实现ALU操作、MAC操作、DIV操作的EX流水级模块；实现存储器访问，从存储器中读取数据的DM流水级模块；进行标志比较，实现cache的标志比较操作以及部分字的对齐写操作的TC流水级模块；将ALU或者Load指令的输出结果写入寄存器文件的WB流水级模块；还包括一种集中处理汇编程序的程序正常转移、绝对跳转转移、条件跳转转移、异常处理转移四种不同的程序转移方式的集中式程序转移计算装置。本发明的微处理器能够精简指令集。
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公开(公告)号：CN102629913B
公开(公告)日：2014-12-24
申请号：CN201210104961.8
申请日：2012-04-11
Applicant: 浙江大学
IPC: H04L12/771
Abstract: 本发明公开了一种适用于全局异步局部同步片上互连网络的路由器装置，具有3个流水级，在BW/RC级对微片进行缓存和时钟域的转换，并利用时钟域转换的延迟对数据包进行路由计算和对计算结果的同步；在VA/SA级以投机的方式同时对虚通道和交叉开关的使用权进行申请，虚通道分配器对虚通道请求做出仲裁，交叉开关分配器只对非投机微片的交叉开关请求进行仲裁，并直接将虚通道请求的仲裁结果直接做为微片投机申请交叉开关的仲裁结果，交叉开关分配器优先选择非投机交叉开关请求的仲裁结果做为最终的交叉开关分配结果；在ST级，交叉开关选择器根据交叉开关的仲裁结果，连通相应虚通道的输入端口至输出端口，微片离开异步缓存通过路由器。
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