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公开(公告)号：CN1601474A
公开(公告)日：2005-03-30
申请号：CN200410011719.1
申请日：2004-09-24
Applicant: 株式会社东芝
CPC classification number: G06F9/4881
Abstract: 一个信息处理系统在一个特定时间间隔内执行多个任务。该系统包括：一条总线；多个通过总线传输数据的处理器；以及用于执行一个时序安排操作的一个单元，该时序安排操作根据关于执行每个任务所需的一个时间的花费信息和关于每个任务所需的一个数据传输带宽的带宽信息确定每个任务的执行开始时间以及至少一个执行任务的处理器，以便在不交叠任务中的至少两个任务的执行期的情况下在特定时间间隔内执行任务，这两个任务要求的数据传输带宽不小于其他任务要求的数据传输带宽。
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公开(公告)号：CN1581023A
公开(公告)日：2005-02-16
申请号：CN200410057495.8
申请日：2004-08-13
Applicant: 株式会社东芝
CPC classification number: G06F9/4887 , G06F1/3203 , G06F1/324 , G06F1/3275 , G06F1/3287 , G06F1/329 , G06F1/3296 , Y02D10/126 , Y02D10/13 , Y02D10/14 , Y02D10/171 , Y02D10/172 , Y02D10/24
Abstract: 一种以特定时间间隔定期执行实时操作的信息处理系统。所述系统包括执行把实时操作分配给一个处理器，以便该处理器以特定时间间隔定期执行实时操作的调度操作的单元；根据特定的时间间隔和关于处理器以第一运算速度执行实时操作所需时间的成本信息，计算处理器以第一运算速度执行实时操作的执行时间与每个特定时间间隔的比值的单元；和执行运算速度控制操作，以低于第一运算速度的第二运算速度运转处理器的单元，根据计算的比值，确定所述第二运算速度。
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公开(公告)号：CN1577311A
公开(公告)日：2005-02-09
申请号：CN200410007303.2
申请日：2004-02-27
Applicant: 株式会社东芝
CPC classification number: G06F9/50 , G06F9/45533
Abstract: 本发明公开了一种调度方法，实时处理系统利用称作密结合线程组的线程组的属性，判别线程组是否为包含彼此协调工作的线程群的密结合线程组。当判断为线程组是密结合线程组时，实时处理系统为了使属于密结合线程组的线程群分别由不同的处理器(VPU)来同时执行，而执行用于把属于密结合线程组的线程群分别分配给该线程群个数的处理器(VPU)的调度处理。能高效地进行彼此协调工作的线程之间的数据交换。
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公开(公告)号：CN1577281A
公开(公告)日：2005-02-09
申请号：CN200410007301.3
申请日：2004-02-27
Applicant: 株式会社东芝
IPC: G06F9/50
CPC classification number: G06F9/4881 , G06F9/5066
Abstract: 本发明公开了一种调度方法，程序模块(100)包含记录与多个处理要素分别对应的步骤的多个程序(111～116)、构成记述信息(117)。构成记述信息(117)表示多个程序(111～116)间的输入输出关系和各程序(111～116)的执行所需的成本。在程序模块(100)的执行时，通过根据构成记述信息(117)决定执行多个程序(111～116)的多个线程各自的执行开始时刻和执行期间，执行把多个线程分别分配给1以上的处理器的调度处理。在程序的代码中不详细记述各种处理的时间制约条件，高效地调度用于实时处理的线程群。
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公开(公告)号：CN102163179B
公开(公告)日：2015-05-06
申请号：CN201110038959.0
申请日：2011-02-16
Applicant: 株式会社东芝
CPC classification number: G06F12/0246 , G06F2212/7205
Abstract: 本发明涉及半导体存储器装置。根据一个实施例，一种半导体存储器装置根据日志结构方法进行以下写入：响应于来自主机的写入具有特定的逻辑块地址的数据的请求而将数据写入半导体存储器元件，以及为了压缩而将有效数据写入所述半导体存储器元件。所述半导体存储器装置根据预定的比率调整响应于来自所述主机的请求的写入的频率和用于压缩的写入的频率。
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Patent Agency Ranking
公开(公告)号：CN102436353B
公开(公告)日：2014-08-13
申请号：CN201110254447.8
申请日：2011-08-31
Applicant: 株式会社东芝
IPC: G06F3/06
CPC classification number: G06F12/0246 , G06F12/1009 , G06F2212/7201 , G06F2212/7205
Abstract: 本发明涉及半导体存储器控制装置。根据一个实施例，在信息处理器请求时，半导体存储控制器将预定单位的数据段写入在半导体芯片的存储区内的擦除区域中的没有数据被写入的存储位置中。第三表以及作为其子集的第二表包括各自指示所述半导体芯片内的每个数据段的存储位置的物理地址。第一表包括指定第二表表目的信息或指定第三表表目的信息。所述半导体存储控制器将所述第一和第二表记录到易失性存储器中，或者将所述第一表记录到易失性存储器中且将所述第三表记录到非易失性存储器中。
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公开(公告)号：CN102193748B
公开(公告)日：2014-01-01
申请号：CN201110048761.0
申请日：2011-03-01
Applicant: 株式会社东芝
CPC classification number: G06F12/0246 , G06F3/0608 , G06F3/061 , G06F3/0611 , G06F3/0631 , G06F3/0638 , G06F3/064 , G06F3/0644 , G06F3/0659 , G06F3/0665 , G06F3/0679 , G06F3/0688 , G06F12/00 , G06F12/16 , G06F2212/1016 , G06F2212/214 , G06F2212/7202 , G06F2212/7205
Abstract: 本发明涉及控制器、数据存储装置以及程序产品。根据一个实施例，写指令单元指令数据存取单元在数据存储单元的由第一物理地址指示的存储区中写入写目标数据，指令管理信息存取单元更新地址转换信息，并指令第一存取单元更新所述第一物理地址。压缩单元提取压缩目标数据的物理地址，指令所述数据存取单元读取在所述数据存储单元的由所述物理地址指示的存储区中所存储的所述压缩目标数据，指令所述数据存取单元在所述数据存储单元的由第二物理地址指示的存储区中写入所述压缩目标数据，指令所述管理信息存取单元更新所述地址转换信息，并指令第二存取单元更新所述第二物理地址。
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公开(公告)号：CN101840307A
公开(公告)日：2010-09-22
申请号：CN200910172876.3
申请日：2009-09-07
Applicant: 株式会社东芝
CPC classification number: G06F12/0246 , G06F2212/7207 , G06F2212/7209
Abstract: 本发明涉及控制器和存储器系统。一种控制器(10；110)包括：用于转译表的存储器(32)，该转译表表明闪速存储器(11)中的逻辑地址和物理地址的彼此相对应；存储FAT信息和FAT信息标识符的另一存储器(34)，该FAT信息指示在每一个块中包含的每一个页中所存储的数据的状态，每一个FAT信息标识符识别这样的页所属于的块，这些页中的每一个都在其中存储有处于由FAT信息所指示的状态的数据，同时FAT信息和FAT信息标识符保持彼此对应；用于块管理表的又一存储器(36)，该块管理示出块标识符、使用状态判断信息以及FAT信息标识符且保持它们彼此相对应，其中使用状态判断信息指示对应的块为已使用/未使用，FAT信息标识符与通过使用状态判断信息指示为已使用的所有块相对应；以及控制器控制单元(28；128)，其通过使用转译表、FAT信息以及块管理表来管理在闪速存储器(11)中存储的数据。
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公开(公告)号：CN100416540C
公开(公告)日：2008-09-03
申请号：CN200410007302.8
申请日：2004-02-27
Applicant: 株式会社东芝
CPC classification number: G06F9/544 , G06F9/5016
Abstract: 本发明公开了一种信息处理系统，在多个处理器(LS0、LS1、LS2)中分别设置局部存储器(LS0、LS1、LS2)，各线程即使不访问共享存储器，只通过访问处理器内的局部存储器就能执行程序。另外，按照执行进行相互作用的对方线程的处理器，自动变更映射到有效地址EA空间上的与对方线程对应的处理器的局部存储器，所以各线程不用考虑分配对方线程的处理器就能高效地进行与对方线程的相互作用。因此，能高效地并行执行多个线程，实现使用多个处理器来高效地并行执行多个线程的系统。
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公开(公告)号：CN101042682A
公开(公告)日：2007-09-26
申请号：CN200710084379.9
申请日：2007-02-28
Applicant: 株式会社东芝
CPC classification number: G06F12/1466 , G06F11/1016 , G06F12/1408 , G06F21/79
Abstract: 一种访问控制装置，包括：写入方校正子生成器，其生成写入方掩码数据的写入方校正子以对添加了奇偶校验码的数据进行掩码，所述写入方校正子与当所述写入方访问所述存储器时使用的写入方访问ID相关联，所述写入方请求将所述写数据写入所述存储器；写掩码生成器，其根据所述写入方校正子、所述写入方访问ID以及所述写入方在所述存储器中写入所述写数据的写地址来生成所述写入方掩码数据；第一XOR计算器，其通过计算所述添加了奇偶校验码的数据与所述写入方掩码数据之间的XOR来获得第一运算后数据；写地址转换器，其将所述写地址转换为根据所述写入方访问ID确定的另一个地址。
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