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公开(公告)号：CN116112785A
公开(公告)日：2023-05-12
申请号：CN202310169202.8
申请日：2023-02-27
Applicant: 之江实验室
IPC: H04N23/617 , H04N23/73
Abstract: 本发明公开一种基于FPGA的图像传感器帧率控制系统及控制方法，系统包含图像传感器和FPGA芯片；FPGA芯片包括曝光时间设置模块、帧率计算和控制模块。该方法包含如下步骤：在FPGA内部设置目标帧率，通过目标帧率计算出产生一张目标图像所需要的时间；根据FPGA提供给传感器的实际时钟频率，计算实际产生一张图像所需要的时间；在FPGA内部设定曝光时间；将曝光时间和实际产生一张图片的时间相加与目标时间做对比，如果目标时间大于上述的相加和，可以直接进行图像输出，如果目标时间小于上述描述的相加和，通过调整传感器的ROI区域来降低实际产生图片的时长，以满足目标时间。本发明能够更加灵活的控制图像帧率，大大方便了该图像传感器在不同帧率场景下的使用。
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公开(公告)号：CN113536228B
公开(公告)日：2021-12-24
申请号：CN202111083549.8
申请日：2021-09-16
Applicant: 之江实验室
IPC: G06F17/16
Abstract: 本发明公开一种矩阵奇异值分解的FPGA加速实现方法，该方法首先将存储在片外DRAM的m行×n列的矩阵，按每k列列向量一组平均分成p=n/k个子块，对p个子块按顺序两两交替组合，得到m行×2k列的小尺寸矩阵并写入到FPGA内部BRAM，进一步地执行单边Jacobi旋转变换，所得计算结果中的一半列向量写回片外DRAM，另一半列向量则与下一个子块继续组合得到新的m行×2k列矩阵，在FPGA上重复执行前述操作，直至p个子块两两组合均执行一整轮的单边Jacobi旋转变换；对上述操作执行多次，直至收敛条件满足，即m行×n列大尺寸矩阵奇异值分解完毕。本发明采用分而治之的分解策略和子块间交替组合的实现方式，提高了数据复用率，减少了频繁的数据搬移，减轻了片内外数据传输带宽压力。
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公开(公告)号：CN112632465B
公开(公告)日：2021-06-01
申请号：CN202110246334.7
申请日：2021-03-05
Applicant: 之江实验室
IPC: G06F17/16
Abstract: 本发明公开一种基于FPGA的实对称矩阵特征值分解的数据存储方法，该方法充分利用上三角结构阵列从上到下每行存储的数据个数线性递减，存在接近一半的存储空闲，采用RAM互补存储结构替代常见的乒乓结构，将空闲存储充分利用，从而实现了节省接近原来一半的RAM存储资源的效果。此外，将每行元素的寻址地址从右往左排序以取代通常的从左至右排序，保留了原有实对称矩阵的行列交换规律，利于上三角阵列结构经Jacobi旋转计算后行列数据交换规律的数字电路实现。本发明对于大尺寸矩阵的特征值分解，可以降低外部DDR的访存次数，甚至将整体算法完全部署到FPGA内部实现，从而显著提高实对称矩阵特征值分解的效率。
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公开(公告)号：CN113709666B
公开(公告)日：2023-12-15
申请号：CN202111022586.8
申请日：2021-09-01
Applicant: 之江实验室
Abstract: 本发明公开了一种提高蓝牙定位基站到达角计算精度和稳定性的方法及系统，该方法中蓝牙基站通过合理布局接收天线，同时满足形成均匀圆形和均匀线形接收天线阵列的条件，利用两种天线阵列以分时复用方式切换接收蓝牙信标发送的数据包，计算出信标的真实到达角。进一步的，该方法通过设计十字型交叉极化天线，从不同极化方向接收的信标数据包中选取信噪比较高的一组，从而增强基站对不同方向的蓝牙信号的接收能力，提升信标到达角的计算精度。本发明通过使用不同极化方向的天线阵列接收信标的数据包，克服了单一极化的天线阵列基站在复杂环境下测得的信标到达角波动较大的问题，提高了基站对信标的定位精度。
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公开(公告)号：CN117037871A
公开(公告)日：2023-11-10
申请号：CN202311298426.5
申请日：2023-10-09
Applicant: 之江实验室
IPC: G11C11/22
Abstract: 本申请涉及一种存内计算结果的读出电路、读出方法及存储器，该电路包括依次连接的钳位电路、电流镜电路、放大电路以及模数转换电路，钳位电路、电流镜电路与铁电存储阵列的位线连接，模数转换电路与控制器连接；钳位电路用于将位线的电压锁定为预设电压；电流镜电路用于基于预设电压对位线的电流进行采样，并转换为对应的采样电压；放大电路用于放大采样电压；模数转换电路用于将放大处理后的采样电压进行模数转换，得到转换电压并发送至控制器，控制器基于转换电压得到对应的存内计算结果，解决了相关技术中存在的通过读取铁电存储阵列的源线电流得到存内计算结果准确度较低的问题。
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Patent Agency Ranking
公开(公告)号：CN116680510A
公开(公告)日：2023-09-01
申请号：CN202310519879.X
申请日：2023-05-10
Applicant: 之江实验室
IPC: G06F17/16
Abstract: 本发明公开了一种基于FPGA的对称矩阵脉动阵列LDL分解器，该分解器通过以下方法获取：首先基于LDL分解的基本分解公式进行分解，以获取对角矩阵对应的对角向量D、下三角矩阵L和三个中间变量；然后将脉动阵列设计成三维阵列的形式，输入对称矩阵，以获取脉动阵列运行时的顺序结构；再对脉动阵列中的所有节点进行模块化设计，以获取基础模块，其中边界节点的输入单独设计；最后按照脉动阵列运行时的顺序结构对基础模块进行调用与连接，以构建LDL分解器。本发明通过五种基础模块实现一个可扩展的LDL分解器，能够逐列以并行流水线形式完成对称矩阵的连续输入输出，同时可以根据使用要求修改对称矩阵的尺寸以适用不同的应用环境。
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公开(公告)号：CN116456093A
公开(公告)日：2023-07-18
申请号：CN202310364151.4
申请日：2023-03-31
Applicant: 之江实验室
IPC: H04N19/149
Abstract: 本发明公开了一种基于Zynq的图像帧率可控模拟器和方法，所述模拟器包括存储器、Zynq芯片和内存；所述Zynq芯片包括PS和PL；所述存储器，用来为PS提供图像数据；所述PS，用来读取存储器中的图像数据，并将所述图像数据存储在内存中；所述PL，用来控制图像的帧率，根据所需帧率，将内存中的数据进行读取以及输出。本发明采用zynq芯片，zynq芯片内部集成了cpu和FPGA，减少片外互联之间的链路不稳定性，更具有可靠性，更加小型化，轻量化，便于携带，降低开发难度，增加了扩展数据库的功能。
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公开(公告)号：CN116170601A
公开(公告)日：2023-05-26
申请号：CN202310451246.X
申请日：2023-04-25
Applicant: 之江实验室
IPC: H04N19/423 , H04N19/436 , H04N19/176
Abstract: 本发明公开一种基于四列列向量分块奇异值分解的图像压缩方法，该方法中待压缩图像以矩阵形式输入，每四列图像元素为一组进行平均分块，一列图像元素对应一列列向量，对每一块内的四列列向量进行两两组合，并分别计算各种组合对应的二阶范数以及单位向量内积，根据单位列向量内积大小，决定最终组合方式以及数据源头交换规则；并执行单边雅克比旋转计算操作；与列向量输入数据源头交换规则相一致，单边雅克比计算更新的结果输出也按照相应规则写回并覆盖原有的列向量数据。本发明可实现矩阵奇异值分解的图像压缩过程低效计算行为减少、收敛速度加快以及并行计算效率提升。
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公开(公告)号：CN115033843A
公开(公告)日：2022-09-09
申请号：CN202210948609.6
申请日：2022-08-09
Applicant: 之江实验室
Abstract: 本发明公开一种基于三角脉动阵列的协方差矩阵计算的电路实现方法，该方法对协方差计算公式执行转换处理，使之适于数字电路并行计算；根据三角脉动阵列尺寸，对待求协方差矩阵进行分块，从而定制行—列“Z”型交织寻址方式的数据结构，为三角脉动阵列并发同步提供操作数输入；脉动阵列为三角形结构，包含对角线处理单元和内部普通处理单元，对角线处理单元包含列向量乘累加与列向量求和功能且有三种工作模式，内部普通处理单元不含列向量求和功能，所有处理单元在同一时钟下以脉动方式并行流水线工作。本发明适合于各种尺寸规模的协方差矩阵计算，尤其是基于数字电路方式实现的协方差矩阵计算。
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公开(公告)号：CN113709666A
公开(公告)日：2021-11-26
申请号：CN202111022586.8
申请日：2021-09-01
Applicant: 之江实验室
Abstract: 本发明公开了一种提高蓝牙定位基站到达角计算精度和稳定性的方法及系统，该方法中蓝牙基站通过合理布局接收天线，同时满足形成均匀圆形和均匀线形接收天线阵列的条件，利用两种天线阵列以分时复用方式切换接收蓝牙信标发送的数据包，计算出信标的真实到达角。进一步的，该方法通过设计十字型交叉极化天线，从不同极化方向接收的信标数据包中选取信噪比较高的一组，从而增强基站对不同方向的蓝牙信号的接收能力，提升信标到达角的计算精度。本发明通过使用不同极化方向的天线阵列接收信标的数据包，克服了单一极化的天线阵列基站在复杂环境下测得的信标到达角波动较大的问题，提高了基站对信标的定位精度。
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