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公开(公告)号：CN111694514B
公开(公告)日：2024-06-18
申请号：CN202010165077.X
申请日：2020-03-11
Applicant: 三星电子株式会社
Abstract: 一种存储器设备包括：存储器存储体，其包括至少一个存储体组；存储器中处理器(PIM)电路，包括被布置为与存储体组相对应的第一处理元件，其通过使用由主机提供的数据和从存储体组读出的数据中的至少一个来处理运算；处理元件输入和输出(PEIO)选通电路，其被配置为控制被布置为与存储体组中的每个存储体相对应的存储体局部IO和被布置为与存储体组相对应的存储体组IO之间的电连接；以及控制逻辑，其被配置为执行控制操作，使得执行对存储器存储体的存储器操作或者由PIM电路处理运算。当运算由第一处理元件处理时，PEIO选通电路阻断存储体局部IO和存储体组IO之间的电连接。
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公开(公告)号：CN111694513A
公开(公告)日：2020-09-22
申请号：CN202010165017.8
申请日：2020-03-11
Applicant: 三星电子株式会社
Abstract: 一种存储器器件包括：存储器存储体，包括一个或多个存储体阵列；PIM电路，被配置为执行运算逻辑处理操作；以及指令存储器，包括被配置在循环指令队列中以存储由主机提供的指令的第一指令队列段至第m指令队列段，其中存储在第一指令队列段至第m指令队列段中的指令响应于来自主机的操作请求而执行，并且由主机提供的每个新的指令被更新在循环指令队列中的完全执行的指令上。
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公开(公告)号：CN111679785A
公开(公告)日：2020-09-18
申请号：CN202010147089.X
申请日：2020-03-05
Applicant: 三星电子株式会社
IPC: G06F3/06
Abstract: 提供了用于处理操作的存储器装置、包括该存储器装置的数据处理系统以及操作该存储器装置的方法。存储器装置包括具有存储体的存储器、存储器内置处理器(PIM)电路和控制逻辑。PIM电路包括指令存储器，该指令存储器存储从主机提供的至少一条指令。PIM电路被配置为使用由主机提供的数据或从存储体读取的数据来处理操作，并存储由主机提供的至少一条指令。控制逻辑被配置为对从主机接收的命令/地址进行解码以生成解码结果，并基于解码结果执行控制操作以便进行以下各项之一：i)执行对存储体的存储器操作，和ii)PIM电路执行处理操作。响应于指示执行处理操作的命令/地址，控制指示指令存储器的位置的程序计数器的计数值。
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公开(公告)号：CN118038953A
公开(公告)日：2024-05-14
申请号：CN202311095064.X
申请日：2023-08-29
Applicant: 三星电子株式会社
IPC: G11C29/42
Abstract: 提供存储器装置、电子装置和存储器装置的操作方法。存储器装置包括多个存储器芯片。多个存储器芯片中的每一个包括多个存储器分块和基于从主机接收的第一命令和第一地址对存储在多个存储器分块中的数据执行读操作的逻辑电路。当在接收第一命令和第一地址之前存储有PIM指令集时，逻辑电路被配置为执行PIM命令执行操作。当发生与PIM命令执行操作相关联的错误时，逻辑电路被配置为生成错误数据，并且通过第一通道在日志寄存器记录错误数据。逻辑电路被配置为在第一操作模式下将指示存在错误数据的事件数据输出至主机。逻辑电路被配置为在第二操作模式中将错误数据输出至主机。
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Patent Agency Ranking
公开(公告)号：CN109685198B
公开(公告)日：2024-04-05
申请号：CN201811153487.1
申请日：2018-09-29
Applicant: 三星电子株式会社
IPC: G06N3/0495 , G06N3/042 , G06N3/048
Abstract: 提供了一种由神经网络量化装置执行的量化神经网络的参数的方法，该方法包括：获得在学习或推断神经网络时使用的浮点格式的参数；应用定点格式的小数长度，以及为了根据量化后要被丢弃的比特值之中的最高有效比特来确定是否舍入定点，通过使用整数算术逻辑单元(ALU)来执行运算；以及基于该运算的结果，将浮点格式的参数量化为定点格式的参数。
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公开(公告)号：CN116417031A
公开(公告)日：2023-07-11
申请号：CN202211651583.5
申请日：2022-12-21
Applicant: 三星电子株式会社
Abstract: 提供了一种存储器件。所述存储器件包括：存储器存储体，所述存储器存储体包括多个存储体，所述多个存储体中的每个存储体包括存储单元；以及PIM(存储器中处理)电路，所述PIM电路包括多个PIM块，每个所述PIM块包括算术逻辑单元(ALU)和地址生成单元，所述ALU被配置为使用从所述多个存储体中的至少一个存储体获取的内部数据来执行算术运算。所述多个PIM块包括分配给至少一个第一存储体的第一PIM块和分配给至少一个第二存储体的第二PIM块。所述第一PIM块的所述地址生成单元被配置为针对所述至少一个第一存储体生成第一内部行地址，并且所述第二PIM块的所述地址生成单元被配置为针对所述至少一个第二存储体生成第二内部行地址。
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公开(公告)号：CN115862704A
公开(公告)日：2023-03-28
申请号：CN202210920554.8
申请日：2022-08-02
Applicant: 三星电子株式会社
IPC: G11C11/4096
Abstract: 提供了存储器装置。所述存储器装置包括：存储器单元阵列；存储器中处理(PIM)电路，被配置为执行处理操作；以及控制逻辑电路，被配置为控制正常模式和内部处理模式。控制逻辑电路在内部处理模式下将通过PIM电路的处理操作获得的操作结果写入存储器单元阵列中，并且将从存储器单元阵列读取的读取数据提供给PIM电路。
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公开(公告)号：CN111258495A
公开(公告)日：2020-06-09
申请号：CN201910840521.0
申请日：2019-09-05
Applicant: 三星电子株式会社
Abstract: 一种半导体存储器设备包括：多个存储体组，被配置为被并行访问；内部存储器总线，被配置为从多个存储体组的外部接收外部数据；以及第一计算电路，被配置为：在多个第一周期中的每个第一周期期间从多个存储体组中的第一存储体组接收内部数据，在多个第二周期中的每个第二周期期间通过内部存储器总线来接收外部数据，第二周期短于第一周期，并且在每个第二周期期间针对内部数据和外部数据执行存储器中处理(PIM)算术运算。
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公开(公告)号：CN111679785B
公开(公告)日：2025-03-11
申请号：CN202010147089.X
申请日：2020-03-05
Applicant: 三星电子株式会社
IPC: G06F3/06
Abstract: 提供了用于处理操作的存储器装置、包括该存储器装置的数据处理系统以及操作该存储器装置的方法。存储器装置包括具有存储体的存储器、存储器内置处理器(PIM)电路和控制逻辑。PIM电路包括指令存储器，该指令存储器存储从主机提供的至少一条指令。PIM电路被配置为使用由主机提供的数据或从存储体读取的数据来处理操作，并存储由主机提供的至少一条指令。控制逻辑被配置为对从主机接收的命令/地址进行解码以生成解码结果，并基于解码结果执行控制操作以便进行以下各项之一：i)执行对存储体的存储器操作，和ii)PIM电路执行处理操作。响应于指示执行处理操作的命令/地址，控制指示指令存储器的位置的程序计数器的计数值。
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