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公开(公告)号：CN118426976A
公开(公告)日：2024-08-02
申请号：CN202410889277.8
申请日：2024-07-04
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F9/50 , G06F12/1009 , G06F18/214
Abstract: 本发明公开了一种内存扩展系统、访问方法及设备、介质和计算机程序产品，涉及计算机技术领域，内存扩展系统包括N个图形处理器和N个现场可编程门阵列模组，现场可编程门阵列模组上挂载内存扩展模组，N个图形处理器环形连接，N个现场可编程门阵列模组环形连接，每个所述图形处理器连接k个现场可编程门阵列模组；现场可编程门阵列模组，用于接收内存访问请求；其中，内存访问请求包括与现场可编程门阵列模组连接的处理器和/或图形处理器和/或其他现场可编程门阵列模组发送的内存访问请求；内存扩展模组，用于响应内存访问请求。本发明实现了图形处理器的内存扩展，提升了图形处理器的处理性能。
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公开(公告)号：CN117806553A
公开(公告)日：2024-04-02
申请号：CN202311843443.2
申请日：2023-12-28
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F3/06 , G06F12/084 , G06F9/50 , G06F9/54
Abstract: 本发明涉及数据存储技术领域，公开了一种多源异构分布式系统、内存访问方法和存储介质，第一统一互连总线单元通过协议适配接口模块接收第一设备发送的读请求，将第一内存单元的缓存状态设置为无效状态；将读请求封装得到的请求报文发送至第二设备的第二统一互连总线单元。第二统一互连总线单元从第二内存单元中读取数据；将第二内存单元的缓存状态设置为共享状态，将响应报文发送至第一统一互连总线单元。第一统一互连总线单元将响应报文携带的数据存储至第一内存单元；将第一内存单元的缓存状态设置为共享状态。通过在每个设备上部署统一互连总线单元，实现各设备间的一致性内存通信，实现内存共享，提升了多源异构分布式系统的性能。
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公开(公告)号：CN117555836A
公开(公告)日：2024-02-13
申请号：CN202311576289.7
申请日：2023-11-23
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本发明公开了一种数据处理装置、系统及电子设备，涉及数据处理领域，为解决主机无法直接、高效地读写网卡设备的大容量内存的问题，该数据处理装置包括计算高速链路硬核模块，用于获取主机发送的任务请求，确定任务请求对应的目标内存访问模块，将任务请求下发至目标内存访问模块；支持计算高速链路协议的第一内存访问模块，用于直接对存储模块执行任务请求对应的操作；第二内存访问模块，用于根据任务请求从主机的内存中请求对应的数据帧，并基于接收到的数据帧对存储模块执行对应的操作。本发明能够使主机直接访问电子设备中的存储模块的传输层，无需映射到主机内存空间，降低对主机内存和带宽以及总线链路的带宽的占用。
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公开(公告)号：CN117421268A
公开(公告)日：2024-01-19
申请号：CN202311413029.8
申请日：2023-10-27
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本发明公开了计算机技术领域内的一种互联系统、设备及网络。在本发明中，互联设备通过自身的PCIE接口连接多个主机，以构成mesh拓扑的主机集群或crossbar拓扑的主机集群。由于互联设备的PCIE接口被配置为EP模式，因此可在不增加硬件成本的前提下借助此互联设备实现：互联设备所连的任意主机至互联设备的网络接口的数据通路、互联设备的网络接口至互联设备任意PCIE接口所连主机的数据通路、以及互联设备的不同PCIE接口所连主机之间的数据通路，而不用借助网卡和网络连接不同主机。
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公开(公告)号：CN112230880B
公开(公告)日：2023-08-11
申请号：CN202011148294.4
申请日：2020-10-23
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本申请公开了一种数据传输控制方法、装置、FPGA、介质，该方法包括：向接收端FPGA的第二kernel发送数据帧；接收所述第二kernel发送的ACK响应帧；根据所述ACK响应帧中的接收信用使用字段、帧响应序列号、接收端缓存剩余空间大小以及本地保存的发送信用消耗数据对本地数据发送端口的数据流量进行控制，其中，所述发送信用消耗数据表示所述第一kernel已向所述第二kernel发送的数据量。这样能够根据接收端的情况对发送端的数据传输进行自动控制，能够充分利用带宽，又不造成数据丢失。
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Patent Agency Ranking
公开(公告)号：CN115190175B
公开(公告)日：2023-07-14
申请号：CN202210840515.7
申请日：2022-07-18
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: H04L67/568 , H04L67/14 , H04L67/02 , H04L69/163 , H04L69/22
Abstract: 本申请公开了一种连接处理方法、系统、电子设备、服务器及可读存储介质，涉及服务器领域，该连接处理方法包括对接收到的客户端发送的TCP连接进行解析，得到客户端数据；将客户端数据存储到DDR中与TCP连接对应的预设存储空间，并判断预设存储空间中存储的客户端数据是否满足TLS处理条件；若是，对预设存储空间中存储的所有客户端数据进行TLS计算处理，将处理后的客户端数据发送至服务端；当接收到服务端反馈的服务端数据，对服务端数据进行TLS计算处理，将处理后的服务端数据封包发送至客户端。本申请能够减少设计复杂度，避免大量断包处理、状态存储及回读，同时释放了CPU资源，从而保证服务器性能。
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公开(公告)号：CN111177482A
公开(公告)日：2020-05-19
申请号：CN201911402930.9
申请日：2019-12-30
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F16/901 , G06F12/0811
Abstract: 本申请公开了一种图数据并行处理的方法，包括：获取图数据；对图数据中的源地址进行筛选，得到独立源地址；根据独立源地址确定对应的目的地址，并对目的地址进行筛选，得到独立目的地址；根据独立源地址和独立目的地址获取对应的独立源数据和独立目的数据，并对独立源数据和独立目的数据进行并行处理，得到并行处理结果。本申请不需要多个处理单元同时处理，仅需一个处理单元即可完成对图数据的并行处理，极大的降低图数据并行处理过程中的缓存开销及通信开销。本申请同时还提供了一种图数据并行处理的装置、设备及可读存储介质，具有上述有益效果。
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公开(公告)号：CN111046002A
公开(公告)日：2020-04-21
申请号：CN201911243266.8
申请日：2019-12-06
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F16/17
Abstract: 本申请提供一种图数据的压缩方法，包括：获取原始图数据并确定原始图数据中每条边的节点对；将节点对中的同一源节点按照预设分组规则分组；每个分组中保留一个源节点；根据每个分组的组类型存入对应的FIFO；对源节点的源节点数据和目的节点的目的节点数据添加标签；对FIFO进行轮询并存储，得到压缩图数据。本申请使得对应目的节点数量不同的源节点采用不同的压缩率，在同一分组内仅保留一个源节点，无需存储重复的源节点。可以支持图数据大规模并行解压缩，大幅增加图数据处理带宽。本申请还提供一种图计算系统的数据压缩系统、计算机可读存储介质和一种数据压缩终端，具有上述有益效果。
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公开(公告)号：CN118536073B
公开(公告)日：2024-09-20
申请号：CN202410986270.8
申请日：2024-07-23
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F18/25 , G06F7/50 , G06N20/00 , G06F17/16 , G06F18/213
Abstract: 本申请公开了计算机技术领域内的一种加速器、数据处理方法、设备、介质、程序产品及系统。本申请在加速器中实现特征矩阵的特征融合操作，加速器可完成特征矩阵的自动分割，并实现有乘加、累加等运算逻辑，支持任意尺寸的矩阵的输入；其中的第一存储器和第二存储器以乒乓方式进行子矩阵缓存，可实现多个子矩阵的并行数据读取与计算，且脉动阵列能够达到更快的运算效率，为提高特征融合操作的处理效率提供了可能。
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公开(公告)号：CN115190175A
公开(公告)日：2022-10-14
申请号：CN202210840515.7
申请日：2022-07-18
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: H04L67/568 , H04L67/14 , H04L67/02 , H04L69/163 , H04L69/22
Abstract: 本申请公开了一种连接处理方法、系统、电子设备、服务器及可读存储介质，涉及服务器领域，该连接处理方法包括对接收到的客户端发送的TCP连接进行解析，得到客户端数据；将客户端数据存储到DDR中与TCP连接对应的预设存储空间，并判断预设存储空间中存储的客户端数据是否满足TLS处理条件；若是，对预设存储空间中存储的所有客户端数据进行TLS计算处理，将处理后的客户端数据发送至服务端；当接收到服务端反馈的服务端数据，对服务端数据进行TLS计算处理，将处理后的服务端数据封包发送至客户端。本申请能够减少设计复杂度，避免大量断包处理、状态存储及回读，同时释放了CPU资源，从而保证服务器性能。
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