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公开(公告)号：CN108460184A
公开(公告)日：2018-08-28
申请号：CN201810070832.9
申请日：2018-01-24
Applicant: 三星电子株式会社
IPC: G06F17/50
CPC classification number: G05B19/4097 , G05B2219/45031 , G06F17/5072 , G06F2217/12 , Y02P90/265
Abstract: 一种制造包括标准单元的实例的集成电路(IC)的方法包括布置第一实例并布置与第一实例相邻的第二实例。所述第二实例具有与所述第一实例的场景组相对应的前端层图案。所述场景组包括与实例的前端层图案有关的信息，所述前端层图案在所述第一实例上引起相同的局部布局效应(LLE)并且与所述第一实例相邻地布置。
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公开(公告)号：CN108460184B
公开(公告)日：2023-08-08
申请号：CN201810070832.9
申请日：2018-01-24
Applicant: 三星电子株式会社
IPC: G06F30/392
Abstract: 一种制造包括标准单元的实例的集成电路(IC)的方法包括布置第一实例并布置与第一实例相邻的第二实例。所述第二实例具有与所述第一实例的场景组相对应的前端层图案。所述场景组包括与实例的前端层图案有关的信息，所述前端层图案在所述第一实例上引起相同的局部布局效应(LLE)并且与所述第一实例相邻地布置。
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Patent Agency Ranking
公开(公告)号：CN109508514B
公开(公告)日：2023-03-28
申请号：CN201910083553.0
申请日：2014-10-29
Applicant: 三星电子株式会社
IPC: G06F30/39 , G06F30/392 , H01L27/02 , H01L27/092 , H01L27/105 , H01L29/66
Abstract: 本发明公开了一种布局设计系统、一种布局设计方法和一种半导体装置。所述布局设计系统包括：处理器；存储单元，被配置为存储具有第一面积的第一单元设计，其中，在第一单元设计中，在第一单元设计的边界上未布置端子；以及设计模块，被配置为通过在第一单元设计的边界上布置端子来产生具有大于第一面积的第二面积的第二单元设计。
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公开(公告)号：CN107665268A
公开(公告)日：2018-02-06
申请号：CN201710628517.9
申请日：2017-07-28
Applicant: 三星电子株式会社
IPC: G06F17/50
CPC classification number: G06F17/5072 , G06F17/5077 , G06F17/5081 , G06F2217/12 , G06F2217/78 , G06F2217/82 , G06F2217/84
Abstract: 提供了通过考虑局部布局效应来设计集成电路(IC)的系统和方法。设计IC的方法可以放置预放置单元的实例以便减少局部布局效应(LLE)引起结构的发生。该方法可以从放置的每个实例的外围布局中提取实例的环境以估计实例的LLE，由此分析IC的性能。
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公开(公告)号：CN104657535B
公开(公告)日：2019-10-18
申请号：CN201410591856.0
申请日：2014-10-29
Applicant: 三星电子株式会社
Abstract: 本发明公开了一种布局设计系统、一种布局设计方法和一种半导体装置。所述布局设计系统包括：处理器；存储单元，被配置为存储具有第一面积的第一单元设计，其中，在第一单元设计中，在第一单元设计的边界上未布置端子；以及设计模块，被配置为通过在第一单元设计的边界上布置端子来产生具有大于第一面积的第二面积的第二单元设计。
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公开(公告)号：CN109508514A
公开(公告)日：2019-03-22
申请号：CN201910083553.0
申请日：2014-10-29
Applicant: 三星电子株式会社
IPC: G06F17/50 , H01L27/02 , H01L27/092 , H01L27/11 , H01L29/66
Abstract: 本发明公开了一种布局设计系统、一种布局设计方法和一种半导体装置。所述布局设计系统包括：处理器；存储单元，被配置为存储具有第一面积的第一单元设计，其中，在第一单元设计中，在第一单元设计的边界上未布置端子；以及设计模块，被配置为通过在第一单元设计的边界上布置端子来产生具有大于第一面积的第二面积的第二单元设计。
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公开(公告)号：CN104657535A
公开(公告)日：2015-05-27
申请号：CN201410591856.0
申请日：2014-10-29
Applicant: 三星电子株式会社
Abstract: 本发明公开了一种布局设计系统、一种布局设计方法和一种半导体装置。所述布局设计系统包括：处理器；存储单元，被配置为存储具有第一面积的第一单元设计，其中，在第一单元设计中，在第一单元设计的边界上未布置端子；以及设计模块，被配置为通过在第一单元设计的边界上布置端子来产生具有大于第一面积的第二面积的第二单元设计。
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