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公开(公告)号：CN109643277A
公开(公告)日：2019-04-16
申请号：CN201680088783.0
申请日：2016-09-26
申请人： 英特尔公司
发明人： 董耀祖
IPC分类号： G06F12/0802 , G06F9/455
CPC分类号： G06F12/1009 , G06F9/455 , G06F9/45558 , G06F12/1081 , G06F12/109 , G06F2009/45575 , G06F2009/45579 , G06F2009/45583 , G06F2212/151 , G06F2212/651
摘要： 描述了一种用于中介传递和共享存储器页合并的装置和方法。例如，一种方法的一个实施例包括：生成客户机存储器页组中的每一个客户机存储器页的页标识符(PI)，其中，相等的PI指示相应存储器页相同；在检测到第一客户机存储器页和第二客户机存储器页具有相等的PI时，将所述第一客户机存储器页和所述第二客户机存储器页合并成单个存储器页；检测所述第一客户机存储器页将用于直接存储器访问(DMA)操作；以及响应性地拆分所述第一客户机存储器页和所述第二客户机存储器页。
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公开(公告)号：CN108885588A
公开(公告)日：2018-11-23
申请号：CN201780016504.4
申请日：2017-02-24
申请人： 高通股份有限公司
IPC分类号： G06F12/0891 , G06F12/1027 , G06F12/1081 , G06F13/28
CPC分类号： G06F12/1027 , G06F3/0619 , G06F3/064 , G06F3/0659 , G06F3/0673 , G06F12/0891 , G06F12/1081 , G06F13/28 , G06F2212/1024 , G06F2212/1028 , G06F2212/683 , Y02D10/13
摘要： 公开了基于硬件的转译后备缓冲器(TLB)失效技术。主机系统被配置成与快速外围组件互连(PCIe)端点(EP)交换数据。作为硬件元件的存储器管理单元(MMU)被包括在主机系统中，以根据至少一个TLB提供地址转译。在一个方面，MMU被配置成响应于从PCIe EP接收到至少一个TLB失效命令而使至少一个TLB失效。在另一方面，PCIe EP被配置成确定需要使至少一个TLB失效，并且提供TLB失效命令以使至少一个TLB失效。通过在主机系统中实现基于硬件的TLB失效，可以减少TLB失效延迟，从而导致增加的数据吞吐量、降低的功耗和改善的用户体验。
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公开(公告)号：CN104750624B
公开(公告)日：2018-07-17
申请号：CN201410705574.9
申请日：2014-11-27
申请人： 英特尔公司
IPC分类号： G06F12/0815 , G06F13/16 , G06F13/32 , G06F13/40
CPC分类号： G06F9/52 , G06F3/0619 , G06F3/0661 , G06F3/0688 , G06F9/467 , G06F11/2017 , G06F12/0815 , G06F12/0817 , G06F12/1081 , G06F13/1663 , G06F13/32 , G06F13/4022 , G06F2212/1056 , G11C14/009
摘要： 本文描述一种提供数据一致性的装置。该装置包括全局持续存储器。使用包括输入/输出(I/O)语义和存储器语义的协议访问该全局持续存储器。该装置也包括反射存储器区。该反射存储器区是全局持续存储器的一部分，多个节点中的每个节点将该反射存储器区映射到不可高速缓存的空间中。进一步说，该装置包括信号量存储器。该信号量存储器为所实施的数据一致性提供硬件辅助。
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公开(公告)号：CN107438850A
公开(公告)日：2017-12-05
申请号：CN201680019968.6
申请日：2016-05-13
申请人： 谷歌公司
发明人： B.C.塞雷布林
CPC分类号： H04L63/0876 , G06F12/1081 , G06F12/1408 , G06F12/1475 , G06F21/79 , G06F2212/1052 , H04L9/3247 , H04L63/062 , H04L63/164
摘要： 用于生成签名的地址的、包括在计算机存储介质上编码的计算机程序的方法、系统和装置。所述方法中的一个包括：通过组件从设备接收多个第一请求，每个第一请求用于物理地址并且包括虚拟地址，由所述组件使用所述虚拟地址确定第一物理地址，生成用于第一物理地址的第一签名，并且为所述设备提供包括第一签名的响应；从设备接收多个第二请求，每一个第二请求用于访问第二物理地址并且包括第二签名，对于所述多个第二请求中的每一个，由所述组件使用第二签名确定第二物理地址是否是有效的，并且对于第二物理地址被确定为有效的每一个第二请求，向对应的第二请求提供服务。
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公开(公告)号：CN106030499A
公开(公告)日：2016-10-12
申请号：CN201480075734.4
申请日：2014-05-28
申请人： 株式会社日立制作所
CPC分类号： H04L67/06 , G06F3/06 , G06F12/1081 , G06F15/17331 , H04L67/1097 , H04L67/42
摘要： 本发明实际有效地削减了服务器存储器之间的传送数据量，并实现了服务器存储器之间的实效频带的宽带化。接口设备位于服务器模块内，当接收到由服务器处理器发布的读取请求时，将基于读取请求的读取指令发送至存储器处理器，在从存储器处理器接收到使接口设备针对将读取请求的对象数据转换得到的转换后对象数据的逆转换的逆转换指示的情况下，进行一边对保存于存储器内存上的传送源地址的转换后对象数据进行逆转换、一边传送至服务器内存上的传送目的地地址的DMA。
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公开(公告)号：CN105975413A
公开(公告)日：2016-09-28
申请号：CN201610134805.4
申请日：2016-03-09
申请人： 国际商业机器公司
CPC分类号： G06F12/1009 , G06F9/45558 , G06F12/1081 , G06F15/17331 , G06F2009/45583 , G06F2009/45595 , G06F2212/1041 , G06F2212/657 , H04L67/1097 , H04L69/40 , G06F13/28 , G06F9/45504 , G06F9/4856
摘要： 本公开的实施例涉及用于迁移虚拟机的RDMA存储器映射的控制器和方法。提出了一种具有RDMA能力的网络接口控制器，该网络接口控制器用于使用多个映射表来提供到物理机的物理存储器的RDMA访问。物理存储器包括多个物理存储器区域，物理存储器区域中的至少一些物理存储器区域与运行在物理机上的虚拟机的虚拟存储器区域相关联。网络接口控制器包括映射单元，映射单元被配置为基于映射表将存储器区域标识符映射到虚拟存储器区域并且映射到相关联的物理存储器区域，该网络接口控制器还包括处理单元，处理单元被配置为从客户端接收访问物理存储器区域中的、与虚拟机的虚拟存储器区域相关联的一个物理存储器区域的访问请求。
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公开(公告)号：CN105518746A
公开(公告)日：2016-04-20
申请号：CN201480030019.9
申请日：2014-12-24
申请人： 英特尔公司
CPC分类号： G06T1/60 , G06F9/455 , G06F9/45533 , G06F9/45558 , G06F12/10 , G06F12/1009 , G06F12/1081 , G06F2009/45562 , G06F2009/45591 , G06F2212/1016 , G06F2212/151 , G06F2212/302 , G06T15/005 , G06T15/60
摘要： 在多个实施例中，图形处理器与虚拟机监控器(VMM)耦合以将虚拟图形处理器呈现给一个或多个虚拟机。用于虚拟图形处理器的中介者利用对虚拟化进行俘获和仿真来将对虚拟机的客体图形转换表(GTT)的修改同步地阴影化成VMM的阴影GTT。如果中介者检测到对客体GTT的修改的频率超过了阈值，则中介者随后可以将客体GTT的至少部分异步地阴影化成阴影GTT，并且在将用于虚拟图形处理器的命令提交给所述图形处理器之前来重建所述阴影GTT。
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公开(公告)号：CN102915208B
公开(公告)日：2016-04-20
申请号：CN201210272624.X
申请日：2012-08-01
申请人： 株式会社东芝
IPC分类号： G06F3/06
CPC分类号： G06F3/061 , G06F3/0604 , G06F3/0638 , G06F3/064 , G06F3/0688 , G06F11/1458 , G06F12/0246 , G06F12/0253 , G06F12/0292 , G06F12/10 , G06F12/1027 , G06F12/1081 , G06F13/28 , G06F2212/7201 , G06F2212/7205
摘要： 本发明的实施方式的信息处理装置包括主机装置和半导体存储装置。上述主机装置包括主存储器。上述半导体存储装置包括非易失性半导体存储器、存储部和控制部。上述非易失性半导体存储器存储第1逻辑物理变换表及数据。上述存储部存储作为上述第1逻辑物理变换表的一部分的第2逻辑物理变换表。上述控制部参照上述第2逻辑物理变换表对上述非易失性半导体存储器进行访问。在上述主存储器上复制上述第1逻辑物理变换表的至少一部分。在上述第2逻辑物理变换表未登记通过上述控制部访问的逻辑地址或物理地址的情况下，将上述主存储器上的第3逻辑物理变换表的一部分复制到上述第2逻辑物理变换表。
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公开(公告)号：CN103026348B
公开(公告)日：2016-03-16
申请号：CN201180009059.1
申请日：2011-02-16
申请人： 超威半导体公司
IPC分类号： G06F12/1027 , G06F12/1081
CPC分类号： G06F12/1081 , G06F12/1027 , G06F2212/6028 , G06F2212/654
摘要： 实施例容许具有独立于页表结构和格式的改进转换性能的输入/输出内存管理单元（IOMMU）的较小的、较简单的硬件实现。实施例还提供了实现的设备无关的结构和方法，使得软件的通用性更强（较少的特定软件版本，进而降低了开发成本）。
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公开(公告)号：CN103842976B
公开(公告)日：2016-01-20
申请号：CN201280046643.9
申请日：2012-09-24
申请人： 超威半导体公司
CPC分类号： G06F12/1081 , G06F12/145 , G06F12/1491 , G06F21/79 , G06F21/85 , G06F2212/1052 , G06F2221/2129
摘要： 一种存储器管理单元被配置成从多个I/O装置接收对存储器访问的请求。所述存储器管理单元实施保护模式，其中所述单元通过将存储器访问请求（从所述I/O装置）映射至同一组存储器地址转换数据而防止所述多个I/O装置进行存储器访问。当所述存储器管理单元不处于所述保护模式中时，所述单元将存储器访问请求从所述多个I/O装置映射至不同的各个组的存储器地址转换数据。因此，所述存储器管理单元可使用比通常所需的更少的地址转换表（例如，无）保护存储器免于被I/O装置访问。
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