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公开(公告)号：CN111752889A
公开(公告)日：2020-10-09
申请号：CN202010124286.X
申请日：2020-02-27
Applicant: 英特尔公司
IPC: G06F15/78
Abstract: 描述了用于多级保留站的处理器和方法。例如，设备的一个实施例包括：执行电路，包括用于执行多个操作的多个功能单元；保留站，包括用于存储将在功能单元中的一个或多个上执行的对应多个操作的多个条目，保留站包括：第一RS级，用于保存第一子集的多个操作，其准备好供一个或多个功能单元执行或其期望准备好供功能单元执行；第二RS级，用于保存第二子集的多个操作，其不期望准备好供功能单元执行；操作评估电路，用于评估第一RS级中的操作，并且响应于标识不期望准备好执行的一个或多个操作，以促使一个或多个操作从第一RS级被移动到第二RS级。
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